DDR2 SDRAM是目前內(nèi)存市場上的主流內(nèi)存。除了通用計算機系統(tǒng)外，大量的嵌入式系統(tǒng)也紛紛采用DDR2內(nèi)存，越來越多的SoC系統(tǒng)芯片中會集成有DDR2接口模塊。因此，設(shè)計一款匹配DDR2的內(nèi)存控制器將會具有良好的應(yīng)用前景。 論文在研究了DDR2的JEDEC標(biāo)準(zhǔn)的基礎(chǔ)上，設(shè)計出DDR2控制器的整體架構(gòu)，采用自項向下的設(shè)計方法和模塊化的思想，將DDR2控制器劃分為若干模塊，并使用Verilog HDL語言完成DDR2控制器IP軟核中初始化模塊、配置模塊、執(zhí)行模塊和數(shù)據(jù)通道模塊的RTL級設(shè)計。根據(jù)在設(shè)計中遇到的問題，對DDR2控制器的整體架構(gòu)進(jìn)行改進(jìn)與完善。在分析了Altera數(shù)字PHY的基本性能的基礎(chǔ)上，設(shè)計DDR2控制器與數(shù)字PHY的接口模塊。搭建DDR2控制器IP軟核的仿真驗證平臺，針對設(shè)計的具體功能進(jìn)行仿真驗證，并實現(xiàn)在Altera Stratix II GX90開發(fā)板上對DDR2存儲芯片基本讀/寫操作控制的FPGA功能演示。 論文設(shè)計的DDR2控制器的主要特點是： 1.支持?jǐn)?shù)字PHY電路，不需要實際的硬件電路就完成DDR2控制器與DDR2存儲芯片之間的物理層接口，節(jié)約了設(shè)計成本，縮小了硬件電路的體積。 2.將配置口從初始化模塊中分離出來，簡化了具體操作。 3.支持多個DDR2存儲芯片，使得DDR2控制器的應(yīng)用范圍更為廣闊。 4.支持DDR2的三項新技術(shù)，充分發(fā)揮DDR2內(nèi)存的特性。 5.自動DDR2刷新控制，方便用戶對DDR2內(nèi)存的控制。
上傳時間： 2013-06-10
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減搖鰭是船舶與海洋工程中的一種重要系統(tǒng)，目前已在多種船舶中廣泛應(yīng)用。減搖鰭對于提高船舶耐波性，增加船舶使用壽命，改善設(shè)備與人員的工作條件，提高艦艇的戰(zhàn)斗力具有重要作用。減小船舶橫搖是目前船舶運動控制領(lǐng)域的重要課題之一。本文以船舶減搖鰭系統(tǒng)作為研究對象，重點講述了基于ARM處理器的減搖鰭控制器的設(shè)計與實現(xiàn)方案。 減搖鰭系統(tǒng)目前大多采用基于力矩對抗原理的PID控制器。控制器的性能對船舶自然橫搖周期和無因次橫搖衰減系數(shù)有著很大的依賴關(guān)系。由于船舶橫搖運動的復(fù)雜性、非線性、時變性和海況的不確定性，經(jīng)典PID控制難以獲得滿意的控制效果。采用先進(jìn)的控制策略是解決這一問題的有效方法。本論文將模糊控制與PID控制相結(jié)合，實現(xiàn)了無須精確的對象模型，只須將操作人員和專家長期實踐積累的經(jīng)驗知識用控制規(guī)則模型化，然后用模糊推理在線辨識對象特征參數(shù)，便可對PID參數(shù)實現(xiàn)自整定。另外，浪級調(diào)節(jié)器做為減搖鰭控制器的一個重要組成部分，本論文也對其設(shè)計進(jìn)行了研究，提出了一種基于海浪譜估計的浪級調(diào)節(jié)器的設(shè)計方法，彌補了傳統(tǒng)浪級調(diào)節(jié)器不能充分利用海浪信息的不足。 目前大多數(shù)的減搖鰭控制器使用單片機作為主處理器或者以工控機為基礎(chǔ)開發(fā)而來的，前者集成度不高，穩(wěn)定性也不好，而后者成本較高。因此，本課題設(shè)計了一款新型的基于ARM處理器的減搖鰭控制器，解決了上述問題。該系統(tǒng)主要由硬件平臺和軟件平臺兩部分組成。硬件平臺主要包括基于飛利浦公司的LPC2214的控制器核心電路和輔助實現(xiàn)控制的驅(qū)動電路；軟件平臺主要是基于ARM的軟件，包括啟動代碼和應(yīng)用程序。 研究結(jié)果表明：開發(fā)的嵌入式減搖鰭控制系統(tǒng)不僅具有集成度高、性價比高、性能優(yōu)越、抗干擾能力強、穩(wěn)定性好、實時性高等優(yōu)點。同時更能夠適應(yīng)減搖鰭控制系統(tǒng)智能化的發(fā)展趨勢，所以該減搖鰭控制器具有很好的使用價值及意義。
上傳時間： 2013-07-10
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智能控制器是智能斷路器的核心，不僅具有普通脫扣器的各種保護(hù)功能，而且還具有實時參數(shù)顯示、故障記憶和查詢、自診斷等多項功能。在回顧和總結(jié)了智能斷路器的發(fā)展歷程后，討論了當(dāng)前智能斷路器的發(fā)展趨勢，提出了基于ARM的斷路器智能控制器的研究。本論文介紹了斷路器智能控制器的設(shè)計原理，同時重點闡述了斷路器智能控制器的各項參數(shù)測量及保護(hù)原理和算法，并進(jìn)行了具體的硬件和軟件模塊的設(shè)計，旨在實現(xiàn)斷路器的智能保護(hù)。 本文涉及的斷路器智能控制器，在硬件上以PHILIPS公司的ARM芯片LPC2294為核心處理器，主要進(jìn)行數(shù)據(jù)的實時采集處理和斷路器的故障保護(hù)。硬件設(shè)計采用了標(biāo)準(zhǔn)化模塊設(shè)計方法，硬件電路盡可能選擇標(biāo)準(zhǔn)化、模塊化結(jié)構(gòu)的典型電路，以便擴展。其中，液晶選用的是SMG240128A，鍵盤芯片選用的是ZLG7290。軟件的編制采用模塊化編程方法，每一個模塊相對獨立，完成特定功能，便于維護(hù)添加新功能。編程工具為ARM公司提供的ADS1.2。為了保證智能控制器各種保護(hù)功能的可靠實現(xiàn)，論文中對智能控制器的干擾源進(jìn)行了分析，從硬件和軟件兩個方面采取了多項設(shè)計措施，提高了智能控制器的穩(wěn)定性和可靠性。實踐證明，論文中構(gòu)建的斷路器智能控制器結(jié)構(gòu)簡單，易于實現(xiàn)，可以滿足系統(tǒng)需要，因此具有較高的實用價值。
上傳時間： 2013-06-10
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本文對TCN中的MVB技術(shù)進(jìn)行了研究，并在深入了解MVB的通信機制的基礎(chǔ)上，提出了采用FPGA替代MVB控制器專用芯片的解決方法。根據(jù)TCN協(xié)議，連接在MVB上的設(shè)備可以分為5類，其中1類設(shè)備可以在不需要CPU的基礎(chǔ)上實現(xiàn)自動通信，最為常用。本設(shè)計的目的就是采用FPGA替代MVB1類設(shè)備控制器。 文章采用自頂向下的模塊化設(shè)計方法，根據(jù)MVB1類設(shè)備控制器要實現(xiàn)的功能，將設(shè)計劃分為3個模塊：發(fā)送模塊、接收模塊和MVB1類模式控制模塊。其中發(fā)送模塊又劃分為位控制單元、CRC生成單元、FIFO單元和曼徹斯特編碼單元等。接收模塊又劃分為幀起始檢測單元、時鐘恢復(fù)單元、幀分界符檢測單元、數(shù)據(jù)譯碼單元、CRC校驗單元、譯碼控制單元和長度錯誤檢測單元等。MVB1類模式控制模塊又劃分為報文錯誤處理單元、主幀寄存器單元、TM控制單元和主控單元等。上述各模塊的RTL級設(shè)計都是采用硬件描述語言Verilog實現(xiàn)的。
標(biāo)簽： MVB1 FPGA 設(shè)備 控制器
上傳時間： 2013-07-21
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隨著印制電路板功能的日益增強，結(jié)構(gòu)日趨復(fù)雜，系統(tǒng)中各個功能單元之間的連線間距越來越細(xì)密，基于探針的電路系統(tǒng)測試方法已經(jīng)很難滿足現(xiàn)在的測試需要。邊界掃描測試(BST)技術(shù)通過將邊界掃描寄存器單元安插在集成電路內(nèi)部的每個引腳上，相當(dāng)于設(shè)置了施加激勵和觀測響應(yīng)的內(nèi)建虛擬探頭，通過該技術(shù)可以大大的提高數(shù)字系統(tǒng)的可觀測性和可控性，降低測試難度。針對這種測試需求，本文給出了基于FPGA的邊界掃描控制器設(shè)計方法。 完整的邊界掃描測試系統(tǒng)主要由測試控制部分和目標(biāo)器件構(gòu)成，其中測試控制部分由測試圖形、數(shù)據(jù)的生成與分析及邊界掃描控制器兩部分構(gòu)成。而邊界掃描控制器是整個系統(tǒng)的核心，它主要實現(xiàn)JTAG協(xié)議的自動轉(zhuǎn)換，產(chǎn)生符合IEEE標(biāo)準(zhǔn)的邊界掃描測試總線信號，而邊界掃描測試系統(tǒng)工作性能主要取決與邊界掃描控制器的工作效率。因此，設(shè)計一個能夠快速、準(zhǔn)確的完成JTAG協(xié)議轉(zhuǎn)換，并且具有通用性的邊界掃描控制器是本文的主要研究工作。 本文首先從邊界掃描技術(shù)的基本原理入手，分析邊界掃描測試的物理基礎(chǔ)、邊界掃描的測試指令及與可測性設(shè)計相關(guān)的標(biāo)準(zhǔn)，提出了邊界掃描控制器的總體設(shè)計方案。其次，采用模塊化設(shè)計思想、VHDL語言描述來完成要實現(xiàn)的邊界掃描控制器的硬件設(shè)計。然后，利用自頂向下的驗證方法，在對控制器內(nèi)功能模塊進(jìn)行基于Testbench驗證的基礎(chǔ)上，利用嵌入式系統(tǒng)的設(shè)計思想，將所設(shè)計的邊界掃描控制器集成到SOPC中，構(gòu)成了基于SOPC的邊界掃描測試系統(tǒng)。并且對SOPC系統(tǒng)進(jìn)行軟硬件協(xié)同仿真，實現(xiàn)對邊界掃描控制器的功能驗證后將其應(yīng)用到實際的測試電路當(dāng)中。最后，在基于SignalTapⅡ硬件調(diào)試的基礎(chǔ)上，軟硬件結(jié)合對整個系統(tǒng)可行性進(jìn)行了測試。從測試結(jié)果看，達(dá)到了預(yù)期的設(shè)計目標(biāo)，該邊界掃描控制器的設(shè)計方案是正確可行的。 本文設(shè)計的邊界掃描控制器具有自主知識產(chǎn)權(quán)，可以與其他處理器結(jié)合構(gòu)成完整的邊界掃描測試系統(tǒng)，并且為SOPC系統(tǒng)提供了一個很有實用價值的組件，具有很明顯的現(xiàn)實意義。
上傳時間： 2013-07-20
上傳用戶：hewenzhi
該系統(tǒng)采用自校正控制原理和常規(guī)PID控制相結(jié)合的算法!能快速整定出PID控制器的參數(shù)
標(biāo)簽： C8051F020 PID 參數(shù) 自整定
上傳時間： 2013-10-21
上傳用戶：Shaikh
本系統(tǒng)采用Visual Foxprow 5.0編寫,面向?qū)ο罂梢暬幊?使系統(tǒng)的開發(fā)工作適應(yīng)目前的流行趨勢。設(shè)計時采用了常用的自頂向下的瀑布式結(jié)構(gòu)化設(shè)計方法。各子系統(tǒng)具有獨立的數(shù)據(jù)庫結(jié)構(gòu)，設(shè)計時力求簡單易用，便于維護(hù)。各模塊為平行關(guān)系，彼此間無直接的參數(shù)聯(lián)系，也無庫的交叉關(guān)聯(lián)，從而保證各子系統(tǒng)可以單獨運行。
上傳時間： 2015-03-12
上傳用戶：zhichenglu
本系統(tǒng)采用Visual Foxprow 5.0編寫,面向?qū)ο罂梢暬幊?使系統(tǒng)的開發(fā)工作適應(yīng)目前的流行趨勢。設(shè)計時采用了常用的自頂向下的瀑布式結(jié)構(gòu)化設(shè)計方法。各子系統(tǒng)具有獨立的數(shù)據(jù)庫結(jié)構(gòu)，設(shè)計時力求簡單易用，便于維護(hù)。各模塊為平行關(guān)系，彼此間無直接的參數(shù)聯(lián)系，也無庫的交叉關(guān)聯(lián)，從而保證各子系統(tǒng)可以單獨運行。
上傳時間： 2014-01-01
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單片機上智能拼音輸入法,附有控制和杳詢函數(shù).方便使用調(diào)用.可以自加LCD實現(xiàn)可視化鍵盤輸入!供大家參考!
標(biāo)簽： LCD 單片機 函數(shù) 拼音輸入法
上傳時間： 2015-04-15
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數(shù)值微分和數(shù)值積分:Newton-Cotes公式、復(fù)化公式和區(qū)間逐次半分法、外推法和Romberg積分、自適應(yīng)Simpson積分法
標(biāo)簽： Newton-Cotes Romberg Simpson 積分
上傳時間： 2015-04-21
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