信息技術在建筑行業(yè)的高速發(fā)展使得智能住宅和智能小區(qū)迅速崛起并成長為巨大的新興產(chǎn)業(yè)。文章提出了一個基于$3C2410的高性能、低價格的WLAN智能住宅控制終端的設計方案。該方案依托成熟的無線局域
上傳時間： 2013-05-26
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EDA卷積碼編解碼器實現(xiàn)技術針對某擴頻通信系統(tǒng)數(shù)據(jù)糾錯編碼的需要, 構造并分析了(2 , 1 , 6) 卷積碼編解碼器的基本工作原理, 提出了基于MAX +
標簽： EDA 卷積碼 編解碼器 實現(xiàn)技術
上傳時間： 2013-07-18
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MSP430USB仿真器制作資料+430JTAG簡版仿真器+利爾達- 輕松制作MSP430 JTAG Adapter+制作的單面板的MSP430JTAG仿真器 幾套430JTAG制作方案，做不好你找我........
上傳時間： 2013-07-26
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本文分析了目前軟PLC 編輯器中功能塊編程的不足，提出了使用面向對象的概念來設計功能塊圖的方法。通過研究軟PLC 開發(fā)系統(tǒng)和編譯系統(tǒng)的模型，詳細討論了PLC 梯形圖中圖元的設計方法，并基于此方
上傳時間： 2013-06-21
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光伏并網(wǎng)逆變器是將太陽能電池所輸出的直流電轉換成符合公共電網(wǎng)要求的交流電并送入電網(wǎng)的設備。按照不同的標準光伏并網(wǎng)逆變器的拓撲結構分為很多種，本文介紹了一種工頻隔離型光伏并網(wǎng)逆變器
標簽： 太陽能電池 光伏并網(wǎng) 逆變器
上傳時間： 2013-08-02
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Reed-Solomon碼(簡稱RS碼)是一種具有很強糾正突發(fā)和隨機錯誤能力的信道編碼方式，在深空通信、移動通信、磁盤陣列以及數(shù)字視頻廣播(DVB)等系統(tǒng)中具有廣泛的應用。 本文簡要介紹了有限域基本運算的算法和常用的RS編碼算法，分析了改進后的Euclid算法和改進后的BM算法，針對改進后的BM算法提出了一種流水線結構的譯碼器實現(xiàn)方案并改進了該算法的實現(xiàn)結構，在譯碼器復雜度和譯碼延時上作了折衷，降低了譯碼器的復雜度并提高了譯碼器的最高工作頻率。在Xilinx公司的Virtex-Ⅱ系列FPGA上設計實現(xiàn)了RS(255,239)編譯碼器，證明了該方案的可行性。
上傳時間： 2013-06-11
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本課題首先研究了常規(guī)的RS譯碼器的算法，確定在關鍵方程的計算中采用一種新改進的BM算法，然后提出了基于復數(shù)基的有限域快速并行乘法器和利用冪指數(shù)相減進行除法計算的有限域除法器，通過這些優(yōu)化方法提高了RS譯碼器的速度，減少了譯碼延時和硬件資源使用，最后利用VHDL硬件描述語言在FPGA上實現(xiàn)了流水線處理的RS(255,223)譯碼器?！? 本課題實現(xiàn)的RS(255,223)硬件譯碼器的性能在國內具有領先水平，對我國以后航天項目高速數(shù)據(jù)傳輸系統(tǒng)的設計有著很大的意義?！?/p>
上傳時間： 2013-06-29
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全數(shù)字調制解調技術具有多速率、多制式、智能性等特點，這極大的提高了通信系統(tǒng)的靈活性和通用性，符合未來通信技術發(fā)展的方向?！ ”疚膹娜缦聨讉€方面對全數(shù)字調制解調器進行了深入系統(tǒng)研究：1，在介紹全數(shù)字調制解調器的發(fā)展現(xiàn)狀和研究QPSK通信調制解調方式的基礎上，依據(jù)軟件定性仿真分析了QPSK正交調制解調系統(tǒng)，設計出了滿足系統(tǒng)要求的實現(xiàn)電路框圖并選定了芯片；2，在完成了基于FPGA芯片實現(xiàn)QPSK調制解調的算法方案設計基礎上，利用VHDL語言完成了芯片程序的設計，并對其進行了調試和功能仿真；3，利用設計出的調制解調器與選定的AD、DA、正交調制解調芯片，完成了QPSK通信系統(tǒng)的硬件電路的設計并完成了調制電路的研制；4，完成電路的信息速率大于300Kbps，產(chǎn)生的中頻信號中心頻率70MHz，帶寬500KHz，滿足系統(tǒng)設計要求，由于時間關系解調電路仍在調試中。 本文基于FPGA實現(xiàn)的QPSK數(shù)字調制解調器具有體積小、集成度高和軟件可升級等優(yōu)點，這為設計高集成和高靈活性的通信系統(tǒng)提供了技術基礎。
上傳時間： 2013-07-08
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本文對于全并行Viterbi譯碼器的設計及其FPGA實現(xiàn)方案進行了研究，并最終將用FPGA實現(xiàn)的譯碼器嵌入到某數(shù)字通信系統(tǒng)之中?！ ∈紫冉榻B了卷積碼及Viterbi譯碼算法的基本原理，并對卷積碼的糾錯性能進行了理論分析。接著介紹了Viterbi譯碼器各個模塊實現(xiàn)的一些經(jīng)典算法，對這些算法的硬件結構設計進行優(yōu)化并利用FPGA實現(xiàn)，而后在QuartusⅡ平臺上對各模塊的實現(xiàn)進行仿真以及在Matlab平臺上對結果進行驗證。最后給出Viterbi譯碼模塊應用在實際系統(tǒng)上的誤碼率測試性能結果?！ y試結果表明，系統(tǒng)的誤碼率達到了工程標準的要求，從而驗證了譯碼器設計的可靠性，同時所設計的基于FPGA實現(xiàn)的全并行Viterbi譯碼器適用于高速數(shù)據(jù)傳輸?shù)膽脠龊稀?/p>
上傳時間： 2013-07-30
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數(shù)字電視近年來飛速發(fā)展，它最終取代模擬電視是一個必然趨勢。可編程邏輯技術以及EDA技術的升溫也帶來了電子系統(tǒng)設計的巨大變革。本論文將迅速發(fā)展的FPGA技術應用于數(shù)字電視系統(tǒng)中，研究探討了數(shù)字電視前端系統(tǒng)中的關鍵設備——傳輸流復用器的FPGA建模和實現(xiàn)，以及相關的關鍵技術。本論文首先介紹了數(shù)字電視的發(fā)展現(xiàn)狀和前景，概述了數(shù)字電視前端系統(tǒng)的組成結構與關鍵技術，以及可編程邏輯技術的發(fā)展和優(yōu)勢。然后介紹了數(shù)字電視系統(tǒng)中的重要標準MPEG-2以及傳輸流復用器的原理和系統(tǒng)結構，并且從理論上闡述了復用器設計的關鍵技術：PSI重組和PCR調整。接著詳細說明了如何運用創(chuàng)新思路，采用獨特的硬件架構在一片F(xiàn)PGA上實現(xiàn)整個復用器的軟件和硬件系統(tǒng)的方案，并且舉例說明了復用器硬件邏輯設計中所運用的幾個FPGA設計技巧。最后對本文進行總結，并提出了數(shù)字電視系統(tǒng)中復用器設備未來發(fā)展的設想。本文中介紹的基于SOPC的硬件復用器設計方案，將系統(tǒng)的軟件和硬件集成在一款Altera公司新推出的低成本高密度cyclone系列FPGA上，并且將FPGA設計技巧運用于復用器的硬件邏輯設計中。整個設計方案不但簡化了系統(tǒng)設計，而且實現(xiàn)了穩(wěn)定，高速，低成本，可擴展性強的復用器系統(tǒng)。
上傳時間： 2013-06-02
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