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RS(255,223)譯碼器的FPGA實(shí)現(xiàn)及其性能測試

  • 資源大?。?/b>2327 K
  • 上傳時(shí)間: 2013-06-29
  • 上傳用戶:wnyoxyku
  • 資源積分:2 下載積分
  • 標(biāo)      簽: FPGA 255 223 譯碼器

資 源 簡 介

  本課題首先研究了常規(guī)的RS譯碼器的算法,確定在關(guān)鍵方程的計(jì)算中采用一種新改進(jìn)的BM算法,然后提出了基于復(fù)數(shù)基的有限域快速并行乘法器和利用冪指數(shù)相減進(jìn)行除法計(jì)算的有限域除法器,通過這些優(yōu)化方法提高了RS譯碼器的速度,減少了譯碼延時(shí)和硬件資源使用,最后利用VHDL硬件描述語言在FPGA上實(shí)現(xiàn)了流水線處理的RS(255,223)譯碼器。   本課題實(shí)現(xiàn)的RS(255,223)硬件譯碼器的性能在國內(nèi)具有領(lǐng)先水平,對我國以后航天項(xiàng)目高速數(shù)據(jù)傳輸系統(tǒng)的設(shè)計(jì)有著很大的意義?!?/p>

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