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數(shù)(shù)模命題

可以做數(shù)學(xué)陣列的反轉(zhuǎn), 是一個(gè)cla

可以做數(shù)學(xué)陣列的反轉(zhuǎn), 是一個(gè)cla

標(biāo)簽： cla

上傳時(shí)間： 2014-01-06

上傳用戶：waizhang
背包問(wèn)題是關(guān)於最佳化的問(wèn)題

背包問(wèn)題是關(guān)於最佳化的問(wèn)題，要解最佳化問(wèn)題可以使用「動(dòng)態(tài)規(guī)劃」（Dynamic programming），從空集合開(kāi)始，每增加一個(gè)元素就先求出該階段的最佳解，直到所有的元素加入至集合中，最後得到的就是最佳解。以背包問(wèn)題為例，我們使用兩個(gè)陣列value與item，value表示目前的最佳解所得之總價(jià)，item表示最後一個(gè)放至背包的水果，假設(shè)有負(fù)重量 1～8的背包8個(gè)，並對(duì)每個(gè)背包求其最佳解

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上傳時(shí)間： 2014-01-22

上傳用戶：aix008
與奇數(shù)魔術(shù)方陣相同

與奇數(shù)魔術(shù)方陣相同，在於求各行、各列與各對(duì)角線的和相等，而這次方陣的維度是4的倍數(shù)。

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上傳時(shí)間： 2013-12-18

上傳用戶：shus521
說(shuō)明除了自身之外

說(shuō)明除了自身之外，無(wú)法被其它整數(shù)整除的數(shù)稱之為質(zhì)數(shù)，要求質(zhì)數(shù)很簡(jiǎn)單，但如何快速的求出質(zhì)數(shù)則一直是程式設(shè)計(jì)人員與數(shù)學(xué)家努力的課題，在這邊介紹一個(gè)著名的 Eratosthenes求質(zhì)數(shù)方法解。以背包問(wèn)題為例，我們使用兩個(gè)陣列value與item，value表示目前的最佳解所得之總價(jià)，item表示最後一個(gè)放至背包的水果，假設(shè)有負(fù)重量 1～8的背包8個(gè)，並對(duì)每個(gè)背包求其最佳解。

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上傳時(shí)間： 2013-12-22

上傳用戶：二驅(qū)蚊器
復(fù)數(shù)計(jì)算,實(shí)現(xiàn)復(fù)數(shù)的加減乘除,求模,求主幅角,求共軛等功能

復(fù)數(shù)計(jì)算,實(shí)現(xiàn)復(fù)數(shù)的加減乘除,求模,求主幅角,求共軛等功能

標(biāo)簽： 計(jì)算減模

上傳時(shí)間： 2014-01-12

上傳用戶：壞天使kk
DPLL由鑒相器模K加減計(jì)數(shù)器脈沖加減電路同步建立偵察電路模N分頻器構(gòu)成. 整個(gè)系統(tǒng)的中心頻率(即signal_in和signal_out的碼速率的2倍) 為clk/8/N. 模K

DPLL由鑒相器模K加減計(jì)數(shù)器脈沖加減電路同步建立偵察電路模N分頻器構(gòu)成. 整個(gè)系統(tǒng)的中心頻率(即signal_in和signal_out的碼速率的2倍) 為clk/8/N. 模K加減計(jì)數(shù)器的K值決定DPLL的精度和同步建立時(shí)間,K越大,則同步建立時(shí)間長(zhǎng),同步精度高.反之則短,低.

標(biāo)簽： signal_out signal_in DPLL 模

上傳時(shí)間： 2013-12-26

上傳用戶：希醬大魔王
利用凌陽(yáng)單片機(jī)開(kāi)發(fā)傳感器模組電路,方便學(xué)習(xí)了解凌陽(yáng)單片機(jī)

利用凌陽(yáng)單片機(jī)開(kāi)發(fā)傳感器模組電路,方便學(xué)習(xí)了解凌陽(yáng)單片機(jī)

標(biāo)簽： 凌陽(yáng) 傳感器單片機(jī)開(kāi)發(fā) 凌陽(yáng)單片機(jī)

上傳時(shí)間： 2014-01-14

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基于滑模變結(jié)構(gòu)的倒立擺系統(tǒng)穩(wěn)定控制

基于滑模變結(jié)構(gòu)的倒立擺系統(tǒng)穩(wěn)定控制，歡迎下載！

標(biāo)簽： 滑模變結(jié)構(gòu) 倒立擺系統(tǒng) 穩(wěn)定控制

上傳時(shí)間： 2013-12-16

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VHDL 開(kāi)發(fā)PCI加密解密卡逢甲大學(xué) 資訊工程學(xué)系專題報(bào)告 PCI 介面之加解密卡製作

VHDL 開(kāi)發(fā)PCI加密解密卡逢甲大學(xué) 資訊工程學(xué)系專題報(bào)告 PCI 介面之加解密卡製作

標(biāo)簽： PCI VHDL 加密解密

上傳時(shí)間： 2016-01-21

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滑模經(jīng)典論文a control engineer s guide to sliding mode control

滑模經(jīng)典論文a control engineer s guide to sliding mode control

標(biāo)簽： control engineer sliding guide

上傳時(shí)間： 2016-01-21

上傳用戶：dengzb84

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