<li id="q8qsu"></li> 數(shù)字信號處理是信息科學(xué)中近幾十年來發(fā)展最為迅速的學(xué)科之一.目前,數(shù)字信號處理廣泛應(yīng)用于通信、雷達、聲納、語音與圖像處理等領(lǐng)域.而數(shù)字信號處理算法的硬件實現(xiàn)一般來講有三種方式:用于通用目的的可編程DSP芯片;用于特定目的的固定功能DSP芯片組和ASIC;可以由用戶編程的FPGA芯片.隨著微電子技術(shù)的發(fā)展,采用現(xiàn)場可編程門陣列FPGA進行數(shù)字信號處理得到了飛速發(fā)展,FPGA正在越來越多地代替ASIC和PDSP用作前端數(shù)字信號處理的運算.該文主要探討了基于FPGA數(shù)字信號處理的實現(xiàn).首先詳細(xì)闡述了數(shù)字信號處理的理論基礎(chǔ),重點討論了離散傅立葉變換算法原理,由于快速傅立葉變換算法在實際中得到了廣泛的應(yīng)用,該文給出了基-2FFT算法原理、討論了按時間抽取FFT算法的特點.該論文對硬件描述語言的描述方法和風(fēng)格做了一定的探討,介紹了硬件描述語言的開發(fā)環(huán)境MAXPLUSII.在此基礎(chǔ)上,該論文詳細(xì)闡述了數(shù)字集成系統(tǒng)的高層次設(shè)計方法,討論了數(shù)字系統(tǒng)設(shè)計層次的劃分和數(shù)字系統(tǒng)的自頂向下的設(shè)計方法,探討了數(shù)字集成系統(tǒng)的系統(tǒng)級設(shè)計和寄存器傳輸級設(shè)計,描述了數(shù)字集成系統(tǒng)的高層次綜合方法.最后該文描述了數(shù)字信號處理系統(tǒng)結(jié)構(gòu)的實現(xiàn)方法,指出常見的高速、實時信號處理系統(tǒng)的四種結(jié)構(gòu);由于FFT算法在數(shù)字信號處理中占有重要的地位,所以該文提出了用FPGA實現(xiàn)FFT的一種設(shè)計思想,給出了總體實現(xiàn)框圖;重點設(shè)計實現(xiàn)了FFT算法中的蝶形處理單元,采用了一種高效乘法器算法設(shè)計實現(xiàn)了蝶形處理單元中的旋轉(zhuǎn)因子乘法器,從而提高了蝶形處理器的運算速度,降低了運算復(fù)雜度.
標(biāo)簽： FPGA 數(shù)字信號處理 中的應(yīng)用
上傳時間： 2013-05-23
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·作者：江思敏等編著 叢書名：DSP應(yīng)用開發(fā)教程系列 出版社：機械工業(yè)出版社 ISBN：9787111123224 出版時間：2003-6-1 版次：1版1次 印次： 頁數(shù)：335 字?jǐn)?shù)：535千 紙張：膠版紙 包裝：平裝開本： 內(nèi)容提要本書詳細(xì)講述了TMS320LF240X系列DSP芯片結(jié)構(gòu)、外設(shè)的原理和結(jié)構(gòu)、系統(tǒng)和外設(shè)寄存器等資源。在此基礎(chǔ)上，介紹如何操作TMS320LF240X系統(tǒng)的
上傳時間： 2013-07-12
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隨著現(xiàn)場可編程門陣列(FPGA)在工業(yè)中的廣泛應(yīng)用，使得基于FPGA數(shù)字信號處理的實現(xiàn)在雷達信號處理中有著重要地位。模型化設(shè)計是一種自頂向下的面向FPGA的快速原型驗證法，它不僅降低了FPGA設(shè)計門檻，而且縮短了開發(fā)周期，提高了設(shè)計效率。這使得FPGA模型化設(shè)計成為了FPGA系統(tǒng)設(shè)計的發(fā)展趨勢。本文針對常見雷達信號處理模塊的FPGA模型化實現(xiàn)，在以下幾個方面展開研究：首先對基于FPGA的模型化設(shè)計方法進行了研究，給出了模型化設(shè)計方法的發(fā)展現(xiàn)狀和趨勢，并對本文中使用的模型化設(shè)計方法的軟件工具System Generator和AccelDSP進行了介紹。其次使用這兩種軟件工具對FIR濾波器進行了模型化設(shè)計并同RTL(寄存器傳輸級)設(shè)計方法進行對比，全面分析了模型化設(shè)計方法和RTL設(shè)計方法的優(yōu)缺點。然后在簡明闡述雷達信號處理原理的基礎(chǔ)上，使用System Generator對數(shù)字下變頻(DDC)、脈沖壓縮、動目標(biāo)顯示(MTI)及恒虛警(CFAR)處理等雷達信號處理模塊進行了自頂向下的模型化設(shè)計。在Simulink中進行了功能仿真驗證，生成了HDL代碼，并在Xilinx FPGA中進行了RTL的時序仿真分析。關(guān)鍵詞：雷達信號處理 FPGA 模型化設(shè)計 System Generator AccelDSP
上傳時間： 2013-07-25
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· 摘要： 本文研究了由線性反饋移位寄存器(Linear Feedback Shift Registers,LFSR)生成m序列的原理,并對LFSR電路結(jié)構(gòu)作了改進,利用基于現(xiàn)代DSP技術(shù)的DSP Builder軟件,設(shè)計了一種周期、相位可調(diào)的m序列發(fā)生器.經(jīng)調(diào)試與仿真,結(jié)果表明該方法硬件結(jié)構(gòu)簡單、開發(fā)周期短,為系統(tǒng)設(shè)計或測試帶來很大的便利.
上傳時間： 2013-07-18
上傳用戶：fuzhoulinzexu
根據(jù)輸入的波特率設(shè)置值，計算相關(guān)的寄存器器配置值。
上傳時間： 2013-06-08
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STM8S103，開發(fā)必用資料，有詳細(xì)的寄存器說明
上傳時間： 2013-07-19
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·內(nèi)容簡介 本書從51系列單片機的一般知識出發(fā)，將ARM處理器和51系列單片機進行對比，引導(dǎo)讀者去理解和學(xué)習(xí)ARM處理器的知識。內(nèi)容分為3部分：第1部分是前4章，從大家所熟悉的51系列單片機的基礎(chǔ)知識開始，介紹ARM處理器的基本知識，包括ARM和51系列的對比、中斷處理系統(tǒng)、寄存器和存儲器結(jié)構(gòu)等；第2部分是5～9章，詳細(xì)比較ARM指令和51系列指令之間
標(biāo)簽： ARM 嵌入式系統(tǒng)
上傳時間： 2013-07-21
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STM32中文參考手冊，很詳細(xì)的介紹的STM的內(nèi)部寄存器功能。
上傳時間： 2013-06-28
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DI0~DI7：數(shù)據(jù)輸入線，TLL電平。 ILE：數(shù)據(jù)鎖存允許控制信號輸入線，高電平有效。 CS：片選信號輸入線，低電平有效。 WR1：為輸入寄存器的寫選通信號。 XFER：數(shù)據(jù)傳送控制信號輸入線，低電平有效。
標(biāo)簽： 0832 DAC 應(yīng)用電路圖
上傳時間： 2013-04-24
上傳用戶：小楓殘月
英文描述： 8-Bit Serial-Input/Parallel-Output Shift Register 中文描述： 8位Serial-Input/Parallel-Output移位寄存器
上傳時間： 2013-04-24
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