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可行性驗證

  • 利用動態密勒補償電路解決LDO的穩定性問題

    利用動態密勒補償電路解決LDO的穩定性問題:針對LDO穩壓器的穩定性問題,設計了一種新穎的動態密勒補償電路8與傳統方法相比,該電路具有恒定的帶寬,大大提高了系統的瞬態響應性能,同時將開環增益提高了,左右使6LDO穩壓器具有較高的電壓調整率和負載調整率。通過具體投片,驗證了該方法的正確性和可行性。關鍵詞:低壓降穩壓器,動態密勒補償,穩定性,P型場效應管電容器

    標簽: LDO 動態 密勒補償 電路

    上傳時間: 2013-10-24

    上傳用戶:小寶愛考拉

  • 4x4鍵盤的設計與制作

    三種方法讀取鍵值􀂄 使用者設計行列鍵盤介面,一般常採用三種方法讀取鍵值。􀂉 中斷式􀂄 在鍵盤按下時產生一個外部中斷通知CPU,並由中斷處理程式通過不同位址讀資料線上的狀態判斷哪個按鍵被按下。􀂄 本實驗採用中斷式實現使用者鍵盤介面。􀂉 掃描法􀂄 對鍵盤上的某一行送低電位,其他為高電位,然後讀取列值,若列值中有一位是低,表明該行與低電位對應列的鍵被按下。否則掃描下一行。􀂉 反轉法􀂄 先將所有行掃描線輸出低電位,讀列值,若列值有一位是低表明有鍵按下;接著所有列掃描線輸出低電位,再讀行值。􀂄 根據讀到的值組合就可以查表得到鍵碼。4x4鍵盤按4行4列組成如圖電路結構。按鍵按下將會使行列連成通路,這也是見的使用者鍵盤設計電路。 //-----------4X4鍵盤程序--------------// uchar keboard(void) { uchar xxa,yyb,i,key; if((PINC&0x0f)!=0x0f) //是否有按鍵按下 {delayms(1); //延時去抖動 if((PINC&0x0f)!=0x0f) //有按下則判斷 { xxa=~(PINC|0xf0); //0000xxxx DDRC=0x0f; PORTC=0xf0; delay_1ms(); yyb=~(PINC|0x0f); //xxxx0000 DDRC=0xf0; //復位 PORTC=0x0f; while((PINC&0x0f)!=0x0f) //按鍵是否放開 { display(data); } i=4; //計算返回碼 while(xxa!=0) { xxa=xxa>>1; i--; } if(yyb==0x80) key=i; else if(yyb==0x40) key=4+i; else if(yyb==0x20) key=8+i; else if(yyb==0x10) key=12+i; return key; //返回按下的鍵盤碼 } } else return 17; //沒有按鍵按下 }

    標簽: 4x4 鍵盤

    上傳時間: 2013-11-12

    上傳用戶:a673761058

  • 基于DSP的語音錄播器設計

    本設計講解了光于DSP的語音錄播系統的設計過程,論證了系統的軟硬件的可行性。在硬件中,給出各個單元電路,軟件中給出部分程序。對于初學者相信會有很大幫助!

    標簽: DSP 語音

    上傳時間: 2013-10-10

    上傳用戶:tsfh

  • 基于DSP二維聲源定向系統設計

    系統基于聲波到達時間差技術,采用相位匹配算法,對兩個傳聲器采集的聲音信號進行分析。通過算法仿真驗證了算法的可行性和準確性,并將算法在DSP上實現。

    標簽: DSP 二維 聲源 定向

    上傳時間: 2013-12-11

    上傳用戶:yanqie

  • 基于VHDL的QPSK調制解調系統設計與仿真

    文中詳細介紹了QPSK技術的工作原理和QPSK調制、解調的系統設計方案,并通過VHDL語言編寫調制解調程序和QuartusII軟件建模對程序進行仿真,通過引腳鎖定,下載程序到FPGA芯片EP1K30TC144-3中驗證。軟件仿真和硬件驗證結果表明了該設計的正確性和可行性,由于采用FPGA芯片,減小了硬件設計的復雜性,該設計具有便于移植維護和升級的特點。

    標簽: VHDL QPSK 調制解調 系統設計

    上傳時間: 2013-11-02

    上傳用戶:ajaxmoon

  • 基于FPGA的多功能LCD顯示控制器設計

    通過對LCD1602/LCD12864顯示模塊控制時序和指令集的對比分析,利用Verilog HDL描述語言完成了多功能LCD顯示控制模塊的IP核設計.所設計的LCD顯示控制器具有很好的可移植性,只需通過端口的使能參數配置便可以驅動LCD1602/LCD12864模塊實現字符或圖形的實時顯示,并且該多功能LCD控制器的可行性也在Cyclone II系列的EP2C5T144C8 FPGA芯片上得到了很好的驗證.

    標簽: FPGA LCD 多功能 顯示控制器

    上傳時間: 2014-06-23

    上傳用戶:hasan2015

  • AES中SubBytes算法在FPGA的實現

    介紹了AES中,SubBytes算法在FPGA的具體實現.構造SubBytes的S-Box轉換表可以直接查找ROM表來實現.通過分析SubBytes算法得到一種可行性硬件邏輯電路,從而實現SubBytes變換的功能.

    標簽: SubBytes FPGA AES 算法

    上傳時間: 2013-11-30

    上傳用戶:hzy5825468

  • 采用高速串行收發器Rocket I/O實現數據率為2.5 G

    摘要: 串行傳輸技術具有更高的傳輸速率和更低的設計成本, 已成為業界首選, 被廣泛應用于高速通信領域。提出了一種新的高速串行傳輸接口的設計方案, 改進了Aurora 協議數據幀格式定義的弊端, 并采用高速串行收發器Rocket I/O, 實現數據率為2.5 Gbps的高速串行傳輸。關鍵詞: 高速串行傳輸; Rocket I/O; Aurora 協議 為促使FPGA 芯片與串行傳輸技術更好地結合以滿足市場需求, Xilinx 公司適時推出了內嵌高速串行收發器RocketI/O 的Virtex II Pro 系列FPGA 和可升級的小型鏈路層協議———Aurora 協議。Rocket I/O支持從622 Mbps 至3.125 Gbps的全雙工傳輸速率, 還具有8 B/10 B 編解碼、時鐘生成及恢復等功能, 可以理想地適用于芯片之間或背板的高速串行數據傳輸。Aurora 協議是為專有上層協議或行業標準的上層協議提供透明接口的第一款串行互連協議, 可用于高速線性通路之間的點到點串行數據傳輸, 同時其可擴展的帶寬, 為系統設計人員提供了所需要的靈活性[4]。但該協議幀格式的定義存在弊端,會導致系統資源的浪費。本文提出的設計方案可以改進Aurora 協議的固有缺陷,提高系統性能, 實現數據率為2.5 Gbps 的高速串行傳輸, 具有良好的可行性和廣闊的應用前景。

    標簽: Rocket 2.5 高速串行 收發器

    上傳時間: 2013-11-06

    上傳用戶:smallfish

  • 一種降低OFDM系統PAPR聯合算法的研究

    選擇映射法(SLM)和概率類算法都可以降低OFDM (Orthogonal Frequency Division Multiplexing)系統的PAPR(Peak to Average Power Ratio),傳統SLM算法自身較為復雜,但由于其優良的性能,棄之可惜。研究表明,SLM算法和限幅類算法在性能上具有一定的互補性。任何一個算法未必能達到抑制PAPR的理想效果,在深入研究了兩個算法的基礎上,將其優點聯合起來,以達到降低OFDM系統PAPR的目的。最后對聯合改進算法進行了分析與仿真,并驗證了聯合改進算法的有效性和可行性

    標簽: OFDM PAPR 法的研究

    上傳時間: 2013-11-22

    上傳用戶:xinhaoshan2016

  • 基于Modbus協議的串行通信的應用

    針對目前工控領域,現場數據采集分散管理的不足,該文采用了Modbus RTU通信協議和串口通信技術,設計了主從式通信的采集系統,實現對各個現場的遠程集中監控,即集散控制系統。詳細闡述了在C#環境下基于Modbus RTU通信協議的上位機和DAM-3504系列三相多功能電量采集模塊經過GPRS網絡的主從式串行通信的實現。經過現場測試驗證,表明該方案運行穩定,操作簡便,能夠對采集的數據進行實時顯示,解決了對現場的統一監控和分布式管理的問題,為工業控制現場提供了一套可行性方案。

    標簽: Modbus 協議 串行通信

    上傳時間: 2013-10-29

    上傳用戶:88mao

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