該文檔為基于FPGA信號(hào)發(fā)生器的設(shè)計(jì)與實(shí)現(xiàn)講解文檔,是一份很不錯(cuò)的參考資料,具有較高參考價(jià)值,感興趣的可以下載看看………………
資源簡(jiǎn)介:該文檔為基于fpga信號(hào)發(fā)生器的設(shè)計(jì)與實(shí)現(xiàn)講解文檔,是一份很不錯(cuò)的參考資料,具有較高參考價(jià)值,感興趣的可以下載看看………………
上傳時(shí)間: 2022-01-17
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資源簡(jiǎn)介:基于fpga的數(shù)字視頻信號(hào)發(fā)生器的設(shè)計(jì)與實(shí)現(xiàn)
上傳時(shí)間: 2013-04-24
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資源簡(jiǎn)介:基于fpga的數(shù)字視頻信號(hào)發(fā)生器的設(shè)計(jì)與實(shí)現(xiàn),內(nèi)有全套源碼以及各種配套的圖片,內(nèi)容詳盡,絕對(duì)真實(shí)!
上傳時(shí)間: 2016-06-20
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資源簡(jiǎn)介:·基于DSP的任意波形信號(hào)發(fā)生器的設(shè)計(jì)與實(shí)現(xiàn)
上傳時(shí)間: 2013-07-02
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資源簡(jiǎn)介:基于單片機(jī)控制的數(shù)字函數(shù)信號(hào)發(fā)生器的設(shè)計(jì)與實(shí)現(xiàn)這是一份非常不錯(cuò)的資料,歡迎下載,希望對(duì)您有幫助!
上傳時(shí)間: 2022-03-07
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資源簡(jiǎn)介:vhdl的一個(gè)串行序列信號(hào)發(fā)生器的設(shè)計(jì)與實(shí)現(xiàn)
上傳時(shí)間: 2015-07-15
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資源簡(jiǎn)介:基于fpga的QPSK信號(hào)源的設(shè)計(jì)與實(shí)現(xiàn)
上傳時(shí)間: 2017-08-06
上傳用戶:songnanhua
資源簡(jiǎn)介:基于51單片機(jī)數(shù)字信號(hào)源的設(shè)計(jì)與實(shí)現(xiàn)
上傳時(shí)間: 2013-11-17
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資源簡(jiǎn)介:基于DDS的信號(hào)發(fā)生器的設(shè)計(jì)與開發(fā) The Design and Development of Function Generator Based on DDS
上傳時(shí)間: 2014-01-03
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資源簡(jiǎn)介:基于DDS的信號(hào)發(fā)生器的設(shè)計(jì) 能實(shí)現(xiàn)信號(hào)的檢測(cè) 是基于AT9300
上傳時(shí)間: 2014-01-13
上傳用戶:jichenxi0730
資源簡(jiǎn)介:基于DDS的掃頻信號(hào)源的設(shè)計(jì)與實(shí)現(xiàn)這是一份非常不錯(cuò)的資料,歡迎下載,希望對(duì)您有幫助!
上傳時(shí)間: 2021-12-29
上傳用戶:jason_vip1
資源簡(jiǎn)介:[摘要]本論文主要論述了基于Multisim多功能函數(shù)信號(hào)發(fā)生器的設(shè)計(jì)與仿真。函數(shù)信號(hào)發(fā)生器是一種廣泛應(yīng)用于工業(yè)生產(chǎn)、產(chǎn)品開發(fā)、科學(xué)研究等領(lǐng)域中比較常見的信號(hào)源。函數(shù)信號(hào)發(fā)生器的設(shè)計(jì)方法有很多,可以由專門的集成芯片設(shè)計(jì)產(chǎn)生,也可以由分立元件設(shè)計(jì)產(chǎn)生,...
上傳時(shí)間: 2022-07-21
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資源簡(jiǎn)介:該文檔為基于fpga語(yǔ)音識(shí)別系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)簡(jiǎn)介資料,講解的還不錯(cuò),感興趣的可以下載看看…………………………
上傳時(shí)間: 2021-10-16
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資源簡(jiǎn)介:該文檔為基于fpga語(yǔ)音識(shí)別系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)講解文檔,是一份很不錯(cuò)的參考資料,具有較高參考價(jià)值,感興趣的可以下載看看………………
上傳時(shí)間: 2022-02-02
上傳用戶:1208020161
資源簡(jiǎn)介:基于ZigBee通訊協(xié)議的設(shè)計(jì)與實(shí)現(xiàn),包括物理層電路的設(shè)計(jì),網(wǎng)絡(luò)層和傳輸層的軟件設(shè)計(jì)部分,文檔中均做了詳細(xì)的介紹。
上傳時(shí)間: 2014-01-06
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資源簡(jiǎn)介:0170、基于PLL信號(hào)發(fā)生器的設(shè)計(jì)論文資料
上傳時(shí)間: 2014-04-09
上傳用戶:ljt101007
資源簡(jiǎn)介:0030、基于PLL信號(hào)發(fā)生器的設(shè)計(jì)論文資料
上傳時(shí)間: 2014-04-09
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資源簡(jiǎn)介:基于android手機(jī)通訊錄的設(shè)計(jì)與實(shí)現(xiàn)的畢業(yè)論文基于android手機(jī)通訊錄的設(shè)計(jì)與實(shí)現(xiàn)的畢業(yè)論文
上傳時(shí)間: 2015-02-15
上傳用戶:cqqq
資源簡(jiǎn)介:該文檔為基于fpga異步FIFO的研究與實(shí)現(xiàn)簡(jiǎn)介文檔,是一份很不錯(cuò)的參考資料,具有較高參考價(jià)值,感興趣的可以下載看看………………
上傳時(shí)間: 2021-11-23
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資源簡(jiǎn)介:1、????????????? 設(shè)計(jì)任務(wù)(1)?????????????????? 正弦波、三角波、方波、鋸齒波輸出頻率范圍:1KHZ~1MHZ(2)?????????????????? 具有頻率設(shè)置功能,頻率步驟:100HZ;(3)??????????????...
上傳時(shí)間: 2022-05-30
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資源簡(jiǎn)介:制作一個(gè)正弦信號(hào)發(fā)生器的設(shè)計(jì):(1)正弦波輸出頻率范圍:1kHz~10MHz;(2)具有頻率設(shè)置功能,頻率步進(jìn):100Hz;(3)輸出信號(hào)頻率穩(wěn)定度:優(yōu)于10-2;(4)輸出電
上傳時(shí)間: 2013-06-18
上傳用戶:huannan88
資源簡(jiǎn)介:制作一個(gè)正弦信號(hào)發(fā)生器的設(shè)計(jì):(1)正弦波輸出頻率范圍:1kHz~10MHz;(2)具有頻率設(shè)置功能,頻率步進(jìn):100Hz;(3)輸出信號(hào)頻率穩(wěn)定度:優(yōu)于10-2;(4)輸出電壓幅度:1V到5V這間;(5)失真度:用示波器觀察時(shí)無(wú)明顯失真。(6)輸出電壓幅度:在頻率范...
上傳時(shí)間: 2014-12-21
上傳用戶:Jerry_Chow
資源簡(jiǎn)介:任意波形發(fā)生器已成為現(xiàn)代測(cè)試領(lǐng)域應(yīng)用最為廣泛的通用儀器之一,代表了信號(hào)源的發(fā)展方向。直接數(shù)字頻率合成(DDS)是二十世紀(jì)七十年代初提出的一種全數(shù)字的頻率合成技術(shù),其查表合成波形的方法可以滿足產(chǎn)生任意波形的要求。由于現(xiàn)場(chǎng)可編程門陣列(fpga)具有高集...
上傳時(shí)間: 2013-08-03
上傳用戶:1079836864
資源簡(jiǎn)介:數(shù)據(jù)采集處理技術(shù)是現(xiàn)代信號(hào)處理的基礎(chǔ),廣泛應(yīng)用于雷達(dá)、聲納、軟件無(wú)線電、瞬態(tài)信號(hào)測(cè)試等領(lǐng)域。隨著信息科學(xué)的飛速發(fā)展,人們面臨的信號(hào)處理任務(wù)越來(lái)越繁重,對(duì)數(shù)據(jù)采集處理系統(tǒng)的要求也越來(lái)越高。近年來(lái)fpga由于其設(shè)計(jì)靈活性、更強(qiáng)的適應(yīng)性及可重構(gòu)性,結(jié)...
上傳時(shí)間: 2013-06-24
上傳用戶:wangrong
資源簡(jiǎn)介:本文對(duì)基于fpga的液晶顯示控制系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)進(jìn)行了研究。設(shè)計(jì)中從LCD技術(shù)參數(shù)著手,通過(guò)對(duì)顯示驅(qū)動(dòng)系統(tǒng)結(jié)構(gòu)與工作原理的研究,設(shè)計(jì)出顯示控制系統(tǒng)的框圖及各功能模塊的VHDL程序,通過(guò)單片機(jī)系統(tǒng)配置fpga芯片,控制LCD顯示相應(yīng)的漢字和圖形。LCD顯示控制系...
上傳時(shí)間: 2013-04-24
上傳用戶:asasasas
資源簡(jiǎn)介:隨著無(wú)線通信的應(yīng)用日益廣泛,無(wú)線通信系統(tǒng)的種類也越來(lái)越繁雜,但是由于不同通信系統(tǒng)的工作頻段、調(diào)制方式、通信協(xié)議等原理結(jié)構(gòu)上存在差異而極大限制了不同系統(tǒng)之間的互通。軟件無(wú)線電擺脫了硬件體系結(jié)構(gòu)的束縛,成為解決不同通信體制之間互操作問(wèn)題和開展多...
上傳時(shí)間: 2013-04-24
上傳用戶:mfhe2005
資源簡(jiǎn)介:基于fpga流水線CPU控制器的設(shè)計(jì)與實(shí)現(xiàn):在fpga上設(shè)計(jì)并實(shí)現(xiàn)了一種具有MIPS風(fēng)格的CPU硬布線控制器。
上傳時(shí)間: 2013-08-06
上傳用戶:qw12
資源簡(jiǎn)介:基于fpga的高速FFT處理器的設(shè)計(jì)與實(shí)現(xiàn)
上傳時(shí)間: 2013-08-07
上傳用戶:asdkin
資源簡(jiǎn)介:基于fpga的VGA圖像控制器的設(shè)計(jì)與實(shí)現(xiàn)
上傳時(shí)間: 2013-08-09
上傳用戶:sclyutian
資源簡(jiǎn)介:基于fpga的多功能數(shù)字鐘的設(shè)計(jì)與實(shí)現(xiàn) 內(nèi)附有詳盡的Verilog HDL源碼,其功能主要有:時(shí)間設(shè)置,時(shí)間顯示,跑表,分頻,日期設(shè)置,日期顯示等
上傳時(shí)間: 2013-08-18
上傳用戶:問(wèn)題問(wèn)題