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FPGA VHDL語言DDS函數信號發生器的設計與實現

  • 資源大小:5975 K
  • 上傳時間: 2022-05-30
  • 上傳用戶:lostxc
  • 資源積分:2 下載積分
  • 標      簽: fpga vhdl dds

資 源 簡 介

1、              設計任務

(1)                   正弦波、三角波、方波、鋸齒波輸出頻率范圍:1KHZ~1MHZ

(2)                   具有頻率設置功能,頻率步驟:100HZ;

(3)                   輸出信號頻率定度:優于10 ^4

(4)                   輸出電壓幅度:在5K負載電阻上的電壓峰——峰值Vopp≧1V;

(5)                   失真度:用示波器觀察使無明顯失真。

 

2、              基本要求:

(1)       掌握采用FPGA硬件特性、及軟件開發工具MAXPLUSII的使用。

(2)       掌握DDS函數信號發生器的原理,并采用VIIDL語言設計DDS內核單元。

(3)       掌握單片機與DDS單無連接框圖原理,推導出頻率控制字、相位控制字的算法。

(4)       設計鍵盤輸入電路和程序并調試。掌握鍵盤和顯示(LCD1602)配合使用的方法和技巧。

(5)       掌握硬件和軟件聯合調試的方法。

(6)       完成系統硬件電路的設計和制作。

(7)       完成系統程序的設計。

(8)       完成整個系統的設計、調試和制作。

(9)       完成課程設計報告。


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