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基于VHDL(verilog)語言的UART的設計與實現。全面模仿AVR的UART功能

  • 資源大小:2005 K
  • 上傳時間: 2017-09-20
  • 上傳用戶:heyuyutu
  • 資源積分:2 下載積分
  • 標      簽: UART verilog VHDL AVR

資 源 簡 介

基于VHDL(verilog)語言的UART的設計與實現。全面模仿AVR的UART功能,與AVR直接實現接口調試。資料全面完整。

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