USB通信協(xié)議的硬件描述語(yǔ)言代碼，用于FPGA的總線接口控制器開發(fā)
資源簡(jiǎn)介：USB通信協(xié)議的硬件描述語(yǔ)言代碼，用于FPGA的總線接口控制器開發(fā)
上傳時(shí)間： 2017-05-23
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資源簡(jiǎn)介：UART通信協(xié)議的硬件描述語(yǔ)言代碼，用與FPGA的總線接口開發(fā)
上傳時(shí)間： 2017-05-23
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資源簡(jiǎn)介：CAN通信協(xié)議的硬件描述語(yǔ)言代碼，用于FPGA的總線接口控制器開發(fā)
上傳時(shí)間： 2014-01-12
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資源簡(jiǎn)介：VGA接口協(xié)議的硬件描述語(yǔ)言代碼，用于FPGA的總線接口控制器開發(fā)
上傳時(shí)間： 2013-12-22
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資源簡(jiǎn)介：verilog hdl 快速入門,里面包含很多有用的硬件描述語(yǔ)言的程序
上傳時(shí)間： 2014-01-03
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資源簡(jiǎn)介：用avr 單片機(jī) 用io模擬USB 通信協(xié)議的例子
上傳時(shí)間： 2013-12-21
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資源簡(jiǎn)介：system c 是在C環(huán)境下的硬件描述語(yǔ)言,比VHDL 等語(yǔ)言具有更強(qiáng)的抽象能力,內(nèi)有system C的開發(fā)支持庫(kù)和一些VC下的開發(fā)例程
上傳時(shí)間： 2013-12-27
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資源簡(jiǎn)介：一個(gè)pci接口的硬件描述語(yǔ)言的實(shí)現(xiàn)源代碼,用verilog語(yǔ)言實(shí)現(xiàn)
上傳時(shí)間： 2015-08-10
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資源簡(jiǎn)介：fir ISP design fir VHDL VHDL編程濾波的硬件描述語(yǔ)言實(shí)現(xiàn)，包括VHDL語(yǔ)言和verilog語(yǔ)言
上傳時(shí)間： 2014-06-20
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資源簡(jiǎn)介：電梯的硬件描述語(yǔ)言設(shè)計(jì)，可以下載測(cè)試與仿真，通過EDA開發(fā)系統(tǒng)進(jìn)行調(diào)試
上傳時(shí)間： 2015-08-24
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資源簡(jiǎn)介：電子釧的硬件描述語(yǔ)言設(shè)計(jì)，可以下載測(cè)試與仿真，通過EDA開發(fā)系統(tǒng)進(jìn)行調(diào)試
上傳時(shí)間： 2014-01-02
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資源簡(jiǎn)介：交通燈的硬件描述語(yǔ)言設(shè)計(jì)，可以下載測(cè)試與仿真，通過EDA開發(fā)系統(tǒng)進(jìn)行調(diào)試
上傳時(shí)間： 2015-08-24
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資源簡(jiǎn)介：4人搶答器的硬件描述語(yǔ)言設(shè)計(jì)，可以下載測(cè)試與仿真，通過EDA開發(fā)系統(tǒng)進(jìn)行調(diào)試
上傳時(shí)間： 2013-12-03
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資源簡(jiǎn)介：systemc 是基于VC的硬件描述語(yǔ)言，類似與VHDL VERILOG 等，他是VC提供的類庫(kù)，抽象出硬件接口
上傳時(shí)間： 2014-01-17
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資源簡(jiǎn)介：altera公司開發(fā)板上關(guān)于基于FPGA實(shí)現(xiàn)網(wǎng)絡(luò)協(xié)議的硬件描述
上傳時(shí)間： 2013-12-18
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資源簡(jiǎn)介：個(gè)人認(rèn)為比較經(jīng)典的硬件描述語(yǔ)言的設(shè)計(jì)指導(dǎo)叢書，是數(shù)字IC設(shè)計(jì)基礎(chǔ)，共有10個(gè)文件
上傳時(shí)間： 2016-05-12
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資源簡(jiǎn)介：關(guān)于VGA的控制器的硬件描述語(yǔ)言，有興趣的朋友可以下載去
上傳時(shí)間： 2016-05-12
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資源簡(jiǎn)介：采用CPLD實(shí)現(xiàn)串口通信（Verilog硬件描述語(yǔ)言）
上傳時(shí)間： 2013-12-23
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資源簡(jiǎn)介：機(jī)關(guān)報(bào)的硬件描述語(yǔ)言，SYSTEMC。這國(guó)內(nèi)少的資料。
上傳時(shí)間： 2016-07-27
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資源簡(jiǎn)介：正交頻分復(fù)用的硬件描述語(yǔ)言實(shí)現(xiàn)，atera環(huán)境
上傳時(shí)間： 2016-08-16
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資源簡(jiǎn)介：HLD開發(fā)語(yǔ)言ADHL介紹。ADHL是ALTERA公司開發(fā)的硬件描述語(yǔ)言，也是一種較為流行的開發(fā)工具。是介紹AHDL的入門培訓(xùn)資料。
上傳時(shí)間： 2014-01-14
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資源簡(jiǎn)介：鍵盤防抖模塊Verilog硬件描述語(yǔ)言代碼
上傳時(shí)間： 2013-12-24
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資源簡(jiǎn)介：Verilog是廣泛應(yīng)用的硬件描述語(yǔ)言，可以用在硬件設(shè)計(jì)流程的建模、綜合和模擬等多個(gè)階段。隨著硬件設(shè)計(jì)規(guī)模的不斷擴(kuò)大，應(yīng)用硬件描述語(yǔ)言進(jìn)行描述的CPLD結(jié)構(gòu)，成為設(shè)計(jì)專用集成電路和其他集成電路的主流。通過應(yīng)用Verilog HDL對(duì)多功能電子鐘的設(shè)計(jì)，達(dá)到對(duì)Veri...
上傳時(shí)間： 2017-03-06
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資源簡(jiǎn)介：可以自由開發(fā)的MIPS仿真器模型(.exe),指令執(zhí)行動(dòng)畫顯示.通過修改graphics和對(duì)應(yīng)的元件和互聯(lián)文件(.dit)可以自己畫流水線,其中.dit文件使用簡(jiǎn)單的硬件描述語(yǔ)言編寫.而mipsit是對(duì)應(yīng)的軟件開發(fā)環(huán)境,為自己設(shè)計(jì)的流水線編程.學(xué)習(xí)體系結(jié)構(gòu)的好東西
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資源簡(jiǎn)介：十二音階和八度分頻的硬件描述語(yǔ)言VHDL程序，測(cè)試通過成功
上傳時(shí)間： 2017-06-22
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資源簡(jiǎn)介：eda應(yīng)用中的硬件描述語(yǔ)言vhdl4倍頻率設(shè)計(jì)方法
上傳時(shí)間： 2017-09-13
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資源簡(jiǎn)介：該程序是基于FPGA的硬件描述語(yǔ)言，實(shí)現(xiàn)的功能是對(duì)時(shí)鐘進(jìn)行分頻，從而產(chǎn)生任意頻率的輸出時(shí)鐘。
上傳時(shí)間： 2013-12-27
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資源簡(jiǎn)介：這是一個(gè)I2C串行數(shù)據(jù)通信協(xié)議以VHDL硬件描述語(yǔ)言實(shí)現(xiàn)的IP核，可直接編譯運(yùn)行
上傳時(shí)間： 2015-04-27
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資源簡(jiǎn)介：學(xué)習(xí)vhdl硬件描述語(yǔ)言的一些例子的原代碼，比較全面，相信對(duì)初學(xué)者很有幫助
上傳時(shí)間： 2013-08-23
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資源簡(jiǎn)介：程序主要用硬件描述語(yǔ)言（VHDL）實(shí)現(xiàn)： 單片機(jī)與FPGA接口通信的問題
上傳時(shí)間： 2015-04-06
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