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采用VHDL語言設計一個4通道的數據采集控制模塊。系統的功能描述如下: 1.系統主時鐘為100 MHz。 2.數據為16位-數據線上連續2次00FF后數據傳輸開始。 3.系統內部總線寬度為8位。

  • 資源大小:5648 K
  • 上傳時間: 2013-12-25
  • 上傳用戶:sun67512945
  • 資源積分:2 下載積分
  • 標      簽: VHDL 100 MHz

資 源 簡 介

采用VHDL語言設計一個4通道的數據采集控制模塊。系統的功能描述如下: 1.系統主時鐘為100 MHz。 2.數據為16位-數據線上連續2次00FF后數據傳輸開始。 3.系統內部總線寬度為8位。 4.共有4個通道(ch1、ch2、ch3、ch4),每個通道配備100 Bytes的RAM,當存滿數據后停止數據采集并且相應通道的狀態位產生報警信號。 5.數據分為8位串行輸出,輸出時鐘由外部數據讀取電路給出。 6.具備顯示模塊驅動功能。由SEL信號設置顯示的通道,DISPLAY信號啟動所選通道RAM中數值的顯示過程。數值順次顯示一遍后顯示結束,可以重新設定SEL的值選擇下一個通道。模塊數據線為8位,顯示器件為4個8段LED。 7.數據采集模式如下:單通道采集(由SEL信號選擇通道),多通道順次采集(當前通道采滿后轉入下一通道),多通道并行采集(每通道依次采集一個數據)。模式由控制信號MODE選擇,采集數據的總個數由NUM_COLLECT給出。 8.數據采集過程中不能讀取,數據讀取過程中不能采集

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