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這個(gè)文件中使用verilog hdl簡(jiǎn)單的利用基本運(yùn)算實(shí)現(xiàn)了微型的cpu設(shè)計(jì)開(kāi)發(fā)過(guò)程

  • 資源大小:18 K
  • 上傳時(shí)間: 2016-08-24
  • 上傳用戶(hù):wanglp094
  • 資源積分:2 下載積分
  • 標(biāo)      簽: verilog hdl cpu 運(yùn)算

資 源 簡(jiǎn) 介

這個(gè)文件中使用verilog hdl簡(jiǎn)單的利用基本運(yùn)算實(shí)現(xiàn)了微型的cpu設(shè)計(jì)開(kāi)發(fā)過(guò)程

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