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基于cpld的pwm控制設計 采用vhdl.verilog語言設計 對大家比較有用

  • 資源大小:79 K
  • 上傳時間: 2014-01-09
  • 上傳用戶:scorpioll
  • 資源積分:2 下載積分
  • 標      簽: verilog cpld vhdl pwm

資 源 簡 介

基于cpld的pwm控制設計 采用vhdl.verilog語言設計 對大家比較有用

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