對(duì)于CPLD、FPGA和HardCopy? ASIC設(shè)計(jì),Quartus? II軟件10.1是業(yè)界性能和效能首屈一指的軟件,現(xiàn)在可以下載。這一最新版軟件引入了Qsys,它是功能強(qiáng)大的系統(tǒng)集成新工具。在Quartus II訂購版軟件10.1中以beta版的形式提供Qsys,它提高了系統(tǒng)開發(fā)速度,支持設(shè)計(jì)重用,從而縮短了FPGA設(shè)計(jì)過程,減輕了工作量。
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上傳時(shí)間: 2013-06-10
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資源簡(jiǎn)介:電工學(xué) 上海交大精品課件(謝維敏版) PPT版
上傳時(shí)間: 2013-07-24
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資源簡(jiǎn)介:DE2平臺(tái)應(yīng)用及DSP Builder技術(shù)
上傳時(shí)間: 2013-10-26
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資源簡(jiǎn)介:基于DSP Builder數(shù)字信號(hào)處理器的FPGA設(shè)計(jì)
上傳時(shí)間: 2013-10-11
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資源簡(jiǎn)介:DSP-Builder學(xué)習(xí)資料。學(xué)習(xí)DSPBuilder構(gòu)建系統(tǒng)的方法,主要在matlab環(huán)境下,結(jié)合simulink做硬件系統(tǒng)。和在matlab環(huán)境下仿真。然后生成硬件電路
上傳時(shí)間: 2015-06-27
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資源簡(jiǎn)介:FIR 濾波器 matlab/simulink DSP Builder
上傳時(shí)間: 2015-11-08
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資源簡(jiǎn)介:Quartus II設(shè)計(jì)正弦信號(hào)發(fā)生器。本節(jié)通過正弦信號(hào)發(fā)生器的設(shè)計(jì)對(duì)QuartusII的一些重要功能作一些說明。對(duì)本節(jié)的詳細(xì)了解有利于對(duì)以后章節(jié)有關(guān)DSP Builder的應(yīng)用和設(shè)計(jì)有更好的理解。
上傳時(shí)間: 2015-12-18
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資源簡(jiǎn)介:DSP Builder 6.0 License DSP Builder 6.0 破解
上傳時(shí)間: 2016-10-31
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資源簡(jiǎn)介:DSP Builder 參考手冊(cè),主要用于simulink實(shí)現(xiàn)算法后,可將其自動(dòng)轉(zhuǎn)換為vhdl語言應(yīng)用。
上傳時(shí)間: 2016-11-05
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資源簡(jiǎn)介:分析了MATLAB/Simulink 中DSP Builder 模塊庫在FPGA 設(shè)計(jì)中優(yōu)點(diǎn),\\r\\n然后結(jié)合FSK 信號(hào)的產(chǎn)生原理,給出了如何利用DSP Builder 模塊庫建立FSK 信號(hào)發(fā)生器模\\r\\n型,以及對(duì)FSK 信號(hào)發(fā)生器模型進(jìn)行算法級(jí)仿真和生成VHDL 語言的方法,并在modelsim\\r\\n中對(duì)...
上傳時(shí)間: 2013-08-20
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資源簡(jiǎn)介:DSP+Builder
上傳時(shí)間: 2013-11-26
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資源簡(jiǎn)介:轉(zhuǎn)置矩陣是10*10矩陣A的轉(zhuǎn)置矩陣A(t)
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上傳時(shí)間: 2013-11-28
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上傳時(shí)間: 2016-04-28
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資源簡(jiǎn)介:基于matlab和DSP Builder的update_megacores詳解,主要解決的是update_megacores的問題
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上傳時(shí)間: 2013-11-29
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資源簡(jiǎn)介:用于的DSP Builder的matlab實(shí)現(xiàn)算法,產(chǎn)生可編程的sin或cos波形,可以通過它作為ddc的dds
上傳時(shí)間: 2013-12-27
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資源簡(jiǎn)介:DSP Builder 如何加載License文件,內(nèi)容詳盡,實(shí)用性很強(qiáng)。
上傳時(shí)間: 2014-09-11
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