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CADENCE PCB設(shè)計(jì):布局與布線

  • 資源大小:2587 K
  • 上傳時(shí)間: 2013-11-09
  • 上傳用戶:呂布LOVE闕
  • 資源積分:2 下載積分
  • 標(biāo)      簽: CADENCE PCB 布局 布線

資 源 簡 介

復(fù)雜的物理和電氣規(guī)則, 高密度的元器件布局, 以及更高的高速技術(shù)要求, 這一切都增加了當(dāng)今PCB設(shè)計(jì)的復(fù)雜性。 不管是在設(shè)計(jì)過程的哪一個(gè)階段, 設(shè)計(jì)師都需要能夠輕松地定義,管理和確認(rèn)簡單的物理/間距規(guī)則, 以及至關(guān)重要的高速信號(hào);同時(shí), 他們還要確保最終的PCB滿足傳統(tǒng)制造以及測(cè)試規(guī)格所能達(dá)到的性能
目標(biāo)。

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