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高速數(shù)據(jù)采集系統(tǒng)

  • SAP R/3 企業(yè)系統(tǒng) 數(shù)據(jù)字典 ABAP programming 必要參考檔

    SAP R/3 企業(yè)系統(tǒng) 數(shù)據(jù)字典 ABAP programming 必要參考檔

    標(biāo)簽: programming ABAP SAP 系統(tǒng)

    上傳時(shí)間: 2016-09-24

    上傳用戶:zl5712176

  • 基於DE2系統(tǒng)的LCM verilog code,在LCM右下方顯示數(shù)字,每按一次按鍵數(shù)字會(huì)加1,顏色也會(huì)改變

    基於DE2系統(tǒng)的LCM verilog code,在LCM右下方顯示數(shù)字,每按一次按鍵數(shù)字會(huì)加1,顏色也會(huì)改變

    標(biāo)簽: LCM verilog code DE2

    上傳時(shí)間: 2014-01-14

    上傳用戶:banyou

  • 概率理論與數(shù)理統(tǒng)計(jì)實(shí)驗(yàn)系統(tǒng)matlab代碼

    概率理論與數(shù)理統(tǒng)計(jì)實(shí)驗(yàn)系統(tǒng)matlab代碼,含gui

    標(biāo)簽: matlab 概率 系統(tǒng)

    上傳時(shí)間: 2016-10-17

    上傳用戶:大三三

  • SaleManage.rar 源碼 附詳盡使用說明及數(shù)據(jù)庫(kù) 進(jìn)銷存管理系統(tǒng)

    SaleManage.rar 源碼 附詳盡使用說明及數(shù)據(jù)庫(kù) 進(jìn)銷存管理系統(tǒng)

    標(biāo)簽: SaleManage 系統(tǒng)

    上傳時(shí)間: 2013-12-14

    上傳用戶:CHENKAI

  • 執(zhí)行步驟1: 執(zhí)行EX1126程式進(jìn)入學(xué)生考試系統(tǒng) 權(quán)限描述: 使用者查詢:於”姓名”中輸入”Arno”,於”學(xué)號(hào)”中輸入”good”,再按下”使用者查詢” 即可查詢. 修改使用者:於”姓名

    執(zhí)行步驟1: 執(zhí)行EX1126程式進(jìn)入學(xué)生考試系統(tǒng) 權(quán)限描述: 使用者查詢:於”姓名”中輸入”Arno”,於”學(xué)號(hào)”中輸入”good”,再按下”使用者查詢” 即可查詢. 修改使用者:於”姓名”中輸入”GUEST”,於”學(xué)號(hào)”中輸入”0000”,再按下” 修改使用者即可修改: 功能描述: 使用者開始考試,於”姓名”中輸入自己的姓名,於”學(xué)號(hào)”中輸入學(xué)號(hào),再按下” 考試去”即可: 開始考試,同時(shí)系統(tǒng)紀(jì)錄考生狀態(tài)為”1”. 使用者考試,完成後按下”結(jié)算成績(jī)”,同時(shí)系統(tǒng)顯示紀(jì)錄考生該科分?jǐn)?shù),同時(shí)清除考生登入狀態(tài),使其無法重覆考試,老師並可查詢考生成績(jī).

    標(biāo)簽: 1126 Arno good EX

    上傳時(shí)間: 2016-07-31

    上傳用戶:chens000

  • 在室內(nèi)環(huán)境中可結(jié)合式子母機(jī)器人系統(tǒng)

    在室內(nèi)環(huán)境中可結(jié)合式子母機(jī)器人系統(tǒng),子機(jī)為一多功能平臺(tái),可放置各種家庭所需之設(shè)備,而母機(jī)為一輪式機(jī)器人,經(jīng)由兩者的結(jié)合,可提供高機(jī)動(dòng)性與多功能的服務(wù)。在結(jié)合的技術(shù)面,傳統(tǒng)的吸塵器機(jī)器人與充電站之間的導(dǎo)航系統(tǒng)使用紅外線感測(cè)作為依據(jù),當(dāng)兩者間有障礙物阻擋時(shí),紅外線感測(cè)器導(dǎo)航系統(tǒng)將會(huì)失效。因此本系統(tǒng)利用聲源方向做為機(jī)器人決定移動(dòng)方向的依據(jù),由於聲波傳遞的特性,即使在有障礙物的情況下,依然可以有效地偵測(cè)。此外,在移動(dòng)的過程中,本系統(tǒng)利用光流偵測(cè)法判斷是否遭遇障礙物或是利用Support Vector Machine分類判斷與聲源之間為是否有障礙物的阻隔;若發(fā)現(xiàn)前方有障礙物,則啟動(dòng)避障策略,用有效的方式繼續(xù)往目標(biāo)移動(dòng)。最後,當(dāng)母機(jī)接近子機(jī)時(shí),可根據(jù)多種紅外線感測(cè)器資訊進(jìn)行子母機(jī)器人的結(jié)合,結(jié)合成功後,母機(jī)將可搭載子機(jī)成為一自由行動(dòng)之機(jī)器人。

    標(biāo)簽: 系統(tǒng)

    上傳時(shí)間: 2013-12-19

    上傳用戶:mhp0114

  • 在通訊系統(tǒng)中常見到的cordic

    在通訊系統(tǒng)中常見到的cordic,是個(gè)用很少複雜度就能實(shí)現(xiàn)三角函數(shù)的電路,檔案中有C語(yǔ)言的CORDIC程式

    標(biāo)簽: cordic 系統(tǒng)

    上傳時(shí)間: 2017-03-07

    上傳用戶:lepoke

  • 幫助系統(tǒng)工程師

    幫助系統(tǒng)工程師,設(shè)計(jì)者,管理者在電視廣播上可以順利的傳輸類比訊號(hào)至數(shù)位訊號(hào)之基礎(chǔ)技術(shù)

    標(biāo)簽: 系統(tǒng) 工程

    上傳時(shí)間: 2014-01-07

    上傳用戶:lht618

  • 基于FPGA與DDR2-SDRAM的高速實(shí)時(shí)數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn).rar

    數(shù)據(jù)采集處理技術(shù)是現(xiàn)代信號(hào)處理的基礎(chǔ),廣泛應(yīng)用于雷達(dá)、聲納、軟件無線電、瞬態(tài)信號(hào)測(cè)試等領(lǐng)域。隨著信息科學(xué)的飛速發(fā)展,人們面臨的信號(hào)處理任務(wù)越來越繁重,對(duì)數(shù)據(jù)采集處理系統(tǒng)的要求也越來越高。近年來FPGA由于其設(shè)計(jì)靈活性、更強(qiáng)的適應(yīng)性及可重構(gòu)性,結(jié)合SDRAM的高速、大容量、價(jià)格優(yōu)勢(shì),在設(shè)計(jì)高速實(shí)時(shí)數(shù)據(jù)采集系統(tǒng)時(shí)受到了廣泛的關(guān)注。 本課題重點(diǎn)研究了基于FPGA與DDR2-SDRAM的高速實(shí)時(shí)數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)技術(shù),為需要大容量存儲(chǔ)器的系統(tǒng)設(shè)計(jì)提供了新的思路。在深入研究了DDR2-SDRAM器件的基本構(gòu)造與工作原理的基礎(chǔ)上,結(jié)合成熟的商業(yè)化IP核,提出了基于FPGA與DDR2-SDRAM的高速實(shí)時(shí)數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)方案,并從總體設(shè)計(jì)構(gòu)想到各邏輯細(xì)節(jié)實(shí)現(xiàn)都進(jìn)行了詳細(xì)描述。根據(jù)DDR2-SDRAM的特點(diǎn),選擇合適的內(nèi)存調(diào)度方案,采用Verilog HDL語(yǔ)言設(shè)計(jì)實(shí)現(xiàn)了該高速實(shí)時(shí)數(shù)據(jù)采集系統(tǒng),并對(duì)系統(tǒng)功能進(jìn)行驗(yàn)證與分析,結(jié)果表明本設(shè)計(jì)完全能夠滿足系統(tǒng)的性能指標(biāo)。

    標(biāo)簽: SDRAM FPGA DDR

    上傳時(shí)間: 2013-06-24

    上傳用戶:wangrong

  • 高速實(shí)時(shí)數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

    數(shù)據(jù)采集處理技術(shù)是現(xiàn)代信號(hào)處理的基礎(chǔ),廣泛應(yīng)用于雷達(dá)、聲納、軟件無線電、瞬態(tài)信號(hào)測(cè)試等領(lǐng)域。隨著信息科學(xué)的飛速發(fā)展,人們面臨的信號(hào)處理任務(wù)越來越繁重,對(duì)數(shù)據(jù)采集處理系統(tǒng)的要求也越來越高。近年來FPGA由于其設(shè)計(jì)靈活性、更強(qiáng)的適應(yīng)性及可重構(gòu)性,結(jié)合SDRAM的高速、大容量、價(jià)格優(yōu)勢(shì),在設(shè)計(jì)高速實(shí)時(shí)數(shù)據(jù)采集系統(tǒng)時(shí)受到了廣泛的關(guān)注。 本課題重點(diǎn)研究了基于FPGA與DDR2-SDRAM的高速實(shí)時(shí)數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)技術(shù),為需要大容量存儲(chǔ)器的系統(tǒng)設(shè)計(jì)提供了新的思路。在深入研究了DDR2-SDRAM器件的基本構(gòu)造與工作原理的基礎(chǔ)上,結(jié)合成熟的商業(yè)化IP核,提出了基于FPGA與DDR2-SDRAM的高速實(shí)時(shí)數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)方案,并從總體設(shè)計(jì)構(gòu)想到各邏輯細(xì)節(jié)實(shí)現(xiàn)都進(jìn)行了詳細(xì)描述。根據(jù)DDR2-SDRAM的特點(diǎn),選擇合適的內(nèi)存調(diào)度方案,采用Verilog HDL語(yǔ)言設(shè)計(jì)實(shí)現(xiàn)了該高速實(shí)時(shí)數(shù)據(jù)采集系統(tǒng),并對(duì)系統(tǒng)功能進(jìn)行驗(yàn)證與分析,結(jié)果表明本設(shè)計(jì)完全能夠滿足系統(tǒng)的性能指標(biāo)。

    標(biāo)簽: 高速實(shí)時(shí)數(shù) 采集系統(tǒng)

    上傳時(shí)間: 2013-06-24

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