or1200開源risc cpu的verilog描述實現(xiàn)，cpu源代碼分析與芯片設(shè)計一書的源碼
標(biāo)簽： verilog 1200 risc cpu
上傳時間： 2017-02-28
上傳用戶：litianchu
verilog code for alu in RISC processor
標(biāo)簽： processor verilog code RISC
上傳時間： 2017-05-27
上傳用戶：sunjet
用Verilog 編寫的8位risc cpu，行為級描述，可綜合
標(biāo)簽： Verilog risc cpu 8位
上傳時間： 2017-07-24
上傳用戶：gdgzhym
DLX指令集RISC CPU verilog源碼，使用哈佛結(jié)構(gòu)可實現(xiàn)十多種指令
標(biāo)簽： dlx 指令集 risc cpu verilog
上傳時間： 2022-05-16
上傳用戶：d1997wayne
簡單的一個8位RISC，Verilog HDL代碼,類型為pic16c57
標(biāo)簽： RISC 8位
上傳時間： 2015-04-25
上傳用戶：xinyuzhiqiwuwu
這是一篇關(guān)于8位RISC CPU設(shè)計的文章，其中包含了用Verilog語言編寫的CPU內(nèi)核程序
標(biāo)簽： RISC CPU 8位
上傳時間： 2013-12-22
上傳用戶：CHENKAI
嵌入式risc處理器源碼，包含設(shè)計文檔，原理圖，testbench，及外圍接口，使用verilog實現(xiàn)。
標(biāo)簽： risc 嵌入式 處理器 源碼
上傳時間： 2014-12-03
上傳用戶：三人用菜
Verilog-HDL實踐與應(yīng)用系統(tǒng)設(shè)計
標(biāo)簽： Verilog-HDL 實踐 應(yīng)用系統(tǒng)
上傳時間： 2013-08-06
上傳用戶：eeworm
精通Verilog HDL：IC設(shè)計核心技術(shù)實例詳解
標(biāo)簽： Verilog HDL IC設(shè)計 核心技術(shù)
上傳時間： 2013-07-24
專輯類----可編程邏輯器件相關(guān)專輯 Verilog-HDL實踐與應(yīng)用系統(tǒng)設(shè)計-210頁-18.0M.rar
標(biāo)簽： Verilog-HDL 18.0 210
上傳時間： 2013-07-23
上傳用戶：小宇NVO
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