Verilog-HDL實(shí)踐與應(yīng)用系統(tǒng)設(shè)計(jì)
標(biāo)簽： Verilog-HDL 實(shí)踐 應(yīng)用系統(tǒng)
上傳時(shí)間： 2013-08-06
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精通verilog HDl：IC設(shè)計(jì)核心技術(shù)實(shí)例詳解
標(biāo)簽： Verilog HDL IC設(shè)計(jì) 核心技術(shù)
上傳時(shí)間： 2013-07-24
專輯類----可編程邏輯器件相關(guān)專輯 Verilog-HDL實(shí)踐與應(yīng)用系統(tǒng)設(shè)計(jì)-210頁(yè)-18.0M.rar
標(biāo)簽： Verilog-HDL 18.0 210
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專輯類-可編程邏輯器件相關(guān)專輯-96冊(cè)-1.77G Verilog-HDL實(shí)踐與應(yīng)用系統(tǒng)設(shè)計(jì)-210頁(yè)-18.0M.pdf
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采用 verilog HDl 語(yǔ)言在Altera 公司的FPGA 芯片上實(shí)現(xiàn)了RISC_CPU 的關(guān)鍵部件狀態(tài)控制器的設(shè)計(jì),以及在與其它各種數(shù)字邏輯設(shè)計(jì)方法的比較下,顯示出使用Verilog
標(biāo)簽： Verilog FPGA HDL 語(yǔ)言
上傳時(shí)間： 2013-07-06
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verilog HDl程序設(shè)計(jì)教程,一本實(shí)用的教程，值得一看。
標(biāo)簽： Verilog HDL 程序設(shè)計(jì) 教程
上傳時(shí)間： 2013-05-26
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夏宇聞教授的數(shù)字系統(tǒng)設(shè)計(jì)教程verilog HDl
標(biāo)簽： VERILOG HDL 數(shù)字系統(tǒng)設(shè)計(jì)
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本文利用verilog HDl 語(yǔ)言自頂向下的設(shè)計(jì)方法設(shè)計(jì)多功能數(shù)字鐘，突出了其作為硬件描述語(yǔ)言的良好的可讀性、可移植性和易理解等優(yōu)點(diǎn)，并通過Altera QuartusⅡ 4.1 和ModelSim
標(biāo)簽： Verilog HDL 多功能 數(shù)字
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：視頻圖像采集verilog HDl源程序，視頻解碼芯片部分的，可以供參考
標(biāo)簽： verilog HDl 視頻圖像 源程序
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·詳細(xì)說明：正式出版物《verilog HDl 硬件描述語(yǔ)言》一書的精美 PDF 電子版。- Official publication verilog HDl Hardware Description Language a book fine PDF electron version.目 錄譯者序前言第1章 簡(jiǎn)介&n
標(biāo)簽： nbsp Verilog HDL 硬件描述語(yǔ)言
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