讓你徹底明白0歐姆電阻和磁珠及電感的區別和應用
上傳時間： 2013-04-24
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變頻器矢量控制及PID控制變頻器矢量控制及PID控制
上傳時間： 2013-04-24
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cadence 15.7安裝步驟及方法安裝步驟： 1、 證書生成 a、雙擊Crack->keygen.exe， b、HO
上傳時間： 2013-07-26
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FFT/IFFT是時域信號與頻域信號之間轉換的基本運算，是數字信號處理的核心工具之一，因此，它廣泛地應用于許多領域。在數字化的今天，不論是在通信領域還是在圖像處理領域，對數字信號處理的速度、精度和實時性要求不斷提高。為滿足不斷提高的要求，國內外不斷地推出各種FFT/IFFT處理器，主要處理器有ASIC、DSP芯片、FPGA等。由于FPGA具有可反復編程的特點及豐富資源，所以它受到廣泛的關注。 本論文就是一種基于FPGA實現浮點型數據的FFT及IFFT處理器，該處理器使用A1tera公司的Stratix Ⅱ系列的FPGA芯片。它主要采用流水線結構，這種結構可以使各級運算并行處理，對輸入進來的數據進行連續處理，提高了運算速度，滿足了系統的實時性要求；另外處理器所處理的數據是32位浮點型的，因此它同時提高了運算的精度。
上傳時間： 2013-07-12
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Internet現已成為社會重要的信息流通渠道。嵌入式系統能夠連接到 Internet上面將信息傳送到幾乎世界上的任何一個地方。嵌入式設備與Internet的結合代表著嵌入式系統和網絡技術的真正未來。隨著IPv6的應用，設備都可能獲得一個全球唯一的IP地址，通過IP地址和互聯網相連成為一個網絡設備。因此隨著電子技術和Internet技術的發展使的家用電子電器產品步向智能化網絡化的智能家居方向。智能家居是集成微電子技術與控制技術當前嵌入式系統典型的代表。 本文將嵌入式技術與電力載波通信協議X-10技術結合起來來實現智能家居控制系統，著重研究智能家居控制系統的核心一基于ARM核的智能家居網關軟硬件設計。智能家居網關是一個嵌入式WEB服務器，用戶通過登陸智能家居網關進而實現對智能家居網關的遠程控制操作，智能家居網關將接收到的用戶命令進行“翻譯”之后向家庭電力線發送X-10指令，實現對家庭設備的控制。 本文首先分析基于ARM的智能家居控制系統的原理及X-10技術；然后給出具體基于ARM平臺的硬件電路設計，本文在以LPC2210為處理器實現智能家居控制系統的設計中，給出詳細設計步驟與過程。本系統主要電路包括有電源電路、鍵盤電路、LCD顯示電路、存儲電路、網口電路、及X-10電力載波電路等等；其次ARM平臺軟件實現是本文的一個重點。本文主要分三步來實現：第一步實現了在LPC2200系列處理器上的嵌入式操作系統uC/OS-Ⅱ的移植、第二步實現TCP/IP協議棧LWIP在嵌入式操作系統上的移植、第三步實現WEB服務器的組建以及應用軟件設計。最后系統在搭建完軟硬件平臺之后，進入調試結果環節。系統運行后本人使用本地示波器觀看波形，然后通過對波形的解析與X-10指令的對照來驗證基于ARM的智能家居控制系統的可行性，進而實現了X-10信息家電與Internet的互連控制。
上傳時間： 2013-06-04
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常用有源晶振封裝尺寸及實物圖.應該能幫助一些人吧！！
上傳時間： 2013-06-11
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在工業生產中，二次自動化儀表是構成自動化系統的基本單元之一。我國的單元儀表己基本完成由電動Ⅲ型儀表向基于八位或十六位單片機為基礎設計的數字化儀表的轉換。由于常規單片機資源的限制，以單片機為基礎設計的單元儀表基本上還是在功能上替代電動Ⅲ型儀表，并按電動Ⅲ型功能進行分類。這樣造成國內自動化儀表生產廠家生產的二次數字化儀表品種繁雜，標準難以統一，設計隨意性大。因此帶來如下現實問題： 1．自動化系統設計單位的儀表選型、系統調試、使用中操作、維修和系統的功能優化及備件的準備非常的不方便： 2．儀表生產廠家的批量生產困難，產品質量的提高及成本的節約不利： 3．國內現在自動化儀表廠家數量眾多，但都無法形成規模生產，質量不佳，而國外進口的二次儀表往往依附于特定的集散系統，也存在標準不統一，難以靈活替換的問題，且價格昂貴。 自動化系統設計、生產及應用迫切需要一種使用方便、通用性強的智能型二次儀表，以解決上述問題，改變傳統設計、生產及應用方式，這將是未來自動化儀表的發展趨勢，也就是本課題的努力方向。 本論文正是針對上述問題，以設計出一種可靈活組態的通用智能型二次儀表為研究對象，在深入分析國內主流儀表廠家的儀表操作方式和儀表功能的基礎上，合理地進行軟硬件設計，為在同一硬件平臺下實現多種儀表的功能進行了創新性和探索性研究。主要內容為： 1．各種常規二次儀表功能、標準、接線、操作習慣及結構方式的歸類分析； 2．多信號多量程的柔性測量方法研究； 3．系統整機設計以及系統可靠性設計； 4．u-boot的向ARM的移植、uClinux向ARM的移植、uClinux下的通用組態軟件設計。 本文設計了一種以三星公司的ARM7TDMI系列處理器S3C44BOX為核心，輔以外圍電路，實現同一硬件平臺下多種儀表的功能，并成功制作了樣品系統。 本文所討論的基于$3C44BOX和uClinux的智能儀表系統的開發技術同樣適用于其它項目的開發，對其它嵌入式的應用系統開發有重要的參考價值。
上傳時間： 2013-05-16
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H.264/AVC是國際電信聯盟與國際標準化組織/國際電工委員會聯合推出的活動圖像編碼標準，簡稱H.264。作為最新的國際視頻編碼標準，H.264/AVC與MPEG-4、H.263等視頻編碼標準相比，性能有了很大的提高，并已在流媒體、數字電視、電話會議、視頻存儲等諸多領域得到廣泛的應用。 本論文的研究課題是基于H.264/AVC視頻編碼標準的CAVLC(Context-based Adaptive Variable Length Coding，基于上下文的自適應可變長編碼)編碼算法研究及FPGA實現。對于變換后的熵編碼，H.264/AVC支持兩種編碼模式：基于上下文的可變長編碼(CAVLC)和基于上下文的自適應算術編碼(CABAC，Context-based Adaptive BinaryArithmetic Coding)。在H.264/AVC中，盡管CAVLC算法也是采用了VLC編碼，但是同以往標準不同，它所有的編碼都是基于上下文進行。這種方法比傳統的查單一表的方法提高了編碼效率，但也增加了設計上的困難。 作者在全面學習H.264/AVC協議和深入研究CAVLC編碼算法的基礎上，確定了并行編碼的CAVLC編碼器結構框圖，并總結出了影響CAVLC編碼器實現的瓶頸。針對這些瓶頸，對CAVLC編碼器中的各個功能模塊進行了優化設計，這些優化設計包括多參考塊的表格預測法、快速查找表法、算術消除法等。最后，用Verilog硬件描述語言對所設計的CAVLC編碼器進行了描述，用EDA軟件對其主要功能模塊進行了仿真，并在Cyclone II系列EP2C20F484的FPGA上驗證了它們的功能。結果表明，該CAVLC編碼器各編碼單元的編碼速度得到了顯著提高且均能滿足實時通信要求，為整個CAVLC編碼器的實時通信提供了良好的基礎。
上傳時間： 2013-06-04
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邊界掃描技術是一種應用于數字集成電路器件的標準化可測試性設計方法，它提供了對電路板上元件的功能、互連及相互間影響進行測試的一種新方案，極大地方便了系統電路的測試。本文基于IEEE 1149.1標準剖析了JTAG邊界掃描測試的精髓，分析了其組成，功能與時序控制等關鍵技術。 應用在FPGA芯片中的邊界掃描電路側重于電路板級測試，兼顧芯片功能測試，同時提供JTAG下載方式。針對在FPGA芯片中的應用特點，設計了一種邊界掃描電路，應用于自行設計的FPGA結構之中。除了基本的測試功能外，加入了對FPGA芯片進行配置、回讀以及用戶自定義測試等功能。 通過仿真驗證，所設計的邊界掃描電路可實現FPGA芯片的測試、配置和回讀等功能，并符合IEEE 11491.1邊界掃描標準的規定，達到設計要求。
上傳時間： 2013-04-24
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航天測控通信網是航天工程的重要組成部分。迄今為止，我國已建成“C頻段測控網”，及正在建設的“S頻段測控網”和“TDRSS測控網”。測距單元是測控系統基帶設備中的重要功能單元，為航天飛行器提供定位元素。目前，在航天測距系統中側音測距技術具有最高的測距精度。本文以中國電子科技集團第十研究所某項目為背景，對側音測距系統中的關鍵技術進行了詳細的研究，提出了一些改進測距精度的方法，最后用FPGA實現了側音測距功能單元。 本論文主要完成以下工作： 1)完成了直接數字頻率合成的雜散分析。采用嚴格的信號分析方法，運用離散傅立葉變換(DFT)和傅立葉變換(FT)，推導了理想狀態和相位截短條件下的DDS輸出頻譜的數學表達式，并利用systemview仿真軟件建立了DDS相位截短模型，通過仿真驗證了分析結論的正確性。 2)改進了TT&C系統中經典的FFT頻率引導算法，增加了頻譜對稱性分析，在實現頻率引導的同時完成了防載波頻率錯鎖的功能。 3)首次采用基于正交雙通道相關原理的數字相關相位估計法來實現次側音匹配和解模糊，降低了設備復雜度，提高了測距精度。針對低信噪比的情況，提出了基于平滑濾波的數據處理方法，提高了相位測量精度。對測距信道中加限幅器導致的測距信號信噪比惡化程度做了深入的理論分析。最后，分析了測距誤差，并對其中一些引起測距誤差的因素提出了改善方法。 通過本論文的工作，成功的完成了TT&C側音測距終端的研制，系統現已通過測試，達到系統任務書的各項指標要求。
上傳時間： 2013-04-24
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