使用Verilog編寫的同步FIFO，可通過設置程序中的DEPTH設置FIFO的深度，F(xiàn)IFO_WRITE_CLOCK上升沿向FIFO中寫入數(shù)據(jù)，\r\nFIFO_READ_CLOCK上升沿讀取數(shù)據(jù)。本程序?qū)IFO上層操作簡單實用。
標簽： Verilog FIFO 編寫
上傳時間： 2013-08-12
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