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fpga-jpeg-verilog
本論文主要論述JPEG2000中嵌入式塊編碼的FPGA設計
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一個關于聲音處理的Verilog語言編寫的解碼芯片
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基于FPGA的I2C總線模擬
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基于FPGA的can 總線設計
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JPEG2000分數位平面編碼器的fpga電路實現
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本原碼是基于Verilog HDL語言編寫的
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16位加法器的流水線計算,verilog代碼
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拿verilog編寫的som(自適應神經網絡算法)
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intel 8088 架構的verilog代碼
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這是用pci-wishbone核和16450串口核在xilinx的fpga上實現的串口程序
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