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fpga-jpeg-VERILOG

基于FPGA的16點FFT快速傅立葉變換的Verilog源代碼。

基于FPGA的16點FFT快速傅立葉變換的Verilog源代碼。

標(biāo)簽： Verilog FPGA FFT 傅立葉變換

上傳時間： 2015-04-02

上傳用戶：aysyzxzm
verilog 代碼. 經(jīng)驗證成功,可以作為標(biāo)準(zhǔn)單元庫,為FPGA設(shè)計者使用.

verilog 代碼. 經(jīng)驗證成功,可以作為標(biāo)準(zhǔn)單元庫,為FPGA設(shè)計者使用.

標(biāo)簽： verilog FPGA 代碼經(jīng)驗

上傳時間： 2015-04-07

上傳用戶：bruce
verilog 代碼. 經(jīng)驗證成功,可以作為標(biāo)準(zhǔn)單元庫,為FPGA設(shè)計者使用.

verilog 代碼. 經(jīng)驗證成功,可以作為標(biāo)準(zhǔn)單元庫,為FPGA設(shè)計者使用.

標(biāo)簽： verilog FPGA 代碼經(jīng)驗

上傳時間： 2013-12-25

上傳用戶：PresidentHuang
verilog 代碼. 經(jīng)驗證成功,可以作為標(biāo)準(zhǔn)單元庫,為FPGA設(shè)計者使用.

verilog 代碼. 經(jīng)驗證成功,可以作為標(biāo)準(zhǔn)單元庫,為FPGA設(shè)計者使用.

標(biāo)簽： verilog FPGA 代碼經(jīng)驗

上傳時間： 2015-04-07

上傳用戶：498732662
verilog 代碼. 經(jīng)驗證成功,可以作為標(biāo)準(zhǔn)單元庫,為FPGA設(shè)計者使用.

verilog 代碼. 經(jīng)驗證成功,可以作為標(biāo)準(zhǔn)單元庫,為FPGA設(shè)計者使用.

標(biāo)簽： verilog FPGA 代碼經(jīng)驗

上傳時間： 2014-06-16

上傳用戶：古谷仁美
用verilog語言在fpga中實現(xiàn)fifo功能！

用verilog語言在fpga中實現(xiàn)fifo功能！

標(biāo)簽： verilog fpga fifo 語言

上傳時間： 2015-05-02

上傳用戶：epson850
用verilog 描寫應(yīng)用于數(shù)字圖像壓縮系統(tǒng)--jpeg 有測試文檔

用verilog 描寫應(yīng)用于數(shù)字圖像壓縮系統(tǒng)--jpeg 有測試文檔

標(biāo)簽： verilog jpeg 應(yīng)用于壓縮系統(tǒng)

上傳時間： 2014-01-13

上傳用戶：zhangliming420
完整的jpeg encoder verilog code,DCT部分採用1991 IEEE transection paper,利用skew circular convolution來實現(xiàn)精簡電路

完整的jpeg encoder verilog code,DCT部分採用1991 IEEE transection paper,利用skew circular convolution來實現(xiàn)精簡電路

標(biāo)簽： convolution transection circular encoder

上傳時間： 2014-01-20

上傳用戶：waizhang
用verilog語言編寫的全數(shù)字鎖相環(huán)的源代碼,基于fpga平臺

用verilog語言編寫的全數(shù)字鎖相環(huán)的源代碼,基于fpga平臺

標(biāo)簽： verilog fpga 語言編寫

上傳時間： 2015-06-13

上傳用戶：wanqunsheng
鍵盤鼠標(biāo)的原代碼,用FPGA實現(xiàn),使用Verilog HDL編寫,已經(jīng)使用FPGA驗正過了,完全可以用

鍵盤鼠標(biāo)的原代碼,用FPGA實現(xiàn),使用Verilog HDL編寫,已經(jīng)使用FPGA驗正過了,完全可以用

標(biāo)簽： FPGA Verilog HDL 鍵盤

上傳時間： 2013-12-12

上傳用戶：athjac

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