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fpga uart

  • LMS自適應(yīng)濾波器的FPGA實現(xiàn)

    LMS自適應(yīng)濾波器是一種廣泛使用的數(shù)字信號處理算法,對其實現(xiàn)有多種方法.通過研究其特性的基礎(chǔ)上,提出了在FPGA 中使用軟處理的嵌入式實現(xiàn)方案,文中對實現(xiàn)方式的優(yōu)缺點進行了分析,并給出了硬件實現(xiàn)中的有線字長效應(yīng)進行了詳細(xì)的分析.

    標(biāo)簽: FPGA LMS 自適應(yīng)濾波器

    上傳時間: 2014-01-21

    上傳用戶:gokk

  • 用FPGA實現(xiàn)RS485通信接口芯片

    在點對多點主從通信系統(tǒng)中,需要合適的接口形式和通信協(xié)議實現(xiàn)主站與各從站的信息交換。RS -485 接口是適合這種需求的一種標(biāo)準(zhǔn)接口形式。當(dāng)選擇主從多點同步通信方式時,工作過程與幀格式符合HDLC/SDLC協(xié)議。介紹了采用VHDL 語言在FPGA 上實現(xiàn)的以HDLC/ SDLC 協(xié)議控制為基礎(chǔ)的RS - 485 通信接口芯片。實驗表明,這種接口芯片操作簡單、體積小、功耗低、可靠性高,極具實用價值。

    標(biāo)簽: FPGA 485 RS 通信接口

    上傳時間: 2013-11-02

    上傳用戶:zhf01y

  • HDLC協(xié)議RS485總線控制器的FPGA實現(xiàn)

    介紹了HDLC協(xié)議RS485總線控制器的FPGA實現(xiàn)

    標(biāo)簽: HDLC FPGA 485 RS

    上傳時間: 2013-11-04

    上傳用戶:heart_2007

  • WP396 -Spartan-6 FPGA的性能和設(shè)計

    本白皮書主要介紹 Spartan®-6 FPGA 如何滿足大批量系統(tǒng)的需求。包括經(jīng)濟高效地驅(qū)動商用存儲器芯片、構(gòu)建芯片間的高性能接口、創(chuàng)新型節(jié)電模式,這些只是高性能、低功耗、低成本 Spartan-6 FPGA 解決諸多問題的一部分。

    標(biāo)簽: Spartan FPGA 396 WP

    上傳時間: 2013-11-13

    上傳用戶:bibirnovis

  • FPGA的HD-SDI下變換研究

    研究了一種采用FPGA將高清數(shù)字電視信號轉(zhuǎn)換為標(biāo)清數(shù)字電視信號的方法,利用重采樣等技術(shù)降低了圖像中每行的有效像素和垂直行,完成了HD-SDI到SD-SDI的下變換。設(shè)計實現(xiàn)簡單,目前已運用于實際工程當(dāng)中。

    標(biāo)簽: HD-SDI FPGA 變換

    上傳時間: 2014-11-29

    上傳用戶:mickey008

  • 基于Xilinx FPGA的雙輸出DC/DC轉(zhuǎn)換器解決方案

      Xilinx FPGAs require at least two power supplies: VCCINTfor core circuitry and VCCO for I/O interface. For the latestXilinx FPGAs, including Virtex-II Pro, Virtex-II and Spartan-3, a third auxiliary supply, VCCAUX may be needed. Inmost cases, VCCAUX can share a power supply with VCCO.The core voltages, VCCINT, for most Xilinx FPGAs, rangefrom 1.2V to 2.5V. Some mature products have 3V, 3.3Vor 5V core voltages. Table 1 shows the core voltagerequirement for most of the FPGA device families. TypicalI/O voltages (VCCO) vary from 1.2V to 3.3V. The auxiliaryvoltage VCCAUX is 2.5V for Virtex-II Pro and Spartan-3, andis 3.3V for Virtex-II.

    標(biāo)簽: Xilinx FPGA DC 輸出

    上傳時間: 2013-10-22

    上傳用戶:liu999666

  • WP312-Xilinx新一代28nm FPGA技術(shù)簡介

    Xilinx Next Generation 28 nm FPGA Technology Overview Xilinx has chosen 28 nm high-κ metal gate (HKMG) highperformance,low-power process technology and combined it with a new unified ASMBL™ architecture to create a new generation of FPGAs that offer lower power and higher performance. These devices enable unprecedented levels of integration and bandwidth and provide system architects and designers a fully programmable alternative to ASSPs and ASICs.

    標(biāo)簽: Xilinx FPGA 312 WP

    上傳時間: 2014-12-28

    上傳用戶:zhang97080564

  • WP280 - 利用FPGA技術(shù)解決高端網(wǎng)絡(luò)設(shè)備實現(xiàn)中的難題

      本白皮書分析了業(yè)界對更高速率接口(尤其是100 GbE)的迫切需求、向平臺添加 100 GbE 時系統(tǒng)架構(gòu)師所面臨的重大風(fēng)險和問題,并評介幾種實現(xiàn)方案,這些方案顯示出 FPGA 在解決這些難題方面具有何等獨特的地位。

    標(biāo)簽: FPGA 280 WP 高端

    上傳時間: 2013-10-25

    上傳用戶:851197153

  • WP253 - 簡化FPGA配置設(shè)計過程

      本文著重介紹了 Xilinx Platform Flash PROM 如何幫助系統(tǒng)和電路板設(shè)計人員簡化 FPGA 配置設(shè)計。用于配置 FPGA 的可選解決方案有很多,但它們通常都需要大量的前期設(shè)計工作和時間。Platform Flash 是為配置 Xilinx FPGA 專門設(shè)計的一款包括硬件和軟件支持在內(nèi)的整體解決方案。

    標(biāo)簽: FPGA 253 WP 過程

    上傳時間: 2013-11-04

    上傳用戶:ifree2016

  • PLD、FPGA優(yōu)秀設(shè)計的十條戒律

    PLD、FPGA優(yōu)秀設(shè)計的十條戒律, 該文淺顯易懂的介紹了一個優(yōu)秀設(shè)計必須考慮的問題,給出了設(shè)計方法和建議。仔細(xì)閱讀和消化本文,對提高PLD/FPGA設(shè)計水平大有裨益

    標(biāo)簽: FPGA PLD

    上傳時間: 2013-11-23

    上傳用戶:tsfh

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