一種基于FPGA 實現(xiàn)的全并行結構FFT 設計方法，采用全并行加流水結構, 可在一個時鐘節(jié)拍內完成32 點FFT 運算的功能, 設計最高運算速度可達11ns
標簽： FPGA FFT 并行 設計方法
上傳時間： 2013-08-16
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一種基于FPGA實現(xiàn)的FFT結構\\r\\n調從基本元器件開始的計算機硬件系統(tǒng)的設計與實現(xiàn),大多設置在自動控制系,形成了與應用系統(tǒng)結合的計算機教育。 1966年多處理器平臺FPGA 學習目標 (1) 理解為什么嵌入式系統(tǒng)使用多處理器 (2) 指出處理器中CPU和硬件邏輯的折衷
標簽： FPGA FFT
上傳時間： 2013-08-20
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16位定點FFT-DSP的FPGA實現(xiàn)，相關代碼和實用說明
標簽： FFT-DSP FPGA 定點
上傳時間： 2013-08-21
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用fpga實現(xiàn)dsp 的fft算法 其中有幾個文檔文件和用vhdl寫的1024點的fft代碼
標簽： fft fpga 1024 vhdl
上傳時間： 2013-08-22
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FFT處理器的FPGA設計,詳細論證設計方案，希望對大家有所幫助。
標簽： FPGA FFT 處理器 設計方案
上傳時間： 2013-08-23
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基于FPGA的快速并行FFT及其在空間太陽望遠鏡圖像鎖定系統(tǒng)中的應用
標簽： FPGA FFT 并行 圖像
上傳時間： 2013-08-28
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信號處理中FFT的應用
標簽： FFT 信號處理
上傳時間： 2013-11-18
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介紹了一種基于低壓、寬帶、軌對軌、自偏置CMOS第二代電流傳輸器（CCII）的電流模式積分器電路，能廣泛應用于無線通訊、射頻等高頻模擬電路中。通過采用0.18 μm工藝參數(shù)，進行Hspice仿真，結果表明：電流傳輸器電壓跟隨的線性范圍為-1.04～1.15 V，電流跟隨的線性范圍為-9.02～6.66 mA，iX/iZ的-3 dB帶寬為1.6 GHz。輸出信號的幅度以20dB/decade的斜率下降，相位在低于3 MHz的頻段上保持在90°。
標簽： 電流傳輸器 積分器
上傳時間： 2014-06-20
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影響數(shù)字信號處理發(fā)展的最主要因素之一就是處理速度。DFT使計算機處理頻域信號成為可能，但當N很大時，直接計算N點DFT的計算量非常大。FFT可使DFT的運算量下降幾個數(shù)量級，從而使數(shù)字信號處理的速度大大提高。本文介紹了如何利用高性能數(shù)字信號處理器實現(xiàn)FFT算法，給出了程序流程圖及關鍵程序源碼。該算法采用基2 FFT算法，參數(shù)計算主要采用查表法，計算量小，實時性高。在電網諧波檢測應用中表明，該方法既能有效地檢測出電網諧波，又能滿足實時性要求。
標簽： FFT 算法 電網諧波 檢測
上傳時間： 2013-10-21
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反激式轉換器通常應用於具有多個輸出電壓並要求中低輸出功率的電源。配合采用一個反激式轉換器，多輸出僅增加極少的成本或復雜度––– 每個額外的輸出僅要求另一個變壓器繞組、整流器和輸出濾波電容器。
標簽： 反激式控制器 輸出 調節(jié) 性能
上傳時間： 2013-11-22
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