fpga design flow from Xilinx
標(biāo)簽： design Xilinx fpga flow
上傳時間： 2013-08-29
上傳用戶：talenthn
fpga的一個相關(guān)總結(jié)，據(jù)說是歐洲宇航局的，也不錯
標(biāo)簽： fpga
上傳用戶：klin3139
基于FPGA加密芯片設(shè)計論文（AES和DES算法）
標(biāo)簽： FPGA AES DES 加密
上傳用戶：weixiao99
基于DSP+FPGA的擴頻接收機快捕技術(shù)，一片技術(shù)文章
標(biāo)簽： FPGA DSP 擴頻接收機
上傳用戶：emhx1990
PLD、CPLD、FPGA有何不同？（問與答）
標(biāo)簽： CPLD FPGA PLD
上傳用戶：windypsm
fpga經(jīng)驗的總結(jié)，對于學(xué)習(xí)有很大的幫助，可以少走彎路
標(biāo)簽： fpga 經(jīng)驗
上傳用戶：陽光少年2016
EDA\\FPGA設(shè)計入門\\Farsight060724FPGA-2.rar 這個東西對初學(xué)EDA設(shè)計的人很有用
標(biāo)簽： FPGA EDA
上傳用戶：hgmmyl
詳細(xì)描述了在FPGA/CPLD設(shè)計過程中應(yīng)注意的地方,和如何提高設(shè)計效率,對FPGA設(shè)計者有很好的幫助
標(biāo)簽： FPGA CPLD 過程 如何提高
上傳用戶：wfeel
基于FPGA液晶控制器設(shè)計與實現(xiàn)，采用VHDL硬件描述語言。
標(biāo)簽： FPGA VHDL 液晶 制器設(shè)計
上傳用戶：shen_dafa
基于FPGA＋DDS的MSK數(shù)字調(diào)制源設(shè)計 通信中的DDS技術(shù)應(yīng)用
標(biāo)簽： FPGA DDS MSK 數(shù)字調(diào)制
上傳用戶：r5100
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