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Xilinx-fpga

  • Xilinx-Spartan6 FPGA實(shí)現(xiàn)MultiBoot

    通過Xilinx Spartan-6 FPGA 的Multiboot特性,允許用戶一次將多個(gè)配置文件下載入Flash中,根據(jù)不同時(shí)刻的需求,在不掉電重啟的情況下,從中選擇一個(gè)來重配置FPGA,實(shí)現(xiàn)不同功能,提高器件利用率,增加系統(tǒng)安全性,降低系統(tǒng)成本。

    標(biāo)簽: Xilinx-Spartan MultiBoot FPGA

    上傳時(shí)間: 2013-11-04

    上傳用戶:z1191176801

  • WP312-Xilinx新一代28nm FPGA技術(shù)簡介

    Xilinx Next Generation 28 nm FPGA Technology Overview Xilinx has chosen 28 nm high-κ metal gate (HKMG) highperformance,low-power process technology and combined it with a new unified ASMBL™ architecture to create a new generation of FPGAs that offer lower power and higher performance. These devices enable unprecedented levels of integration and bandwidth and provide system architects and designers a fully programmable alternative to ASSPs and ASICs.

    標(biāo)簽: Xilinx FPGA 312 WP

    上傳時(shí)間: 2014-12-28

    上傳用戶:zhang97080564

  • FPGA/CPLD設(shè)計(jì)工具——Xilinx ISE使用詳解

    FPGA/CPLD設(shè)計(jì)工具——Xilinx ISE使用詳解

    標(biāo)簽: Xilinx FPGA CPLD ISE

    上傳時(shí)間: 2013-07-15

    上傳用戶:eeworm

  • FPGA-CPLD設(shè)計(jì)工具——Xilinx-ISE使用詳解-378頁-71.7M.pdf

    專輯類-可編程邏輯器件相關(guān)專輯-96冊-1.77G FPGA-CPLD設(shè)計(jì)工具——Xilinx-ISE使用詳解-378頁-71.7M.pdf

    標(biāo)簽: Xilinx-ISE FPGA-CPLD 71.7 378

    上傳時(shí)間: 2013-04-24

    上傳用戶:yuanyuan123

  • FPGA的LVDS介紹和xilinx原語的使用

    FPGA的LVDS介紹和xilinx原語的使用方法中文說明.rar

    標(biāo)簽: xilinx FPGA LVDS

    上傳時(shí)間: 2013-08-01

    上傳用戶:leehom61

  • 基于FPGA的波束成型

    波束成型,基于FPGA的波束成型,包括兩個(gè)文件,一個(gè)濾波器,一個(gè)xilinx仿真

    標(biāo)簽: FPGA 波束

    上傳時(shí)間: 2013-08-05

    上傳用戶:joheace

  • Mars-SP3-U FPGA開發(fā)板說明

    Mars-SP3-U FPGA開發(fā)板說明,針對Xilinx的XC3S400,有對原理圖的說明和實(shí)例操作說明

    標(biāo)簽: Mars-SP FPGA 開發(fā)板說明

    上傳時(shí)間: 2013-08-15

    上傳用戶:songnanhua

  • FPGA中雙向端口I/O的設(shè)計(jì)

    :針對現(xiàn)場可編程門陣列(FPGA)芯片的特點(diǎn),研究FPGA中雙向端口I/O的設(shè)計(jì),同時(shí)給出仿真初始化雙向端口I/O的方法。采用這種雙向端口的設(shè)計(jì)方法,選用Xilinx的Spartan2E芯片設(shè)計(jì)一個(gè)多通道圖像信號處理系統(tǒng)。

    標(biāo)簽: FPGA 雙向端口

    上傳時(shí)間: 2013-08-17

    上傳用戶:xiaoyunyun

  • FPGA設(shè)計(jì)全流程

    FPGA設(shè)計(jì)全流程:Modelsim>>Synplify.Pro>>ISE\\r\\n第一章 Modelsim編譯Xilinx庫\\r\\n第二章 調(diào)用Xilinx CORE-Generator\\r\\n第三章 使用Synplify.Pro綜合HDL和內(nèi)核\\r\\n第四章 綜合后的項(xiàng)目執(zhí)行\(zhòng)\r\\n第五章 不同類型結(jié)構(gòu)的仿真

    標(biāo)簽: FPGA 流程

    上傳時(shí)間: 2013-08-20

    上傳用戶:cuibaigao

  • 在利用FPGA實(shí)現(xiàn)數(shù)字信號處理方面

    在利用FPGA實(shí)現(xiàn)數(shù)字信號處理方面,分布式算法發(fā)揮著關(guān)鍵作用,與傳統(tǒng)的乘積-積結(jié)構(gòu)相比,具有并行處理的高效性特點(diǎn)。詳細(xì)研究了基于FPGA、采用分布式算法實(shí)現(xiàn)FIR數(shù)字濾波器的原理和方法,并通過Xilinx ISE在Modelsim下進(jìn)行了仿真。

    標(biāo)簽: FPGA 數(shù)字信號處理 方面

    上傳時(shí)間: 2013-08-30

    上傳用戶:宋桃子

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