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FPGA設(shè)計(jì)全流程

  • 資源大小:213 K
  • 上傳時(shí)間: 2013-08-20
  • 上傳用戶:wc7707399
  • 資源積分:2 下載積分
  • 標(biāo)      簽: FPGA 流程

資 源 簡 介

FPGA設(shè)計(jì)全流程:Modelsim>>Synplify.Pro>>ISE\\r\\n第一章 Modelsim編譯Xilinx庫\\r\\n第二章 調(diào)用Xilinx CORE-Generator\\r\\n第三章 使用Synplify.Pro綜合HDL和內(nèi)核\\r\\n第四章 綜合后的項(xiàng)目執(zhí)行\(zhòng)\r\\n第五章 不同類型結(jié)構(gòu)的仿真

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