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Verilog
Verilog
HDL是一種硬件描述語言，以文本形式來描述數(shù)字系統(tǒng)硬件的結構和行為的語言，用它可以表示邏輯電路圖、邏輯表達式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。
Verilog
HDL和VHDL是世界上最流行的兩種硬件描述語言，都是在20世紀80年代中期開發(fā)出來的。前者由GatewayDesignAutomation公司（該公司于1989年被Cadence公司收購）開發(fā)。兩種HDL均為IEEE標準。[1]
基于
Verilog
的fir濾波
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通過
Verilog
HDL語言使用CPLD連接PS2鍵盤
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用
Verilog
實現(xiàn)的串口收發(fā)數(shù)據(jù)程序
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FPGA
Verilog
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jepg
Verilog
example
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這是一個關于晶震的一個
Verilog
源代碼,希望對新手有用
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arm9_fpga2_
Verilog
是一個可以綜合的用
Verilog
寫的arm9的ip軟核
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這是我寫的一個關于fpga
Verilog
的程序希望有對初學著有幫助
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多個
Verilog
和vhdl程序例子
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fpga-jpeg-
Verilog
在fpga平臺使用
Verilog
語言進行jpeg算法實現(xiàn)
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