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Verilog語言

這是用Verilog語言編寫AV型LCD屏的驅(qū)動(dòng)程序CPLD上運(yùn)行并調(diào)試成功的。可用作數(shù)字到模擬LCD轉(zhuǎn)換

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在quartusII下用verilog語言自己寫的IP核

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FPGA上的VERILOG語言編程。通過查找表實(shí)現(xiàn)直接數(shù)字頻率合成。在主控部分通過鍵盤選擇正弦波

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采用Verilog語言,實(shí)現(xiàn)了FPGA控制視頻芯片的數(shù)據(jù)采集,并將數(shù)據(jù)按幀存儲(chǔ)起來

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verilog語言寫的sdram控制器—命令響應(yīng)模塊代碼

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vhdl to verilog語言的編程設(shè)計(jì)

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用VERILOG語言實(shí)現(xiàn)的數(shù)據(jù)加密標(biāo)準(zhǔn)代碼,在QUARTUS5.1上仿真過

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verilog語言編寫可綜合FIFO。簡(jiǎn)單實(shí)用

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采用Verilog語言描述的FIFO和雙端口RAM源代碼。

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用Verilog語言實(shí)現(xiàn)了一個(gè)8bit的超前進(jìn)位加法器

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