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用verilog HDL寫的VGA驅動，在FPGA上實測可用（實際上是別人的勞動成果，呵呵）。
標簽： verilog HDL VGA 驅動
上傳時間： 2014-01-15
上傳用戶：1966640071
經典的FIFO實現源碼，里面有三種類型，是xilinx工程師寫的，經典
標簽： FIFO 源碼
上傳時間： 2017-05-23
上傳用戶：561596
512×8bid的FIFO 含工程文件，基于QUARTUsII
標簽： 8bid FIFO 512 工程
上傳時間： 2014-01-12
上傳用戶：離殤
王金明verilog書中的大量實例 適合初學者使用
標簽： verilog 初學者
上傳時間： 2013-12-16
上傳用戶：541657925
利用verilog hdl編寫的浮點加法器運算單元，單精度。
標簽： verilog hdl 編寫 浮點
上傳時間： 2013-11-29
上傳用戶：王慶才
verilog語言實現的基于MIPS體系結構的微處理器程序，一個時鐘周期執行一條指令。
標簽： verilog MIPS 語言 微處理器
上傳時間： 2013-12-11
上傳用戶：咔樂塢
這個是用verilog語言編寫的基于FPGA的交通燈控制器，分別控制四個方向上的交通燈的通斷
標簽： verilog FPGA 語言 編寫
上傳時間： 2017-06-12
上傳用戶：hfmm633
是深度為7的FIFO
標簽： FIFO
上傳時間： 2017-06-15
上傳用戶：小寶愛考拉
一種基于格雷碼的異步FIFO設計與實現,8*8位的fifo VHDL 源碼
標簽： FIFO fifo VHDL 格雷碼
上傳時間： 2017-06-22
上傳用戶：yzy6007
Java語 言 的 產 生 及 其 特 點 Java程 序 開 發 與 運 行 環 境 Java程 序 設 計 基 礎 Java應 用 程 序 的 基 本 框 架 Java的 類 Java圖 形 用 戶 接 口
標簽： Java Jav
上傳時間： 2017-06-24
上傳用戶：ukuk
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