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Verilog基本電路設計指導書

jepg verilog example

jepg verilog example

標簽： example verilog jepg

上傳時間： 2013-08-22

上傳用戶：旗魚旗魚
這是一個關于晶震的一個verilog 源代碼,希望對新手有用

這是一個關于晶震的一個verilog 源代碼,希望對新手有用

標簽： verilog 源代碼

上傳時間： 2013-08-23

上傳用戶：大灰狼123456
arm9_fpga2_verilog是一個可以綜合的用verilog寫的arm9的ip軟核

arm9_fpga2_verilog是一個可以綜合的用verilog寫的arm9的ip軟核，對學習arm和FPGA開發有幫助。

標簽： verilog fpga arm9 arm

上傳時間： 2013-08-23

上傳用戶：xlcky
這是我寫的一個關于fpga verilog的程序希望有對初學著有幫助

這是我寫的一個關于fpga verilog的程序希望有對初學著有幫助

標簽： verilog fpga 程序

上傳時間： 2013-08-23

上傳用戶：gundamwzc
多個Verilog和vhdl程序例子

多個Verilog和vhdl程序例子，可以作為初學者參考實例，按照電路結構寫出HDL代碼

標簽： Verilog vhdl 程序

上傳時間： 2013-08-26

上傳用戶：athjac
MIL-STD一1553B是一種集中控制式、時分指令/響應型多路串行數據總線標

MIL-STD一1553B是一種集中控制式、時分指令/響應型多路串行數據總線標\r\n準，具有高可靠性和靈活性，已經成為現代航空機載系統設備互聯的最有效的解\r\n決方案，廣泛的應用于飛機、艦船、坦克等武器平臺上，并且越來越多的應用到\r\n民用領域。完成1553B總線數據傳輸功能的關鍵部件是總線接口芯片11][41。\r\n在對M幾STD一1553B數據總線協議進行研究后，參考國外一些芯片的功能結\r\n構，結合EDA技術，本論文提出了基于FPGA的1553B總線接口芯片的設計方案。\r\n在介紹了總線

標簽： MIL-STD 1553B 集中控制時分

上傳時間： 2013-08-26

上傳用戶：manlian
介紹了Proteus的基本是使用

介紹了Proteus的基本是使用,有利于掌握它與Keil 的聯調!

標簽： Proteus

上傳時間： 2013-08-27

上傳用戶：李彥東
fpga-jpeg-verilog在fpga平臺使用verilog語言進行jpeg算法實現

fpga-jpeg-verilog在fpga平臺使用verilog語言進行jpeg算法實現

標簽： fpga-jpeg-verilog verilog fpga jpeg

上傳時間： 2013-08-28

上傳用戶：zoudejile
verilog HDL 編寫的PWM

verilog HDL 編寫的PWM，是初學CPLD者入門Z資源，epm7128stc100-10

標簽： verilog HDL PWM 編寫

上傳時間： 2013-08-30

上傳用戶：aa54
dds設計，生成多種波形，Verilog語言

dds設計，花了一個星期做的,verilog寫的，可生成多種波形，頻率范圍可上M,性能不錯。

標簽： Verilog dds 波形語言

上傳時間： 2013-08-30

上傳用戶：wentianyou

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