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TestBench

TestBench是一種驗證的手段。首先，任何設計都是會有輸入輸出的。但是在軟環境中沒有激勵輸入，也不會對你設計的輸出正確性進行評估。那么此時便有一種，模擬實際環境的輸入激勵和輸出校驗的一種“虛擬平臺”的產生。在這個平臺上你可以對你的設計從軟件層面上進行分析和校驗，這個就是TestBench的含義。

UART Transmitter. VHDL code and its TestBench.

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Shift Register. VHDL code and its TestBench.

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opcore.org "uart16550" 項目的TestBench

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it is source code of 32 bit register and TestBench for tht register written in verilog.

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TestBench書寫

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Verilog-TestBench的寫法

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TestBench學習筆記

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怎樣寫TestBench

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如何編寫TestBench的總結

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TestBench

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opcore.org "uart16550" 項目的TestBench

it is source code of 32 bit register and TestBench for tht register written in verilog.

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