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TestBench

TestBench是一種驗證的手段。首先，任何設(shè)計都是會有輸入輸出的。但是在軟環(huán)境中沒有激勵輸入，也不會對你設(shè)計的輸出正確性進行評估。那么此時便有一種，模擬實際環(huán)境的輸入激勵和輸出校驗的一種“虛擬平臺”的產(chǎn)生。在這個平臺上你可以對你的設(shè)計從軟件層面上進行分析和校驗，這個就是TestBench的含義。

timing,原程序及TestBench,供初學者參考

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TestBench書寫規(guī)范格式的ppt教程

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vhdl的arm核包含TestBench

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VHDL計數(shù)器的TestBench

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DAC converter design with Verilog code and TestBench

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I2C bus HDL source and TestBench

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編寫TestBench的超好教程

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編寫TestBench的非常號的參考資料哦。

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用于AES加密的TestBench。產(chǎn)生激勵

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簡單的TestBench制作方法

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TestBench

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