//9488定時器B功能測試 9488定時器B功能測試B:DAMI調(diào)試通過: 9488 8位定時器B的使用 有關(guān)的I/O為三個:TBPWM(輸出)(P1.0) 模式有:間隔定時功能,PWM模式 有定時中斷:定時器B溢出中斷
上傳時間： 2017-06-01
上傳用戶：ryb
USBHostSlave is a USB 1.1 host and Device IP core. – Supports full speed (12Mbps) and low speed (1.5Mbps) operation. – USB Device has four endpoints, each with their own independent FIFO. – Supports the four types of USB data transfer control, bulk, interrupt, and isochronous transfers. – Host can automatically generate SOF packets. – 8-bit Wishbone slave bus interface. – FIFO depth configurable via paramters.
標(biāo)簽： speed USBHostSlave and Supports
上傳時間： 2014-01-17
上傳用戶：sxdtlqqjl
HSSDRC IP core is the configurable universal SDRAM controller with adaptive bank control and adaptive command pipeline. HSSDRC IP core and IP core testbench has been written on SystemVerilog and has been tested in Modelsim. HSSDRC IP core is licensed under MIT License
標(biāo)簽： configurable controller universal adaptive
上傳時間： 2017-06-25
上傳用戶：皇族傳媒
This is is a bridge IP core to interface the Tensilica PIF bus protocol with the OpenCores WishBone. It currently supports single-cycle as well as burst transfer operations. The core has been tested in a master-PIF slave-WB configuration.
標(biāo)簽： Tensilica OpenCores interface the
上傳時間： 2013-12-21
上傳用戶：gonuiln
Quartus中實(shí)現(xiàn)的DDS 使用的是altera提供的IP core
標(biāo)簽： Quartus altera core DDS
上傳時間： 2017-06-27
上傳用戶：Breathe0125
Alera 的8051 IP core的示例文件5個
上傳時間： 2017-07-09
上傳用戶：cylnpy
tutorial of xilinx ip core
標(biāo)簽： tutorial xilinx core of
上傳時間： 2017-07-25
上傳用戶：集美慧
Quartus中fft ip core的使用(modelsim 仿真FFT ip core 結(jié)合QUARTUS II 聯(lián)合調(diào)試)
標(biāo)簽： core modelsim Quartus QUARTUS
上傳時間： 2017-07-31
上傳用戶：love1314
數(shù)字音頻接口spdif ip core，verilog語言編寫，帶有testbench
標(biāo)簽： 數(shù)字音頻接口
上傳時間： 2022-05-17
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1.有三根桿子A,B,C。A桿上有若干碟子 2.每次移動一塊碟子,小的只能疊在大的上面 3.把所有碟子從A桿全部移到C桿上 經(jīng)過研究發(fā)現(xiàn)，漢諾塔的破解很簡單，就是按照移動規(guī)則向一個方向移動金片： 如3階漢諾塔的移動：A→C,A→B,C→B,A→C,B→A,B→C,A→C 此外，漢諾塔問題也是程序設(shè)計中的經(jīng)典遞歸問題
標(biāo)簽： 移動 發(fā)現(xiàn)
上傳時間： 2016-07-25
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