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RS-485總線

  • 計算機通信與rs-232接口實用指南-549頁-11.2M.pdf

    專輯類-數字處理及顯示技術專輯-106冊-9138M 計算機通信與rs-232接口實用指南-549頁-11.2M.pdf

    標簽： 11.2 232 549

    上傳時間： 2013-07-14

    上傳用戶：wc412467303

  • 485.rar

    MAX485串口通信的所有資料 485與單片機MAX232連接PC機的遠程通信

    標簽： 485

    上傳時間： 2013-05-27

    上傳用戶：fzy309228829

  • 485總線通訊方式分析.rar

    485總線通訊方式分析,主要是讓大家了解485總線通訊原理

    標簽： 485 總線通訊 分

    上傳時間： 2013-06-27

    上傳用戶：trepb001

  • 485通信仿真源碼.rar

    關于485通信的一些資料 和自己寫的一個仿真 三機通訊（一個主機，2個從機）

    標簽： 485 通信 仿真

    上傳時間： 2013-06-18

    上傳用戶：gzming

  • RS編譯碼器的設計與FPGA實現

    Reed-Solomon碼(簡稱RS碼)是一種具有很強糾正突發和隨機錯誤能力的信道編碼方式，在深空通信、移動通信、磁盤陣列以及數字視頻廣播(DVB)等系統中具有廣泛的應用。 本文簡要介紹了有限域基本運算的算法和常用的RS編碼算法，分析了改進后的Euclid算法和改進后的BM算法，針對改進后的BM算法提出了一種流水線結構的譯碼器實現方案并改進了該算法的實現結構，在譯碼器復雜度和譯碼延時上作了折衷，降低了譯碼器的復雜度并提高了譯碼器的最高工作頻率。在Xilinx公司的Virtex-Ⅱ系列FPGA上設計實現了RS(255,239)編譯碼器，證明了該方案的可行性。

    標簽： FPGA RS編譯碼

    上傳時間： 2013-06-11

    上傳用戶：奇奇奔奔

  • RS（255，223）譯碼器的FPGA實現及其性能測試

    　　本課題首先研究了常規的RS譯碼器的算法，確定在關鍵方程的計算中采用一種新改進的BM算法，然后提出了基于復數基的有限域快速并行乘法器和利用冪指數相減進行除法計算的有限域除法器，通過這些優化方法提高了RS譯碼器的速度，減少了譯碼延時和硬件資源使用，最后利用VHDL硬件描述語言在FPGA上實現了流水線處理的RS(255,223)譯碼器。　 　本課題實現的RS(255,223)硬件譯碼器的性能在國內具有領先水平，對我國以后航天項目高速數據傳輸系統的設計有著很大的意義。　

    標簽： FPGA 255 223 譯碼器

    上傳時間： 2013-06-29

    上傳用戶：gokk

  • IEEE 802.16a RS-CC編譯碼VLSI算法研究及FPGA實現

    　　本論文依據IEEE802.16a物理層對RS-CC碼的參數要求，研究了RS-CC碼的高速編、譯碼的VLSI硬件算法，同時對FPGA開發技術進行了研究，以VerilogHDL為描述語言，在Xilinx公司的FPGA上實現了高速的RS-CC編、譯碼器。RS譯碼器中，錯誤位置多項式和錯誤值多項式的求解采用無求逆單元，并具有規則數據流、易于VLSI實現的改進的歐幾里德算法(MEA)；CC譯碼器由采用模歸一化路徑度量的全并行的“加比選(ACS)”模塊和具有脈動陣列結構的幸存路徑回溯模塊組成。　　在實現RS-CC譯碼器的過程中，分別從算法上和根據FPGA的結構特點上，對譯碼器做了一些優化工作，降低了硬件資源占有率和提高了譯碼速度。　　此外，還搭建了以Xilinx公司40萬等效門的FPGASpartan-Ⅲ400-4PQ208為主體，以Cypress公司的USB2.0芯片CY7C68013為高速數據接口的硬件試驗平臺，并在此試驗平臺上實現了文中的高速RS-CC編譯碼系統。

    標簽： 802.16 RS-CC IEEE FPGA

    上傳時間： 2013-06-03

    上傳用戶：lx9076

  • 經典485電路圖

    經典485電路圖，對電路設計有非常好的參考價值

    標簽： 485 電路圖

    上傳時間： 2013-04-24

    上傳用戶：agent

  • 232轉485電路圖

    經典232轉485電路圖，對電路設計有非常好的參考價值

    標簽： 232 485 電路圖

    上傳時間： 2013-06-30

    上傳用戶：stella2015

  • DVB系統中RS編解碼器的FPGA實現

    該論文討論如何采用一種串行無逆的Berlekamp-Massey(BM)算法,設計應用于DVB系統中的RS(204,188)信道編碼/解碼電路,并通過FPGA的驗證.RS解碼器的設計采用無逆BM算法,并利用串行方式來實現,不僅避免了求逆運算,而且只需用3個有限域乘法器就可以實現,大大的降低了硬件實現的復雜度,并且因為在硬件實現上,采用了3級流水線(pipe-line)的處理結構.RS編碼器的設計中,利用有限域常數乘法器的特性對編碼電路進行優化.這些技術的采用大大的提高了RS編/解碼器的效率,節省了RS編/解碼器所占用資源.

    標簽： FPGA DVB RS編解碼

    上傳時間： 2013-08-05

    上傳用戶：BOBOniu

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