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RS譯碼器

  • 基于MCS 51單片機的PLC仿真器

    可編程控制器PLC以抗擾性強、可靠性高和編程靈活等特點在工業上得到廣泛應用,為了優化PLC系統設計,介紹一種基于MCS.51單片機的PLC仿真器,并給出了硬、軟件設計與實現方法。編程設計主要包括監控主

    標簽: MCS PLC 51單片機 仿真器

    上傳時間: 2013-07-07

    上傳用戶:yzhl1988

  • EDA卷積碼編解碼器實現技術

    EDA卷積碼編解碼器實現技術針對某擴頻通信系統數據糾錯編碼的需要, 構造并分析了(2 , 1 , 6) 卷積碼編解碼器的基本工作原理, 提出了基于MAX +

    標簽: EDA 卷積碼 編解碼器 實現技術

    上傳時間: 2013-07-18

    上傳用戶:ynwbosss

  • MSP430仿真器幾套制作資料

    MSP430USB仿真器制作資料+430JTAG簡版仿真器+利爾達- 輕松制作MSP430 JTAG Adapter+制作的單面板的MSP430JTAG仿真器 幾套430JTAG制作方案,做不好你找我........

    標簽: MSP 430 仿真器 制作資料

    上傳時間: 2013-07-26

    上傳用戶:liaofamous

  • 軟PLC程序編輯器中功能塊的設計與實現

    本文分析了目前軟PLC 編輯器中功能塊編程的不足,提出了使用面向對象的概念來設計功能塊圖的方法。通過研究軟PLC 開發系統和編譯系統的模型,詳細討論了PLC 梯形圖中圖元的設計方法,并基于此方

    標簽: PLC 程序 功能塊

    上傳時間: 2013-06-21

    上傳用戶:allen-zhao123

  • 太陽能電池光伏并網逆變器

    光伏并網逆變器是將太陽能電池所輸出的直流電轉換成符合公共電網要求的交流電并送入電網的設備。按照不同的標準光伏并網逆變器的拓撲結構分為很多種,本文介紹了一種工頻隔離型光伏并網逆變器

    標簽: 太陽能電池 光伏并網 逆變器

    上傳時間: 2013-08-02

    上傳用戶:baiom

  • 軟件無線電中用FPGA實現信道糾錯碼的設計

    軟件無線電是近幾年來提出的一種實現通信的新概念和體制。它的核心是:將寬帶A/D和D/A變換器盡可能地靠近天線,各種功能盡可能地采用軟件進行定義。因此它具有很強的靈活性、開放性和兼容性,是目前研究的熱點。  本文將對軟件無線電的編譯碼部分加以敘述,提出了在VHF/UHF軟件無線電接收/發送樣機中的編譯碼方案及其具體的實現方法。該部分包括發射端的漢明(8,4,4)編碼、RS(100,81)編碼、卷積(2,1,6)編碼,以及在接收端相對應的漢明譯碼、RS譯碼、Viterbi譯碼等?! ”疚氖紫冉榻B軟件無線電的發展概況和VHF/UHF軟件無線電接收/發送樣機的總體方案,然后按照編譯碼部分的功能模塊逐章說明其實現的方法,最后對該部分的設計和實現加以總結。

    標簽: FPGA 軟件無線電 信道 糾錯碼

    上傳時間: 2013-04-24

    上傳用戶:fling_up

  • 全并行Viterbi譯碼器的FPGA實現

      本文對于全并行Viterbi譯碼器的設計及其FPGA實現方案進行了研究,并最終將用FPGA實現的譯碼器嵌入到某數字通信系統之中。  首先介紹了卷積碼及Viterbi譯碼算法的基本原理,并對卷積碼的糾錯性能進行了理論分析。接著介紹了Viterbi譯碼器各個模塊實現的一些經典算法,對這些算法的硬件結構設計進行優化并利用FPGA實現,而后在QuartusⅡ平臺上對各模塊的實現進行仿真以及在Matlab平臺上對結果進行驗證。最后給出Viterbi譯碼模塊應用在實際系統上的誤碼率測試性能結果?! y試結果表明,系統的誤碼率達到了工程標準的要求,從而驗證了譯碼器設計的可靠性,同時所設計的基于FPGA實現的全并行Viterbi譯碼器適用于高速數據傳輸的應用場合。

    標簽: Viterbi FPGA 并行 譯碼器

    上傳時間: 2013-07-30

    上傳用戶:13913148949

  • 傳輸流復用器的FPGA建模與實現

    數字電視近年來飛速發展,它最終取代模擬電視是一個必然趨勢。可編程邏輯技術以及EDA技術的升溫也帶來了電子系統設計的巨大變革。本論文將迅速發展的FPGA技術應用于數字電視系統中,研究探討了數字電視前端系統中的關鍵設備——傳輸流復用器的FPGA建模和實現,以及相關的關鍵技術。本論文首先介紹了數字電視的發展現狀和前景,概述了數字電視前端系統的組成結構與關鍵技術,以及可編程邏輯技術的發展和優勢。然后介紹了數字電視系統中的重要標準MPEG-2以及傳輸流復用器的原理和系統結構,并且從理論上闡述了復用器設計的關鍵技術:PSI重組和PCR調整。接著詳細說明了如何運用創新思路,采用獨特的硬件架構在一片FPGA上實現整個復用器的軟件和硬件系統的方案,并且舉例說明了復用器硬件邏輯設計中所運用的幾個FPGA設計技巧。最后對本文進行總結,并提出了數字電視系統中復用器設備未來發展的設想。本文中介紹的基于SOPC的硬件復用器設計方案,將系統的軟件和硬件集成在一款Altera公司新推出的低成本高密度cyclone系列FPGA上,并且將FPGA設計技巧運用于復用器的硬件邏輯設計中。整個設計方案不但簡化了系統設計,而且實現了穩定,高速,低成本,可擴展性強的復用器系統。

    標簽: FPGA 傳輸流 復用器 建模

    上傳時間: 2013-06-02

    上傳用戶:gtzj

  • 圖象壓縮系統中熵編解碼器的FPGA設計及實現

    隨著移動終端、多媒體、Internet網絡、通信,圖像掃描技術的發展,以及人們對圖象分辨率,質量要求的不斷提高,用軟件壓縮難以達到實時性要求,而且會帶來因傳輸大量原始圖象數據帶來的帶寬要求,因此采用硬件實現圖象壓縮已成為一種必然趨勢。而熵編碼單元作為圖像變換,量化后的處理環節,是圖像壓縮中必不可少的部分。研究熵編解碼器的硬件實現,具有廣闊的應用背景。本文以星載視頻圖像壓縮的硬件實現項目為背景,對熵編碼器和解碼器的硬件實現進行探討,給出了并行熵編碼和解碼器的實現方案。熵編解碼器中的難點是huffman編解碼器的實現。在設計并行huffman編碼方案時通過改善Huffman編碼器中變長碼流向定長碼流轉換時的控制邏輯,避免了因數據處理不及時造成數據丟失的可能性,從而保證了編碼的正確性。而在實現并行的huffman解碼器時,解碼算法充分利用了規則化碼書帶來的碼字的單調性,及在特定長度碼字集內碼字變化的連續性,將并行解碼由模式匹配轉換為算術運算,提高了存儲器的利用率、系統的解碼效率和速度。在實現并行huffman編碼的基礎上,結合針對DC子帶的預測編碼,針對直流子帶的游程編碼,能夠對圖像壓縮系統中經過DWT變換,量化,掃描后的數據進行正確的編碼。同時,在并行huffman解碼基礎上的熵解碼器也可以解碼出正確的數據提供給解碼系統的后續反量化模塊,進一步處理。在本文介紹的設計方案中,按照自頂向下的設計方法,對星載圖像壓縮系統中的熵編解碼器進行分析,進而進行邏輯功能分割及模塊劃分,然后分別實現各子模塊,并最終完成整個系統。在設計過程中,用高級硬件描述語言verilogHDL進行RTL級描述。利用了Altera公司的QuartusII開發平臺進行設計輸入、編譯、仿真,同時還采用modelsim仿真工具和symplicity的綜合工具,驗證了設計的正確性。通過系統波形仿真和下板驗證熵編碼器最高頻率可以達到127M,在62.5M的情況下工作正常。而熵解碼器也可正常工作在62.5M,吞吐量可達到2500Mbps,也能滿足性能要求。仿真驗證的結果表明:設計能夠滿足性能要求,并具有一定的使用價值。

    標簽: FPGA 圖象壓縮

    上傳時間: 2013-05-19

    上傳用戶:吳之波123

  • 基于FPGA的逆變器控制芯片研究

    逆變控制器的發展經歷從分立元件的模擬電路到以專用微處理芯片(DSP/MCU)為核心的電路系統,并從數?;旌想娐愤^渡到純數字控制的歷程。但是,通用微處理芯片是為一般目的而設計,存在一定局限。為此,近幾年來逆變器專用控制芯片(ASIC)實現技術的研究越來越受到關注,已成為逆變控制器發展的新方向之一。本文利用一個成熟的單相電壓型PWM逆變器控制模型,圍繞逆變器專用控制芯片ASIC的實現技術,依次對專用芯片的系統功能劃分,硬件算法,全系統的硬件設計及優化,流水線操作和并行化,芯片運行穩定性等問題進行了初步研究。首先引述了單相電壓型PWM逆變器連續時間和離散時間的數學模型,以及基于極點配置的單相電壓型PWM逆變器電流內環電壓外環雙閉環控制系統的設計過程,同時給出了仿真結果,仿真表明此系統具有很好的動、靜態性能,并且具有自動限流功能,提高了系統的可靠性。緊接著分析了FPGA器件的特征和結構。在給出本芯片應用目標的基礎上,制定了FPGA目標器件的選擇原則和芯片的技術規格,完成了器件選型及相關的開發環境和工具的選取。然后系統闡述了復雜FPGA設計的設計方法學,詳細介紹了基于FPGA的ASIC設計流程,概要介紹了僅使用QuartusII的開發流程,以及Modelsim、SynplifyPro、QuartusII結合使用的開發流程。在此基礎上,進行了芯片系統功能劃分,針對:DDS標準正弦波發生器,電壓電流雙環控制算法單元,硬件PI算法單元,SPWM產生器,三角波發生器,死區控制器,數據流/控制流模塊等逆變器控制硬件算法/控制單元,研究了它們的硬件算法,完成了模塊化設計。分析了全數字鎖相環的結構和模型,以此為基礎,設計了一種應用于逆變器的,用比例積分方法替代傳統鎖相系統中的環路濾波,用相位累加器實現數控振蕩器(DCO)功能的高精度二階全數字鎖相環(DPLL)。分析了“流水線操作”等設計優化問題,并針對逆變器控制系統中,控制系統算法呈多層結構,且層與層之間還有數據流聯系,其執行順序和數據流的走向較為復雜,不利于直接采用流水線技術進行設計的特點,提出一種全新的“分層多級流水線”設計技術,有效地解決了復雜控制系統的流水線優化設計問題。本文最后對芯片運行穩定性等問題進行了初步研究。指出了設計中的“競爭冒險”和飽受困擾之苦的“亞穩態”問題,分析了產生機理,并給出了常用的解決措施。

    標簽: FPGA 逆變器 控制芯片

    上傳時間: 2013-05-28

    上傳用戶:ice_qi

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