<li id="gamo2"></li> IP核生成文件：（Xilinx/Altera 同） IP核生成器生成 ip 后有兩個(gè)文件對(duì)我們比較有用，假設(shè)生成了一個(gè) asyn_fifo 的核，則asyn_fifo.veo 給出了例化該核方式（或者在 Edit－》Language Template-》COREGEN 中找到verilog/VHDL 的例化方式）。asyn_fifo.v 是該核的行為模型，主要調(diào)用了 xilinx 行為模型庫(kù)的模塊，仿真時(shí)該文件也要加入工程。（在 ISE中點(diǎn)中該核，在對(duì)應(yīng)的 processes 窗口中運(yùn)行“ View Verilog Functional Model ”即可查看該 .v 文件）。如下圖所示。
標(biāo)簽： modelsim 仿真 IP核 仿真庫(kù)
上傳時(shí)間： 2013-10-20
上傳用戶(hù)：lingfei
已通過(guò)CE認(rèn)證。（為什么要選擇經(jīng)過(guò)CE認(rèn)證的編程器？） 程速度無(wú)與倫比,逼近芯片理論極限。 基本配置48腳流行驅(qū)動(dòng)電路。所選購(gòu)的適配器都是通用的（插在DIP48鎖緊座上），即支持同封裝所有類(lèi)型器件，48腳及以下DIP器件無(wú)需適配器直接支持。通用適配器保證快速新器件支持。I/O電平由DAC控制，直接支持低達(dá)1.5V的低壓器件。 更先進(jìn)的波形驅(qū)動(dòng)電路極大抑制工作噪聲,配合IC廠(chǎng)家認(rèn)證的算法,無(wú)論是低電壓器件、二手器件還是低品質(zhì)器件均能保證極高的編程良品率。編程結(jié)果可選擇高低雙電壓校驗(yàn),保證結(jié)果持久穩(wěn)固。 支持FLASH、EPROM、EEPROM、MCU、PLD等器件。支持新器件僅需升級(jí)軟件（免費(fèi)）。可測(cè)試SRAM、標(biāo)準(zhǔn)TTL/COMS電路，并能自動(dòng)判斷型號(hào)。 自動(dòng)檢測(cè)芯片錯(cuò)插和管腳接觸不良,避免損壞器件。 完善的過(guò)流保護(hù)功能,避免損壞編程器。 邏輯測(cè)試功能?？蓽y(cè)試和自動(dòng)識(shí)別標(biāo)準(zhǔn)TTL/CMOS邏輯電路和用戶(hù)自定義測(cè)試向量的非標(biāo)準(zhǔn)邏輯電路。 豐富的軟件功能簡(jiǎn)化操作，提高效率，避免出錯(cuò)，對(duì)用戶(hù)關(guān)懷備至。工程（Project）將用戶(hù)關(guān)于對(duì)象器件的各種操作、設(shè)置，包括器件型號(hào)設(shè)定、燒寫(xiě)文件的調(diào)入、配置位的設(shè)定、批處理命令等保存在工程文件中，每次運(yùn)行時(shí)一步進(jìn)入寫(xiě)片操作。器件型號(hào)選擇和文件載入均有歷史（History）記錄，方便再次選擇。批處理（Auto）命令允許用戶(hù)將擦除、查空、編程、校驗(yàn)、加密等常用命令序列隨心所欲地組織成一步完成的單一命令。量產(chǎn)模式下一旦芯片正確插入CPU即自動(dòng)啟動(dòng)批處理命令，無(wú)須人工按鍵。自動(dòng)序列號(hào)功能按用戶(hù)要求自動(dòng)生成并寫(xiě)入序列號(hào)。借助于開(kāi)放的API用戶(hù)可以在線(xiàn)動(dòng)態(tài)修改數(shù)據(jù)BUFFER，使每片芯片內(nèi)容均不同。器件型號(hào)選錯(cuò)，軟件按照實(shí)際讀出的ID提示相近的候選型號(hào)。自動(dòng)識(shí)別文件格式, 自動(dòng)提示文件地址溢出。 軟件支持WINDOWS98/ME/NT/2000/XP操作系統(tǒng)（中英文）。 器件型號(hào) 編程(秒) 校驗(yàn)(秒) P+V (s) Type 28F320W18 9 4.5 13.5 32Mb FLASH 28F640W30 18 9 27 64Mb FLASH AM29DL640E 38.3 10.6 48.9 64Mb FLASH MB84VD21182DA 9.6 2.9 12.5 16Mb FLASH MB84VD23280FA 38.3 10.6 48.9 64Mb FLASH LRS1381 13.3 4.6 19.9 32Mb FLASH M36W432TG 11.8 4.6 16.4 32Mb FLASH MBM29DL323TE 17.5 5.5 23.3 32Mb FLASH AT89C55WD 2.1 1 3.1 20KB MCU P89C51RD2B 4.6 0.9 5.5 64KB MCU
標(biāo)簽： superpro 280 驅(qū)動(dòng) 編程器軟件
上傳時(shí)間： 2013-10-18
上傳用戶(hù)：suicoe
附件是一款PCB阻抗匹配計(jì)算工具，點(diǎn)擊CITS25.exe直接打開(kāi)使用，無(wú)需安裝。附件還帶有PCB連板的一些計(jì)算方法，連板的排法和PCB聯(lián)板的設(shè)計(jì)驗(yàn)驗(yàn)。 PCB設(shè)計(jì)的經(jīng)驗(yàn)建議: 1.一般連板長(zhǎng)寬比率為1：1~2.5：1,同時(shí)注意For FuJi Machine:a.最大進(jìn)板尺寸為:450*350mm, 2.針對(duì)有金手指的部分,板邊處需作掏空處理,建議不作為連板的部位. 3.連板方向以同一方向?yàn)閮?yōu)先,考量對(duì)稱(chēng)防呆,特殊情況另作處理. 4.連板掏空長(zhǎng)度超過(guò)板長(zhǎng)度的1/2時(shí),需加補(bǔ)強(qiáng)邊. 5.陰陽(yáng)板的設(shè)計(jì)需作特殊考量. 6.工藝邊需根據(jù)實(shí)際需要作設(shè)計(jì)調(diào)整,軌道邊一般不少於6mm,實(shí)際中需考量板邊零件的排布,軌道設(shè)備正常卡壓距離為不少於3mm,及符合實(shí)際要求下的連板經(jīng)濟(jì)性. 7.FIDUCIAL MARK或稱(chēng)光學(xué)定位點(diǎn),一般設(shè)計(jì)在對(duì)角處,為2個(gè)或4個(gè),同時(shí)MARK點(diǎn)面需平整,無(wú)氧化,脫落現(xiàn)象;定位孔設(shè)計(jì)在板邊,為對(duì)稱(chēng)設(shè)計(jì),一般為4個(gè),直徑為3mm,公差為±0.01inch. 8.V-cut深度需根據(jù)連板大小及基板板厚考量,角度建議為不少於45°. 9.連板設(shè)計(jì)的同時(shí),需基於基板的分板方式考量<人工(治具)還是使用分板設(shè)備>. 10.使用針孔(郵票孔)聯(lián)接：需請(qǐng)考慮斷裂后的毛刺,及是否影響COB工序的Bonding機(jī)上的夾具穩(wěn)定工作,還應(yīng)考慮是否有無(wú)影響插件過(guò)軌道,及是否影響裝配組裝.
標(biāo)簽： PCB 阻抗匹配 計(jì)算工具 教程
上傳時(shí)間： 2013-10-15
上傳用戶(hù)：3294322651
軟件
標(biāo)簽： 傳動(dòng)
上傳時(shí)間： 2013-10-31
上傳用戶(hù)：liangliang123
中文版詳情瀏覽：http://www.elecfans.com/emb/fpga/20130715324029.html Xilinx UltraScale:The Next-Generation Architecture for Your Next-Generation Architecture The Xilinx® UltraScale™ architecture delivers unprecedented levels of integration and capability with ASIC-class system- level performance for the most demanding applications. The UltraScale architecture is the industr y's f irst application of leading-edge ASIC architectural enhancements in an All Programmable architecture that scales from 20 nm planar through 16 nm FinFET technologies and beyond, in addition to scaling from monolithic through 3D ICs. Through analytical co-optimization with the X ilinx V ivado® Design Suite, the UltraScale architecture provides massive routing capacity while intelligently resolving typical bottlenecks in ways never before possible. This design synergy achieves greater than 90% utilization with no performance degradation. Some of the UltraScale architecture breakthroughs include: • Strategic placement (virtually anywhere on the die) of ASIC-like system clocks, reducing clock skew by up to 50% • Latency-producing pipelining is virtually unnecessary in systems with massively parallel bus architecture, increasing system speed and capability • Potential timing-closure problems and interconnect bottlenecks are eliminated, even in systems requiring 90% or more resource utilization • 3D IC integration makes it possible to build larger devices one process generation ahead of the current industr y standard • Greatly increased system performance, including multi-gigabit serial transceivers, I/O, and memor y bandwidth is available within even smaller system power budgets • Greatly enhanced DSP and packet handling The Xilinx UltraScale architecture opens up whole new dimensions for designers of ultra-high-capacity solutions.
標(biāo)簽： UltraScale Xilinx 架構(gòu)
上傳時(shí)間： 2013-11-21
上傳用戶(hù)：wxqman
白皮書(shū)：采用低成本FPGA實(shí)現(xiàn)高效的低功耗PCIe接口 了解一個(gè)基于DDR3存儲(chǔ)器控制器的真實(shí)PCI Express® （PCIe®） Gen1x4參考設(shè)計(jì)演示高效的Cyclone V FPGA怎樣降低系統(tǒng)總成本，同時(shí)實(shí)現(xiàn)性能和功耗目標(biāo)。點(diǎn)擊馬上下載！
上傳時(shí)間： 2013-10-18
上傳用戶(hù)：康郎
電子發(fā)燒友網(wǎng)核心提示：Altera公司昨日宣布，在業(yè)界率先在28 nm FPGA器件上成功測(cè)試了復(fù)數(shù)高性能浮點(diǎn)數(shù)字信號(hào)處理（DSP）設(shè)計(jì)。獨(dú)立技術(shù)分析公司Berkeley設(shè)計(jì)技術(shù)有限公司（BDTI）驗(yàn)證了能夠在 Altera Stratix V和Arria V 28 nm FPGA開(kāi)發(fā)套件上簡(jiǎn)單方便的高效實(shí)現(xiàn)Altera浮點(diǎn)DSP設(shè)計(jì)流程，同時(shí)驗(yàn)證了要求較高的浮點(diǎn)DSP應(yīng)用的性能。本文是BDTI完整的FPGA浮點(diǎn)DSP分析報(bào)告。 Altera的浮點(diǎn)DSP設(shè)計(jì)流程經(jīng)過(guò)規(guī)劃，能夠快速適應(yīng)可參數(shù)賦值接口的設(shè)計(jì)更改，其工作環(huán)境包括來(lái)自MathWorks的MATLAB和 Simulink，以及Altera的DSP Builder高級(jí)模塊庫(kù)，支持FPGA設(shè)計(jì)人員比傳統(tǒng)HDL設(shè)計(jì)更迅速的實(shí)現(xiàn)并驗(yàn)證復(fù)數(shù)浮點(diǎn)算法。這一設(shè)計(jì)流程非常適合設(shè)計(jì)人員在應(yīng)用中采用高性能 DSP，這些應(yīng)用包括，雷達(dá)、無(wú)線(xiàn)基站、工業(yè)自動(dòng)化、儀表和醫(yī)療圖像等。
上傳時(shí)間： 2015-01-01
上傳用戶(hù)：sunshie
不少使用CAD的朋友在找CAD填充圖案，附件是小編收集的近千種cad填充圖案打包，供CAD學(xué)習(xí)和使用者參考，希望對(duì)大家能有所幫助。以下是cad填充圖案使用說(shuō)明。 CAD填充圖案使用說(shuō)明： 1、將填充名改成自己比較容易識(shí)別的名稱(chēng)，但要注意填充文件和填充名要完全一致（不用區(qū)分大小寫(xiě)）。 我收集的這些填充圖案有些是中文名稱(chēng)，很容易就知道填充圖案的類(lèi)型。有些是英文名，本來(lái)我想將這些英文名都改成中文名的填充。 我可以提供大家方法。先用記事本打開(kāi)其中一個(gè)填充文件，如下圖所示： 圖中打開(kāi)的填充名為b043,文件名也必須為043，否則CAD是不認(rèn)的。類(lèi)似上圖所示的填充，如果希望CAD的填充列表中直接顯示中文，方便查找，你就需要先用記事本將PAT文件打開(kāi)，復(fù)制“板巖”，選中b043,粘貼將其替換成“板巖”，關(guān)閉并保存文件。選中文件后單擊文件名進(jìn)入重命名轉(zhuǎn)臺(tái)，選中前面的B043,CTRl+V粘貼，將"B043.pat"修改成"板巖.pat"。 修改的最終效果類(lèi)似下圖所示的“六邊形蜂窩轉(zhuǎn)”填充。 2、不建議將所有收集的填充都一次性復(fù)制到CAD的填充目錄（patterns）下。 如果將大量填充都復(fù)制到CAD的填充目錄下，在填充時(shí)效率并不高，因?yàn)橐谏锨ХN填充中找出你要使用的填充，也不是一件簡(jiǎn)單的事情。因此我建議不要做加法，而是應(yīng)該做減法，將自己可能用到的填充保留，把根本不會(huì)用到的填充刪除。 對(duì)于這個(gè)壓縮包也是如此，當(dāng)需要使用其中某種填充時(shí)，你再將填充拷過(guò)去。 3、如何在這么多填充圖案中找到自己需要的填充圖案。 由于有些填充圖案用的是英文名，可以分別通過(guò)文件名和包含文字來(lái)搜索你要找的填充名來(lái)判斷在這些填充中是否有你需要的填充。如果找到的是一個(gè)英文名稱(chēng)的填充文件，你可以參照第一點(diǎn)中的方法進(jìn)行修改，方便使用。
上傳時(shí)間： 2013-11-02
上傳用戶(hù)：lhw888
中望CAD2010體驗(yàn)版正式發(fā)布。作為中望公司的最新年度力作，在繼承以往版本優(yōu)勢(shì)的基礎(chǔ)上，中望CAD2010融入了以“安全漏洞抓取、內(nèi)存池優(yōu)化、位圖和矢量圖混合處理”等多項(xiàng)可以極大提高軟件穩(wěn)定性和效率的中望正在申請(qǐng)全球?qū)＠莫?dú)創(chuàng)技術(shù)，新增了眾多實(shí)用的新功能，在整體性能上實(shí)現(xiàn)了巨大的飛躍，主要體現(xiàn)在以下幾方面： 大圖紙?zhí)幚砟芰Φ奶嵘? 文字所見(jiàn)即所得、消隱打印等新功能 二次開(kāi)發(fā)接口更加成熟 一、大圖紙?zhí)幚砟芰Φ奶嵘? 中望CAD2010版采用了更先進(jìn)的內(nèi)存管理以及壓縮技術(shù)，采用了一些新的優(yōu)化算法，使得中望CAD常用命令執(zhí)行效率和資源占用情況得到進(jìn)一步的提高，特別是在低內(nèi)存配置下大圖紙的處理能力，大大減少了圖紙內(nèi)存資源占用量，提升了大圖紙?zhí)幚硭俣?。主要體現(xiàn)在： 大圖紙內(nèi)存占用量顯著下降，平均下降約30%，地形圖類(lèi)圖紙則平均下降50%； 實(shí)體縮放和平移，zoom\pan\redraw更加順暢； 保存速度更快、數(shù)據(jù)更安全，保存速度平均有40%的提升。 二、新增功能 1、文字所見(jiàn)即所得 文字編輯器有多處改進(jìn)，文字編輯時(shí)顯示的樣式為最后在圖面上的樣式，達(dá)到了所見(jiàn)即所得的效果。文字編輯器新加入段落設(shè)置，可進(jìn)行制表位、縮進(jìn)、段落對(duì)齊方式、段落間距和段落行距等項(xiàng)目的調(diào)整。另外，在文字編輯器內(nèi)可直接改變文字傾斜、高度、寬度等特征。 2、消隱打印 中望CAD2010版本支持二維和三維對(duì)象的消隱打印，在打印對(duì)象時(shí)消除隱藏線(xiàn)，不考慮其在屏幕上的顯示方式。此次消隱打印功能主要體現(xiàn)在以下兩個(gè)方面： （一）、平臺(tái)相關(guān)命令和功能的調(diào)整 視口的“屬性”：增加“著色打印”選項(xiàng)（“線(xiàn)框”和“消隱”兩種著色打印項(xiàng)） 選擇視口后，右鍵菜單支持“著色打印”項(xiàng)（ “線(xiàn)框”和“隱藏”兩種模式） 命令mview增加了“著色打印”功能項(xiàng)，可以方便用戶(hù)設(shè)置視口的“著色打印屬性”（線(xiàn)框和消隱兩種模式） 打印”對(duì)話(huà)框調(diào)整：在布局空間，激活“打印”對(duì)話(huà)框，以前的“消隱打印”選項(xiàng)顯示為“隱藏圖紙空間對(duì)象”。 頁(yè)面設(shè)置管理器啟動(dòng)的“打印設(shè)置”對(duì)話(huà)框調(diào)整：圖紙空間中，通過(guò)頁(yè)面設(shè)置管理器激活的“打印設(shè)置”對(duì)話(huà)框，以前的“消隱打印”選項(xiàng)顯示為“隱藏圖紙空間對(duì)象” （二）、消隱打印使用方法的調(diào)整 模型空間： 可通過(guò)“打印”或“頁(yè)面設(shè)置管理器”打開(kāi)的“打印設(shè)置”對(duì)話(huà)框中的“消隱打印”選項(xiàng)來(lái)控制模型空間的對(duì)象是否消隱打印，同時(shí)包含消隱打印預(yù)覽，若勾選“消隱打印”按鈕，模型空間的對(duì)象將被消隱打印出來(lái)。 布局空間： 若要在布局空間消隱打印對(duì)象，分為兩種情況： 1) 布局空間視口外的對(duì)象是否消隱，直接取決于“打印設(shè)置”對(duì)話(huà)框中“隱藏圖紙空間對(duì)象”按鈕是否被勾選； ２）布局空間視口中的對(duì)象是否消隱，取決于視口本身的屬性，即“著色打印”特性選項(xiàng)，必須確保該選項(xiàng)為“消隱”才可消隱打印或預(yù)覽 3、圖層狀態(tài)管理器 可以創(chuàng)建多個(gè)命名圖層狀態(tài)，以保存圖層的狀態(tài)列表，用戶(hù)可以通過(guò)選擇圖層狀態(tài)來(lái)表現(xiàn)圖紙的不同顯示效果。這種圖層狀態(tài)可以輸出供其它圖紙使用，也可以輸入其它保存的圖層狀態(tài)設(shè)置。 4、文字定點(diǎn)縮放 能夠依據(jù)文字位置的特征點(diǎn)，如中心，左下等，作為基準(zhǔn)點(diǎn)，對(duì)多行文字或單行文字進(jìn)行縮放，同時(shí)不改變基準(zhǔn)點(diǎn)位置。 5、Splinedit新功能 全面支持樣條曲線(xiàn)的編輯，主要體現(xiàn)在SPLINEDIT命令行提示中，如下： 擬合數(shù)據(jù)(F)/閉合樣條(C)/移動(dòng)(M) 頂點(diǎn)(V)/精度(R)/反向(E)/撤消(U)/<退出(X)>: 擬合數(shù)據(jù)： 增加(A)/閉合(C)/刪除數(shù)據(jù)(D)/移動(dòng)(M)/清理(P)/切線(xiàn)(T)/<退出(X)>: 增加、刪除數(shù)據(jù)：通過(guò)增加、刪除樣條曲線(xiàn)的擬合點(diǎn)來(lái)控制樣條曲線(xiàn)的擬合程度。 移動(dòng)：通過(guò)移動(dòng)指定的擬合點(diǎn)控制樣條曲線(xiàn)的擬合數(shù)據(jù) 閉合/打開(kāi)：控制樣條曲線(xiàn)是否閉合。 清理：清除樣條曲線(xiàn)的擬合數(shù)據(jù)，從而使命令提示信息變?yōu)椴话瑪M合數(shù)據(jù)的情形。 切線(xiàn)：修改樣條曲線(xiàn)的起點(diǎn)和端點(diǎn)切向。 閉合樣條：將打開(kāi)的樣條曲線(xiàn)閉合。若選擇的樣條曲線(xiàn)為閉合的，該選項(xiàng)為“打開(kāi)”，將閉合的樣條曲線(xiàn)打開(kāi)。 移動(dòng)：可用來(lái)移動(dòng)樣條曲線(xiàn)的控制點(diǎn)到新的位置。 精度：可通過(guò)添加控制點(diǎn)、提高階數(shù)或權(quán)值的方式更為精密的控制樣條曲線(xiàn)的定義。 反向：調(diào)整樣條曲線(xiàn)的方向?yàn)榉聪颉? 6、捕捉和柵格功能增強(qiáng) 7、支持文件搜索路徑 關(guān)于激活注冊(cè)：打開(kāi)CAD界面，找到左上面的“幫助”，激活產(chǎn)品-復(fù)制申請(qǐng)碼-再打開(kāi)你解壓到CAD包找到keygen.exe（也就是注冊(cè)機(jī)，有的在是“Key”文件里，如果沒(méi)有可以到網(wǎng)上下載），輸入申請(qǐng)碼--點(diǎn)擊確定，就中間那個(gè)鍵--得到數(shù)據(jù) 應(yīng)該是五組-復(fù)制再回到上面激活碼頁(yè)面，粘貼激活碼確定就ok ！復(fù)制(粘貼)的時(shí)候用 ctrl +c（v），用鼠標(biāo)右鍵沒(méi)用！ 如果打開(kāi)安裝CAD就得注冊(cè)才能運(yùn)行的，那方法也跟上邊的差不多！ 其實(shí)你在網(wǎng)上一般是找不到激活碼的，因?yàn)楦鱾€(gè)申請(qǐng)碼不一樣，所以別人的激活碼到你那基本上沒(méi)用，只能用相應(yīng)的方法得到激活碼，這方法也就要你自己去試了，我原來(lái)也不會(huì)裝CAD，但現(xiàn)在一般3分鐘就裝好了，只要知道怎么說(shuō)了就快了，一般軟件都是一樣的裝法，不會(huì)裝可以到網(wǎng)上找資料！有時(shí)求人不如求已，自己算比在網(wǎng)上等著別人給你算快多了
標(biāo)簽： 2010 cad 簡(jiǎn)體中文
上傳時(shí)間： 2013-10-21
上傳用戶(hù)：tedo811
電子發(fā)燒友網(wǎng)核心提示：醫(yī)療內(nèi)窺鏡的市場(chǎng)發(fā)展帶來(lái)了各種挑戰(zhàn)，例如，要求增強(qiáng)功能，更高的精度，更好的處理性能，以及更小的體積等。本文介紹Altera高級(jí)醫(yī)療內(nèi)窺鏡系統(tǒng)解決方案，它使用了1080p視頻設(shè)計(jì)工作臺(tái)、DSP 構(gòu)建模塊、參考設(shè)計(jì)，以及 Stratix® V、Cyclone® V 和 Arria® V FPGA 等。通過(guò)下文介紹，資深專(zhuān)家向您支招，教你懂得如何通過(guò)采用基于FPGA的方法來(lái)縮短高級(jí)醫(yī)療內(nèi)窺鏡系統(tǒng)的開(kāi)發(fā)時(shí)間。 引言 對(duì)內(nèi)窺鏡檢查的需求在不斷增長(zhǎng)，同時(shí)還需要不斷改進(jìn)檢查過(guò)程，增強(qiáng)醫(yī)療設(shè)備的功能。全球競(jìng)爭(zhēng)不斷加劇，導(dǎo)致各種新功能的出現(xiàn)，新市場(chǎng)的變化也非?？?，開(kāi)發(fā)周期越來(lái)越短，工程團(tuán)隊(duì)必須集中精力提高核心競(jìng)爭(zhēng)力，加強(qiáng)系統(tǒng)知識(shí)。工程師需要靈活的硬件平臺(tái)和支持各種平臺(tái)的工作臺(tái)工具，使他們能夠針對(duì)新標(biāo)準(zhǔn)或者標(biāo)準(zhǔn)的變化而對(duì)產(chǎn)品進(jìn)行更新。此外，設(shè)計(jì)團(tuán)隊(duì)必須更高效的進(jìn)行開(kāi)發(fā)工作。Altera® 1080p 視頻設(shè)計(jì)工作臺(tái)和28-nm FPGA提供了靈活的系統(tǒng)方法來(lái)滿(mǎn)足當(dāng)前以及不斷發(fā)展的功能需求。 不斷增長(zhǎng)的全球需求 很多因素導(dǎo)致對(duì)內(nèi)窺鏡檢查的需求越來(lái)越強(qiáng)。今后數(shù)十年內(nèi)，世界60歲以上的人口數(shù)量將會(huì)大幅度增長(zhǎng)，對(duì)醫(yī)療衛(wèi)生服務(wù)的需求也會(huì)隨之增長(zhǎng)。而且，胃腸道患病人口在不斷增加，需要進(jìn)行檢查和治療。越來(lái)越多的醫(yī)生采用內(nèi)窺鏡檢查方法。很多政府報(bào)銷(xiāo)政策鼓勵(lì)非置入式治療，這有利于患者更快的恢復(fù)，從而降低了治療總成本，患者的體驗(yàn)會(huì)更好。 很多國(guó)家增加了在醫(yī)療基礎(chǔ)設(shè)施上的投入，特別是加大了醫(yī)療設(shè)備的采購(gòu)。反過(guò)來(lái)，這些新市場(chǎng)需求也擴(kuò)大了對(duì)下一代內(nèi)窺鏡系統(tǒng)的需求。設(shè)計(jì)團(tuán)隊(duì)體驗(yàn)到需求的不斷增長(zhǎng)，而全球競(jìng)爭(zhēng)導(dǎo)致他們推遲其產(chǎn)品發(fā)布計(jì)劃。
上傳時(shí)間： 2013-12-19
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