LED顯示屏自問世以來經(jīng)歷了飛速發(fā)展,如今已經(jīng)成為了平板顯示器的一個重要產(chǎn)品。LED顯示屏具有亮度高、功耗小、顏色鮮艷等特點,能完成實時性、多樣性、動態(tài)性的信息發(fā)布任務,勝任各種戶外公共場合。高效節(jié)能和保護環(huán)境已成為當今世界發(fā)展的重要議題。因此,為LED顯示屏提供高效節(jié)能的電源及其驅動技術,就成為了LED大屏幕顯示技術得到推廣普及的關鍵性問題。 本文設計了一種低功耗、小成本的LED顯示屏驅動電源,并在此基礎上研究了LED顯示屏的一種時序掃描算法。采用半橋式開關電源作為LED顯示屏驅動電源的基本拓撲,完成了EMI濾波器、主電路和控制驅動電路的設計工作:利用FPGA和VHDL語言設計了基于PWM技術的閉環(huán)反饋控制,實現(xiàn)了恒壓電源的基本要求;并在電源輸出整流側采用同步整流的設計方案,利用低導通阻抗的電力MOSFET,使整流損耗得到了大大降低。研究了LED顯示屏的基本掃描算法,介紹了LED顯示屏的一些基本常識和概念,利用FPGA和VHDL語言設計了一種簡易的LED顯示陣列。仿真和實驗研究表明該電路結構簡單、控制方便,掃描算法簡易可行,滿足了LED顯示屏時序掃描控制的基本要求。
上傳時間: 2013-06-23
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大功率照明LED(Light Emitting Diode)是新一代光源,它光轉換效率高,也稱作綠色光源。由于大功率照明LED本身的伏安特性,大功率LED的開關電源的研究從一開始就遇到了困難。而發(fā)展LED照明是現(xiàn)在節(jié)能環(huán)保的大趨勢,所以研究開發(fā)一種新型的大功率照明LED開關電源是很有必要的。 本文簡要介紹了大功率LED的發(fā)光特性、伏安特性及其驅動方案,并回顧了大功率LED開關電源的發(fā)展歷史,展望了未來趨勢。給出了大功率LED開關電源課題的背景,并分析了設計難點。在此基礎上,提出了一種新型兩級式方案,前級為PFC級,后級為DC/DC級。PFC級采用電感電流臨界連續(xù)模式的Boost變換器,DC/DC級采用準諧振模式的反激變換器。為了提高PFC級在低電壓輸入時的效率,采用了變電壓輸出的控制方案。 文中首先對采用臨界連續(xù)工作模式的功率因數(shù)校正級的工作原理和主電路參數(shù)進行推導與設計,以及對基于L6562的PFC控制電路的設計進行了詳細的研究。其次詳細介紹了準諧振模式的理論基礎和應用,對基于NCP1377B的反激變換器的工作原理和穩(wěn)態(tài)特性進行了詳細的分析;在此基礎上提出了一種高效低損耗的準諧振變換器的設計方案。論文詳細介紹了該方案的工作原理和特點,并分析了鉗位電路及基于TSM103的恒壓/恒流電路及線性穩(wěn)壓器在提出的兩級式方案中的應用。 結合上面提到的方案,本文研制了一臺全球輸入電壓范圍(90~265Vac),12V/5A輸出的大功率照明LED開關電源,實驗結果驗證了所提方案的可行性。
上傳時間: 2013-07-15
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32x16點陣LED顯示,匯編語言,可用于畢業(yè)設計的同學參考
上傳時間: 2013-04-24
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光二極管(LED)繼在中小尺寸屏幕的便攜產(chǎn)品背光等應用獲大量采用后,隨著它發(fā)光性能的進一步提升及成本的優(yōu)化,近年來已邁入通用照明領域,如建筑物照明、街道照明、景觀照明、標識牌、信號燈、以及住宅內的照明等,應用可謂方興未艾。
上傳時間: 2013-04-24
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LED顯示屏培訓資料,講述LED的工作原理,LED屏原理,組裝,工程應用等
上傳時間: 2013-07-28
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基于單片機的超聲波測距儀LED顯示電路的設計
上傳時間: 2013-07-01
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當今,移動通信正處于向第四代通信系統(tǒng)發(fā)展的階段,OFDM技術作為第四代數(shù)字移動通信(4G)系統(tǒng)的關鍵技術之一,被包括LTE在內的眾多準4G協(xié)議所采用。IDFT/DFT作為OFDM系統(tǒng)中的關鍵功能模塊,其精度對基帶解調性能產(chǎn)生著重大的影響,尤其對LTE上行所采用的SC_FDMA更是如此。為了使定點化IDFT/DFT達到較好的性能,本文采用數(shù)字自動增益控制(DAGC)技術,以解決過大輸入信號動態(tài)范圍所造成的IDFT/DFT輸出信噪比(SNR)惡化問題。 首先,本文簡單介紹了較為成熟的AAGC(模擬AGC)技術,并重點關注近年來為了改善其性能而興起的數(shù)字化AGC技術,它們主要用于壓縮ADC輸入動態(tài)范圍以防止其飽和。針對基帶處理中具有累加特性的定點化IDFT/DFT技術,進一步分析了AAGC技術和基帶DAGC在實施對象,實現(xiàn)方法等上的異同點,指出了基帶DAGC的必要性。 其次,根據(jù)LTE協(xié)議,搭建了從調制到解調的基帶PUSCH處理鏈路,并針對基于DFT的信道估計方法的缺點,使用簡單的兩點替換實現(xiàn)了優(yōu)化,通過高斯信道下的MATLAB仿真,證明其可以達到理想效果。仿真結果還表明,在不考慮同步問題的高斯信道下,本文所搭建的基帶處理鏈路,采用64QAM進行調制,也能達到在SNR高于17dB時,硬判譯碼結果為極低誤碼率(BER)的效果。 再次,在所搭建鏈路的基礎上,通過理論分析和MATLAB仿真,證明了包括時域和頻域DAGC在內的基帶DAGC具有穩(wěn)定接收鏈路解調性能的作用。同時,通過對幾種DAGC算法的比較后,得到的一套適用于實現(xiàn)的基帶DAGC算法,可以使IDFT/DFT的輸出SNR處于最佳范圍,從而滿足LTE系統(tǒng)基帶解調的要求。針對時域和頻域DAGC的差異,分別選定移位和加法,以及查表的方式進行基帶DAGC算法的實現(xiàn)。 最后,本文對選定的基帶DAGC算法進行了FPGA設計,仿真、綜合和上板結果說明,時域和頻域DAGC實現(xiàn)方法占用資源較少,容易進行集成,能夠達到的最高工作頻率較高,完全滿足基帶處理的速率要求,可以流水處理每一個IQ數(shù)據(jù),使之滿足基帶解調性能。
上傳時間: 2013-05-17
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電子萬年歷,LED顯示,包括算法以及C語言編寫的程序
上傳時間: 2013-04-24
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LED顯示屏是LED點陣模塊或者像素單元組成的平面顯示屏幕。自從誕生以來,以其亮度高、視角廣、壽命長、性價比高的特點,在交通、廣告、新聞發(fā)布、體育比賽、電子景觀等領域得到了廣泛應用。 LED顯示屏控制器作為控制LED屏顯示圖像、數(shù)據(jù)的關鍵,是整個LED視頻顯示系統(tǒng)的核心。本文研究的是對全彩色同步LED屏的控制,控制LED屏同步顯示在上位機顯示系統(tǒng)中某固定位置處的圖像。根據(jù)已有的LED顯示屏及其驅動器的特點,提出了一種可行的方案并進行了設計。系統(tǒng)主要分為兩個部分:視頻信號的獲取,視頻信號的處理。 經(jīng)過分析比較,決定從顯卡的DVI接口獲得視頻源,視頻源經(jīng)過DVI解碼芯片TFP401A的解碼后,可以獲得圖像的數(shù)字信息,這些信息包括紅、綠、藍三基色的數(shù)據(jù)以及行同步、場同步、使能等控制信號。這些信號將在視頻信號處理模塊中被使用。 信號處理模塊在接收視頻信號源后,對數(shù)據(jù)進行處理,最后輸出數(shù)據(jù)給驅動電路。在信號處理模塊中,采用了可編程邏輯器件FPGA來完成。可編程邏輯器件具有高集成度、高速度、高可靠性、在線可編程(ISP)等特點,所以特別適合于本設計。利用FPGA的可編程性,在FPGA內部劃分了各個小模塊,各小模塊中通過少量的信號進行聯(lián)系,這樣就將比較大的系統(tǒng)轉化成許多小的系統(tǒng),使得設計更加簡單,容易驗證。本文分析了驅動電路所需要的數(shù)據(jù)的特點,全彩色灰度級的實現(xiàn)方式,決定把系統(tǒng)劃分為視頻源截取、RGB格式轉化、位平面分離、讀SRAM地址發(fā)生器、寫SRAM地址發(fā)生器、讀寫SRAM選擇控制器、灰度實現(xiàn)等模塊。 最后利用示波器和SignalTap II邏輯分析儀等工具,對系統(tǒng)進行了聯(lián)合調試。改進了時序、優(yōu)化了布局布線,使得系統(tǒng)性能得到了良好的改善。 在分析了所需要的資源的基礎上,課題決定采用Altera的Cyclone EP1C12 FPGA設計視頻信號處理模塊,在Quartus II和modelsim平臺下,用Verilog HDL語言開發(fā)。
上傳時間: 2013-05-19
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同步技術在許多通訊系統(tǒng)中都是至關重要的,而WCDMA作為第三代移動通信的標準之一,對其同步算法進行研究是非常必要的。FPGA在許多硬件實現(xiàn)中充當了很重要的角色,所以研究如何在FPGA上實現(xiàn)同步算法是非常具有實際意義的。 本文討論了三步小區(qū)搜索的算法,仿真了其性能,并且對如何進行算法的FPGA移植展開了深入的討論。 本文對三步小區(qū)搜索的算法按照算法計算量和運算速度的標準分別進行了比較和討論,并以節(jié)省資源和運行穩(wěn)定為前提進行了FPGA移植。最終在主同步中提出了改進型的PSC匹配濾波器算法,在FPGA上提出了采用指針型雙口RAM的實現(xiàn)方式;在輔同步中提出了改進型PFHT算法并采用查表遍歷算法判決,在FPGA上提出了用綜合型邏輯方式來實現(xiàn);在導頻同步中采用了移位寄存器式擾碼生成算法,并引入了計分制判決算法。 與以往的WCDMA同步的FPGA實現(xiàn)相比,本文提出的實現(xiàn)方案巧妙地利用了FPGA的并行運算結構,在XILINX的V4芯片上只用了500個slice就完成了整個小區(qū)搜索,最大限度地節(jié)省了資源,為小區(qū)搜索在FPGA中的模塊小型化提供了途徑。
上傳時間: 2013-08-05
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