以Altera公司的Quartus Ⅱ 7.2作為開發工具,研究了基于FPGA的DDS IP核設計,并給出基于Signal Tap II嵌入式邏輯分析儀的仿真測試結果。將設計的DDS IP核封裝成為SOPC Builder自定義的組件,結合32位嵌入式CPU軟核Nios II,構成可編程片上系統(SOPC),利用極少的硬件資源實現了可重構信號源。該系統基本功能都在FPGA芯片內完成,利用 SOPC技術,在一片 FPGA 芯片上實現了整個信號源的硬件開發平臺,達到既簡化電路設計、又提高系統穩定性和可靠性的目的。
標簽: FPGA DDS IP核 設計方案
上傳時間: 2013-12-22
上傳用戶:forzalife
該文介紹了一種電離層垂測儀的設計方法,分析了發射信號的選擇要求,給出了實際電路模塊。系統利用FPGA的 IP核DDS產生正弦載波信號,經巴克碼調相后,通過DAC和功放產生發射信號;接收機采用射頻開關和直接ADC采樣技術采集回波信號,避免了模擬正交解調時相位不平衡產生的問題。通過外場實驗驗證,表明該設計是切實可行,具有較好的實用價值。
標簽: 相位編碼 電離層 垂測儀 系統設計
上傳時間: 2013-10-26
上傳用戶:tdyoung
控件特性:活動的RAS連接到INTERNET通知;斷開INTERNET連接通知;RAS撥入設備完整狀態信息及連接狀態;返回PC系統的當地IP地址和主機名;返回撥號連接的RASClient分配的INTERNET地址和主機名;返回撥號連接的RASServer ISP服務器地址和主機名;掛斷任何活動狀態的RAS連接的函數;操作簡單,容易與任何應用項目集成。有提示屏幕。
標簽: INTERNET RAS RASClient 連接
上傳時間: 2013-12-27
上傳用戶:hj_18
一個通用的矩陣綜合算法;能實現加、減、乘、轉置以及初始化設置功能(大小和初值)。
標簽: 矩陣 減 初始化 初值
上傳時間: 2014-02-18
上傳用戶:Thuan
用java編寫的一個基于GUI的算術四則運算(加、減、乘、除)的計算器。 1.綜合使用swing包的容器類和組件類設計一個合理的界面; 2.只能對整型數據進行處理; 3. 只能完成加、減、乘、除四項基本功能; 4.參照Windows附件中的計算器的外觀和功能
標簽: swing java GUI 減
上傳時間: 2014-01-03
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完成“快速拼寫檢查程序”的分析、設計和實現過程。 快速拼寫檢查程序基本功能說明如下: 1.進行拼寫檢查的文件以文本文件形式存儲于外存上; 2.只檢查文件中英文單詞的拼寫錯誤; 3.單詞是用字母(a…z或A…Z)定義,任一非字母字符作為分隔符; 4.判斷單詞拼寫正誤的依據是詞典,詞典以文本文件形式存放于外存上; 5.詞典文件第1行為詞典的名稱,以后每一行存放一個單詞; 6.輸出結果以文本文件形式存儲,其格式為: 第1行:被拼寫檢查的文件名 + 詞典名 第2行后的每一行: 出錯單詞 位于第x行 7.合理的GUI,注意GUI界面類與功能類的關系應比較松散。
標簽: 程序 分 中英文 存儲
上傳時間: 2014-01-09
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數字濾波算法; 中間位置算法 算術平均值算法
標簽: 算法 數字濾波 平均值 算術
上傳時間: 2014-12-07
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定時提醒(可設:提醒;提醒并關機;直接關機;定時執行一程序等。是家長們控制孩子玩電腦的好幫手。
標簽: 定時 關機 程序 家
上傳時間: 2013-12-20
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一款效果非常好的3D動畫;具體的做法可能要好好研究一下它的源碼;
標簽: 動畫 源碼
上傳時間: 2015-01-15
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用戶手冊03;IGK用戶手冊03
標簽: IGK 用戶手冊
上傳時間: 2015-01-16
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