JTAG CPLd實現源代碼，比用簡單并口調試器快5倍以上。 以前總覺得簡單的并口jtag板速度太慢，特別是調試bootloader的時候，簡直難以忍受。最近沒什么事情，于是補習了幾天vhdl，用CPLd實現了一個快速的jtag轉換板。CPLd用epm7128stc100-15，晶振20兆，tck頻率5兆。用sjf2410作測試，以前寫50k的文件用時5分鐘，現在則是50秒左右。tck的頻率還可以加倍，但是不太穩定，而且速度的瓶頸已經不在tck這里，而在通訊上面了。
標簽： JTAG CPLd 源代碼
上傳時間： 2015-05-16
上傳用戶：xsnjzljj
有關于VHDL舉例,FPGA/CPLd的運用方面的例子
標簽： VHDL FPGA CPLd 舉例
上傳用戶：lunshaomo
XilinxJTAG.rar xilinx CPLd,FPGA的JTAG口使用說明.
標簽： XilinxJTAG xilinx CPLd FPGA
上傳時間： 2014-01-20
上傳用戶：lindor
正交信號源的單片機和CPLd源碼，可以實現兩路正交信號的輸出
標簽： CPLd 正 信號源 單片機
上傳時間： 2015-05-21
上傳用戶：moerwang
一段CPLd的控制程序，可以進行傳并轉換，讀寫接口，每秒64k
標簽： CPLd 控制 程序
上傳時間： 2014-01-24
上傳用戶：wmwai1314
用復雜可編程邏輯器件(CPLd)實現的數字鐘控系統
標簽： CPLd 可編程邏輯器件 數字 鐘控
上傳時間： 2015-06-02
上傳用戶：xymbian
vhdl實現的直流電機控制器 通用程序 對不同fpga/CPLd，可能需要修改部分源代碼。
標簽： vhdl fpga CPLd 直流電機
上傳時間： 2013-11-29
上傳用戶：songnanhua
實現基于CPLd的CCD采集系統設計源碼
標簽： CPLd CCD 采集 系統設計
上傳時間： 2015-06-03
上傳用戶：gyq
CPLd數字電路設計硬件描述語言一例+一本經典教材，入門專用
標簽： CPLd 數字 教材 電路設計
上傳時間： 2014-01-08
上傳用戶：kiklkook
里面介紹了＂CPLd，FPGA軟件編程＂，里面許多許多例子，還有原代碼，我也是辛苦才收集到的資料，希望能給其他工程師派上用場．
標簽： CPLd
上傳時間： 2014-01-14
上傳用戶：王者A
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