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4排排針

  • TKScope硬件驅(qū)動(dòng)程序V3.4

    TKScope硬件驅(qū)動(dòng)程序V3.4 安裝程序

    標(biāo)簽: TKScope 3.4 硬件 驅(qū)動(dòng)程序

    上傳時(shí)間: 2013-11-04

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  • 邏輯分析儀軟件zlglogic 4.92

    邏輯分析儀軟件zlglogic 4.92 安裝程序

    標(biāo)簽: zlglogic 4.92 邏輯分析儀 軟件

    上傳時(shí)間: 2013-12-12

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  • PCB阻抗匹配計(jì)算工具(附教程)

    附件是一款PCB阻抗匹配計(jì)算工具,點(diǎn)擊CITS25.exe直接打開使用,無需安裝。附件還帶有PCB連板的一些計(jì)算方法,連板的排法和PCB聯(lián)板的設(shè)計(jì)驗(yàn)驗(yàn)。 PCB設(shè)計(jì)的經(jīng)驗(yàn)建議:       1.一般連板長(zhǎng)寬比率為1:1~2.5:1,同時(shí)注意For FuJi Machine:a.最大進(jìn)板尺寸為:450*350mm,       2.針對(duì)有金手指的部分,板邊處需作掏空處理,建議不作為連板的部位.     3.連板方向以同一方向?yàn)閮?yōu)先,考量對(duì)稱防呆,特殊情況另作處理.     4.連板掏空長(zhǎng)度超過板長(zhǎng)度的1/2時(shí),需加補(bǔ)強(qiáng)邊.       5.陰陽(yáng)板的設(shè)計(jì)需作特殊考量.       6.工藝邊需根據(jù)實(shí)際需要作設(shè)計(jì)調(diào)整,軌道邊一般不少於6mm,實(shí)際中需考量板邊零件的排布,軌道設(shè)備正??▔壕嚯x為不少於3mm,及符合實(shí)際要求下的連板經(jīng)濟(jì)性.       7.FIDUCIAL MARK或稱光學(xué)定位點(diǎn),一般設(shè)計(jì)在對(duì)角處,為2個(gè)或4個(gè),同時(shí)MARK點(diǎn)面需平整,無氧化,脫落現(xiàn)象;定位孔設(shè)計(jì)在板邊,為對(duì)稱設(shè)計(jì),一般為4個(gè),直徑為3mm,公差為±0.01inch.       8.V-cut深度需根據(jù)連板大小及基板板厚考量,角度建議為不少於45°.       9.連板設(shè)計(jì)的同時(shí),需基於基板的分板方式考量<人工(治具)還是使用分板設(shè)備>.  10.使用針孔(郵票孔)聯(lián)接:需請(qǐng)考慮斷裂后的毛刺,及是否影響COB工序的Bonding機(jī)上的夾具穩(wěn)定工作,還應(yīng)考慮是否有無影響插件過軌道,及是否影響裝配組裝. 

    標(biāo)簽: PCB 阻抗匹配 計(jì)算工具 教程

    上傳時(shí)間: 2013-10-15

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  • 超星閱讀器老鷹版4.0破解版

    超星閱讀器老鷹版4.0破解版

    標(biāo)簽: 4.0 超星閱讀器 破解版

    上傳時(shí)間: 2013-11-13

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  • 4-功放電路

    4-功放電路

    標(biāo)簽: 功放電路

    上傳時(shí)間: 2013-10-10

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  • 珀金斯發(fā)動(dòng)機(jī)4缸機(jī)圖冊(cè)

    珀金斯發(fā)動(dòng)機(jī)4缸機(jī)圖冊(cè)

    標(biāo)簽: 發(fā)動(dòng)機(jī)

    上傳時(shí)間: 2014-01-02

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  • 非常好用的西門子授權(quán)Step7V5.4,WinCCV6.2

    非常好用的西門子授權(quán)PLC300編程軟件的注機(jī)軟件,一個(gè)工程師傳出來的。步驟:安裝好Step7V5.4后安裝授權(quán):執(zhí)行Simatic_EKB_InstallSim_EKB_Install_2007_02 _02→Find Key→Select > (打√全部選中) →long key →選擇右下角√,然后要等 十來秒鐘才有一點(diǎn)反應(yīng),就授權(quán)成功了。我試驗(yàn)成功,跟大家分享一下。。。

    標(biāo)簽: WinCCV Step 5.4 6.2

    上傳時(shí)間: 2013-11-18

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  • 7.4 基于IP CORE的BLOCK RAM設(shè)計(jì)修改稿

    7.4 基于IP CORE的BLOCK RAM設(shè)計(jì)修改稿。

    標(biāo)簽: BLOCK CORE 7.4 RAM

    上傳時(shí)間: 2013-11-07

    上傳用戶:sammi

  • 1.4 FPGA的設(shè)計(jì)工具

    1.4 FPGA的設(shè)計(jì)工具。

    標(biāo)簽: FPGA 1.4 設(shè)計(jì)工具

    上傳時(shí)間: 2013-10-14

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  • 4.1 基于MODELSIM的功能仿真

    4.1 基于MODELSIM的功能仿真。

    標(biāo)簽: MODELSIM 4.1 功能仿真

    上傳時(shí)間: 2013-11-02

    上傳用戶:hakim

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