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<nav id="6qky2"></nav> 近年來，由于能源危機和環境污染，世界各國均在投巨資發展燃料電池汽車。雙向DC/DC變換器作為燃料電池汽車的中重要部件，需要隨著行駛狀態的改變，頻繁地切換其工作狀態，其動態性能好壞，直接決定汽車動力系統的響應速度。本文主要致力于對DC/DC變換器在不同控制策略下的動態性能進行研究，并在保證其穩態性能的前提下提高系統動態性能。 本文首先研究了線性控制策略下DC/DC變換器的動態性能。介紹了閉環控制系統在頻域和時域的動態性能指標以及二者之間的關系。當系統受到外部干擾較小時，采用頻域分析方法，對Buck和Boost變換器進行了小信號建模，并對其在不同線性補償網絡控制作用下的動態性能進行對比分析。當系統受到較大干擾時，采用時域分析方法，文中介紹了DC/DC變換器大信號建模方法，并對PID參數在工程上整定方法加以分析。 DC/DC變換器是一非線性系統，應用線性控制策略不可避免地存在一定局限性—動態性能和穩態性能之間的矛盾。針對這一問題，引入了模糊—PI控制，將其應用于DC/DC變換器，以在保持系統穩態性能不變的前提下，提高其動態性能。以Buck DC/DC變換器為例，詳細介紹了模糊-PI控制器的設計過程，并對設計的閉環控制系統用MATLAB進行建模與仿真。最后，通過實驗對比驗證了模糊—PI控制的有效性。 和線性控制策略相比，模糊—PI控制在一定程度上提高了系統的動態性能，但效果有限。本文引入了另一種非線性控制策略——滑模控制策略。滑模控制策略是目前動態性能最好的控制策略之一，可以極佳地發揮系統的硬件潛能。 本文首先介紹了滑模控制相關知識，推導了其應用于Buck和Boost變換器的理論基礎。設計出針對不同被控對象和工作狀態的控制策略，對每種控制策略通過仿真分析驗證其有效性。就滑模控制存在的靜差問題、抖振問題和變頻問題均提出了行之有效的解決方案。快速響應特性
上傳時間： 2013-08-01
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輕型高壓直流輸電系統在解決交流系統非同步互聯、向偏遠地區的無源負荷供電、滿足保護環境要求等方面具有很大的優勢。在傳統的基于兩電平或三電平電壓源型換流器的輕型高壓直流輸電系統中，換流器交流側需要使用體積龐大和笨重的濾波裝置，橋臂的高電壓需要功率開關器件直接串聯來實現等，增大了換流站的占地空間，降低了換流器的工作效率。 本文針對傳統輕型高壓直流輸電系統所存在的缺點，采用一種新的模塊化多電平換流器作為輕型高壓直流輸電系統的換流器。分析了模塊化多電平換流器的工作原理，并提出將其應用于輕型高壓直流輸電系統的調制算法和控制策略。最后對控制系統的具體實現方案進行一定的探討。通過仿真驗證所提出的調制算法和控制策略的正確性。具體說來，全文的主要工作體現在以下幾個方面： 1、詳細講述模塊化多電平換流器的拓撲結構、子模塊的具體實現形式及工作原理，并提出適合該換流器的調制算法。 2、詳細介紹組成輕型高壓直流輸電系統的電壓源型換流器的工作原理，分析電壓源型換流器的間接電流和直接電流控制策略。 3、對基于模塊化多電平換流器的輕型高壓直流輸電系統進行仿真，驗證所提出控制策略的正確性。 4、探討解決模塊化多電平換流器子模塊直流側電容電壓的均衡問題，提出一種較為簡單有效的控制方法。 5、提出基于模塊化多電平換流器結構的輕型高壓直流輸電控制系統的實現方法，并重點講述子模塊的數字邏輯電路的實現方法。
上傳時間： 2013-04-24
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異步電動機的軟起動研究，是一項重要的研究課題。本文以分級變頻理論為基礎，利用數學分析的方法對分級變頻的子頻率系統進行了深入的研究，總結了各級子頻率系統的電壓相序情況以及最優的觸發角度。并且對傳統異步電動機軟起動器的主電路結構進行了改進，提出了從較低頻率開始分五級起動的分級變頻調壓軟起動形式，而且各級子頻率的起動都能實現最優的正序電壓組合，保證了起動轉矩的最大化。通過對分級變頻調壓軟起動形式的建模和仿真試驗，證明了此方法可以在降低起動電流的同時實現異步電機的高轉矩起動，驗證了此方法的有效性和可行性。基于以上研究的成果，本文介紹了以TMS320LF2407ADSP芯片為核心的軟起動軟硬件設計方法。最后對本課題的進一步研究提出了展望。
上傳時間： 2013-04-24
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本文以異步電機參數離線自整定及參數在線辨識為對象，從理論分析，算法提出，仿真證明和實驗驗證四部分進行了深入研究。 異步電機參數離線自整定及參數在線辨識技術的研究，為異步電機控制性能的不斷提高提供了保障，以使更好，更精確的控制方式能夠應用到工程實際中去。 由于在工程中使用的電機和變頻器不一定能夠匹配，而需要在電機運行之前由專業的工程師對變頻器作重新設置，此過程復雜，耽誤時間而且需要專業人員操作。 本文提出一套異步電機參數離線自整定算法，使用C語言編程，并在一臺2.2KW電機的硬件實驗平臺上驗證了該算法，實現了電機在運行之前，變頻器自動測試出電機的基本參數，為矢量控制等控制方式提供所需要的電機參數。 電機在運行過程中，由于溫度等因素的影響，電機的參數會發生變化，影響電機運行的穩定性，所以要對電機參數做在線辨識。本文對異步電機參數在線辨識作了理論分析和方法總結，為下一步工作打下基礎。 算法的實現需要相應的硬件實驗平臺，本文對硬件實驗平臺作了詳細介紹，包括主電路的設計、IGBT的驅動保護電路設計、DSP數字控制器的設計。 本文還對文中提出的實驗方法作了MATLAB/Simulink仿真，驗證了該方法的可行性，對實驗有指導意義。
上傳時間： 2013-04-24
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隨著信息時代的到來，用戶對數據保護和傳輸可靠性的要求也在不斷提高。由于信道衰落，信號經信道傳輸后，到達接收端不可避免地會受到干擾而出現信號失真。因此需要采用差錯控制技術來檢測和糾正由信道失真引起的信息傳輸錯誤。RS（Reed—Solomon）碼是差錯控制領域中一類重要的線性分組碼，由于它編解碼結構相對固定，性能強，不但可以糾正隨機差錯，而且對突發錯誤的糾錯能力也很強，被廣泛應用在數字通信、數據存儲系統中，以滿足對數據傳輸通道可靠性的要求。因此設計一款高性能的RS編解碼器不但具有很大的應用意義，而且具有相當大的經濟價值。 本文首先介紹了線形分組碼及其子碼循環碼、BCH碼的基礎理論知識，重點介紹了BCH碼的重要分支RS碼的常用編解碼算法。由于其算法在有限域上進行，接著介紹了有限域的有關理論。基于RS碼傳統的單倍結構，本文提出了一種八倍并行編碼及九倍并行解碼方案，并用Verilog HDL語言實現。其中編碼器基于傳統的線性反饋移位寄存器除法電路并進行八倍并行擴展，譯碼器關鍵方程求解模塊基于修正的歐幾里德算法設計了一種便于硬件實現的脈動關鍵方程求解結構，其他模塊均采用九倍并行實現。由于進行了超前運算、流水線及并行處理，使編解碼的數據吞吐量大為提高，同時延時更小。 本論文設計了C++仿真平臺，并與HDL代碼結果進行了對比驗證。Verilog HDL代碼經過modelsim仿真驗證，并在ALTERA STRATIX3 EP3SL15OF1152C2 FPGA上進行綜合驗證以及靜態時序分析，綜合軟件為QUATURSⅡ V8．0。驗證及測試表明，本設計在滿足編解碼基本功能的基礎上，能夠實現數據的高吞吐量和低延時傳輸，達到性能指標要求。本論文在基于FPGA的RS（255，223）編解碼器的高速并行實現方面的研究成果，具有通用性、可移植性，有一定的理論及經濟價值。
上傳時間： 2013-04-24
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MP3音樂是目前最為流行的音樂格式，因其音質、復雜度與壓縮比的完美折中，占據著廣闊的市場，不僅在互聯網上廣為流傳，而且在便攜式設備領域深受人們喜愛。本文以MPEG-1的MP3音頻解碼器為研究對象，在實時性、面積等約束條件下，研究MP3解碼電路的設計方法，實現FPGA原型芯片，研究MP3原型芯片的驗證方法。 論文的主要貢獻如下： (1)使用算法融合方法合并MP3解碼過程的相關步驟，以減少緩沖區存儲單元的容量和訪存次數。如把重排序步驟融合到反量化模塊，可以減少一半的讀寫RAM操作；把IMDCT模塊內部的三個算法步驟融合在一起進行設計，可以省去存儲中間計算結果的緩存區單元。 (2)反量化、立體聲處理等模塊中，采用流水線設計技術，設置寄存器把較長的組合邏輯路徑隔開，提高了電路的性能和可靠性；使用連續訪問公共緩存技術，合理規劃各計算子模塊的工作時序，將數據計算的時間隱藏在訪存過程中；充分利用頻率線的零值區特性，有效地減少數據計算量，加快了數據處理的速度。 (3)設計了MP3硬件解碼器的FPGA原型芯片。采用Verilog HDL硬件描述語言設計RTL級電路，完成功能仿真，以Altera公司Stratix II系列的EP2S180 FPGA開發板為平臺，實現MP3解碼器的FPGA原型芯片。MP3硬件解碼器在Stratix II EP2S180器件內的資源利用率約為5％，其中組合邏輯查找表ALUT為7189個，寄存器共有4024個，系統頻率可達69.6MHz，充分滿足了MP3解碼過程的實時性要求。實驗結果表明，MP3音頻解碼FPGA原型芯片可正常播放聲音，解碼音質良好。
上傳時間： 2013-07-01
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LDPC碼以其接近Shannon極限的優異性能在編碼界引起了轟動，成為研究的熱點。隨著研究的不斷深入和技術的發展，目前，LDPC碼已經被多個通信系統定為信道編碼方案，并被應用到第二代數字視頻廣播衛星(DVB—S2)通信系統中。由于LDPC碼譯碼過程中所涉及的數據量龐大，譯碼時序控制復雜，如何實現LDPC碼譯碼器成為了人們研究的重點。 論文以基于FPGA實現LDPC碼譯碼器為研究目標，主要對譯碼算法選擇、譯碼數據量化、定點數據表示方式、譯碼算法關鍵運算單元的FPGA設計和譯碼的時序控制進行了深入研究。首先分析了LDPC碼的基本譯碼原理和常用譯碼算法。然后重點分析了BP算法、Log-BP算法、最小和算法和歸一化最小和算法，并對四種譯碼算法的糾錯性能和譯碼復雜度進行比較論證，選出適合硬件實現的譯碼方案。結合通信系統，對譯碼算法進行仿真分析，確定了譯碼算法的各個參數值和譯碼量化方案。 在系統仿真分析論證的基礎之上，以歸一化最小和譯碼算法為理論方案，利用硬件描述語言編寫譯碼功能模塊，并基于FPGA實現了固定譯碼長度的LDPC碼譯碼器，利用MATLAB和Modelsim分別對譯碼器進行了功能驗證和時序驗證，最后模擬通信系統完成了譯碼器的硬件測試。
上傳時間： 2013-04-24
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可靠通信要求消息從信源到信宿盡量無誤傳輸，這就要求通信系統具有很好的糾錯能力，如使用差錯控制編碼。自仙農定理提出以來，先后有許多糾錯編碼被相繼提出，例如漢明碼，BCH碼和RS碼等，而C。Berrou等人于1993年提出的Turbo碼以其優異的糾錯性能成為通信界的一個里程碑。 然而，Turbo碼迭代譯碼復雜度大，導致其譯碼延時大，故而在工程中的應用受到一定限制，而并行Turbo譯碼可以很好地解決上述問題。本論文的主要工作是通過硬件實現一種基于幀分裂和歸零處理的新型并行Turbo編譯碼算法。論文提出了一種基于多端口存儲器的并行子交織器解決方法，很好地解決了并行訪問存儲器沖突的問題。 本論文在現場可編程門陣列(FPGA)平臺上實現了一種基于幀分裂和籬笆圖歸零處理的并行Turbo編譯碼器。所實現的并行Turbo編譯碼器在時鐘頻率為33MHz，幀長為1024比特，并行子譯碼器數和最大迭代次數均為4時，可支持8.2Mbps的編譯碼數掘吞吐量，而譯碼時延小于124us。本文還使用EP2C35FPGA芯片設計了系統開發板。該開發板可提供高速以太網MAC／PHY和PCI接口，很好地滿足了通信系統需求。系統測試結果表明，本文所實現的并行Turbo編譯碼器及其開發板運行正確、有效且可靠。 本論文主要分為五章，第一章為緒論，介紹Turbo碼背景和硬件實現相關技術。第二章為基于幀分裂和歸零的并行Turbo編碼的設計與實現，分別介紹了編碼器和譯碼器的RTL設計，還提出了一種基于多端口存儲器的并行子交織器和解交織器設計。第三章討論了使用NIOS處理器的SOC架構，使用SOC架構處理系統和基于NIOSII處理器和uC／0S一2操作系統的架構。第四章介紹了FPGA系統開發板設計與調試的一些工作。最后一章為本文總結及其展望。
上傳時間： 2013-04-24
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回波消除器廣泛應用于公用電話交換網(PSTN)、移動通信系統和視頻電話會議系統等多種語音通信領域。在PSTN系統中，由于線路阻抗不匹配，遠端語音信號通過混合線圈時產生一定泄漏，一部分信號又傳回遠端，產生線路回波，回波的存在會嚴重影響語音通信質量。本文主要針對線路回波進行研究，設計并實現了滿足實用要求的基于FPGA平臺的回波消除器。 首先，對回波產生原理和目前幾種常用回波消除算法進行了分析，在研究自適應回波消除器的各個模塊，特別是深入分析各種自適應濾波算法和雙講檢測算法，綜合考慮各種算法的運算復雜度和性能的情況下，這里采用NLMS算法實現自適應回波消除器。針對傳統雙講檢測算法在近端語音幅度較低情況下容易產生誤判的情況，給出一種基于子帶濾波器組的改進雙講檢測算法。 本文首先使用C語言實現回波消除器的各個模塊，其中包括自適應濾波器、遠端檢測、雙講檢測、非線性處理和舒適噪聲產生模塊。經過仿真測試，相關模塊算法能夠有效提高回波消除器性能。在此基礎上，本文使用硬件描述語言Veillog HDL，在QuartusⅡ和ModelSim軟件平臺上實現各功能模塊，并通過模塊級和系統級功能仿真以及時序仿真驗證，最終在現場可編程門陣列(Field Programmable Gate Arrav，FPGA)平臺上實現回波消除系統。本文詳細闡述了基于FPGA的設計流程與設計方法，并描述了自適應濾波器、基于分布式算法FIR濾波器、除法器和有限狀態機的設計過程。 根據ITU-T G.168標準提出的測試要求，本文塒基于FPGA設計實現的自適應回波消除系統進行大量主客觀測試。經過測試，各項性能指標均達到或超過G.168標準的要求，具有良好的回波消除效果。
上傳時間： 2013-06-18
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·作 者： 三菱電機株式會社 I S B N： 7118019917 頁 數： 176 開 本： 大16開 封面形式： 簡裝本 出 版 社： 國防工業出版社 本社特價書 出版日期： 2001-7-1 定 價： 40元 變頻器原理與應用教程 內容簡介本書
上傳時間： 2013-08-01
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