高速FPGA的PCB設(shè)計(jì)指導(dǎo).WORD文檔格式
標(biāo)簽： FPGA WORD PCB 設(shè)計(jì)指導(dǎo)
上傳時(shí)間： 2013-08-13
上傳用戶：sdq_123
amcc PPC405EP taihu 開(kāi)發(fā)板 CPLD 源碼
標(biāo)簽： taihu amcc CPLD PPC
上傳用戶：invtnewer
CPLD與8051的總線接口VHDL源碼
標(biāo)簽： CPLD 8051 VHDL 總線接口
上傳時(shí)間： 2013-08-15
上傳用戶：yuchunhai1990
基于2410s和fpga的開(kāi)發(fā)板資料原理圖 和pcb圖
標(biāo)簽： 2410s fpga pcb 開(kāi)發(fā)板
上傳用戶：packlj
ACTEL的FPGA完整開(kāi)發(fā)文擋 含測(cè)試源碼
標(biāo)簽： ACTEL FPGA 測(cè)試 源碼
上傳時(shí)間： 2013-08-16
上傳用戶：kristycreasy
TMS3205402Verilog HDL源碼
標(biāo)簽： 3205402 Verilog TMS HDL
上傳時(shí)間： 2013-08-17
上傳用戶：shizhanincc
基于FPGA的交通燈的設(shè)計(jì) 有Verilog HDL 源碼、仿真圖與引腳配置圖，已下載實(shí)現(xiàn)\r\n
標(biāo)簽： Verilog FPGA HDL 交通燈
上傳時(shí)間： 2013-08-18
上傳用戶：BOBOniu
實(shí)現(xiàn)基于CPLD的CCD采集系統(tǒng)設(shè)計(jì)源碼
標(biāo)簽： CPLD CCD 采集 系統(tǒng)設(shè)計(jì)
上傳用戶：pkzz021
基于FPGA的多功能數(shù)字鐘的設(shè)計(jì)與實(shí)現(xiàn) 內(nèi)附有詳盡的Verilog HDL源碼，其功能主要有：時(shí)間設(shè)置，時(shí)間顯示，跑表，分頻，日期設(shè)置，日期顯示等
標(biāo)簽： Verilog FPGA HDL 多功能
上傳用戶：問(wèn)題問(wèn)題
s3c2410開(kāi)發(fā)板cpld源碼，希望有些參考價(jià)值
標(biāo)簽： s3c2410 cpld 開(kāi)發(fā)板 源碼
上傳時(shí)間： 2013-08-20
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