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速度測量系統(tǒng)(tǒng)

  • 基于DSP的高性能異步電機(jī)矢量控制系統(tǒng)設(shè)計(jì).pdf

    作為交流異步電機(jī)控制的一種方式,矢量控制技術(shù)已成為高性能變頻調(diào)速系統(tǒng)的首選方案。矢量控制系統(tǒng)中,磁鏈的觀測精度直接影響到系統(tǒng)控制性能的好壞。在轉(zhuǎn)子磁鏈定向的矢量控制系統(tǒng)中,轉(zhuǎn)矩電流和勵(lì)磁電流能得到完全解耦[1]。一般而言,轉(zhuǎn)子磁鏈觀測有兩種方法:電流模型法和電壓模型法。磁鏈的電流模型觀測法中需要電機(jī)轉(zhuǎn)子時(shí)間常數(shù),而轉(zhuǎn)子時(shí)間常數(shù)易受溫度和磁飽和影響。為克服這些缺點(diǎn),需要對電機(jī)的轉(zhuǎn)子參數(shù)進(jìn)行實(shí)時(shí)觀測,但這樣將使得系統(tǒng)更加的復(fù)雜。磁鏈的電壓模型觀測法中不含轉(zhuǎn)子參數(shù),受電機(jī)參數(shù)變化的影響較小。矢量控制計(jì)算量大,要求具有一定的實(shí)時(shí)性,從而對控制芯片的運(yùn)算速度提出了更高的要求。 本文介紹了一種異步電機(jī)矢量控制系統(tǒng)的設(shè)計(jì)方法,采用了電壓模型觀測器[2]對轉(zhuǎn)子磁鏈進(jìn)行估計(jì),針對積分環(huán)節(jié)的誤差積累和直流漂移問題,采用了一種帶飽和反饋環(huán)節(jié)的積分器[3]來代替電壓模型觀測器中的純積分環(huán)節(jié)。整個(gè)算法在tms320f2812 dsp芯片上實(shí)現(xiàn),運(yùn)算速度快,保證了系統(tǒng)具有很好的實(shí)時(shí)性。

    標(biāo)簽: DSP 性能 異步電機(jī)

    上傳時(shí)間: 2013-04-24

    上傳用戶:jhksyghr

  • 基于DSP和IRMCK201的雙CPU交流位置伺服系統(tǒng).pdf

    由于永磁伺服電機(jī)具有轉(zhuǎn)子轉(zhuǎn)動(dòng)慣量 小,響應(yīng)速度快,效率高,功率密度高,電機(jī)體積小,消除電刷而減少噪音和維護(hù)等其他電機(jī)難以比擬的優(yōu)點(diǎn),在高性能位置伺服領(lǐng)域,尤其為伺服電機(jī)組成的伺服系統(tǒng)應(yīng)用越來越廣泛。 永磁無刷電機(jī)有兩種形式:方波式和正弦波式。本文主要研究以pmsm 為伺服電機(jī)的伺服系統(tǒng) 目前實(shí)現(xiàn)永磁同步電動(dòng)機(jī)的控制主要采用dsp、dsp+fpga和dsp+asic三種途徑。而前兩種方式實(shí)現(xiàn)位置控制編程量較大,美國國際整流器公司針對高性能交流伺服驅(qū)動(dòng)要求,基于fpga技術(shù)開發(fā)出了完整的閉環(huán)電流控制和速度控制的伺服系統(tǒng)單片解決方案—irmck201。本文就是基于這種數(shù)字運(yùn)動(dòng)控制芯片,設(shè)計(jì)了dsp和irmck201的交流伺服控制系統(tǒng)。該系統(tǒng)具有性能優(yōu)越,結(jié)構(gòu)簡單,編程任務(wù)小,開發(fā)周期短等優(yōu)點(diǎn),對其他交流位置伺服控制系統(tǒng)也具有很好的推廣意義。

    標(biāo)簽: IRMCK DSP 201 CPU

    上傳時(shí)間: 2013-06-07

    上傳用戶:zgu489

  • 基于ARM和DSP的數(shù)控系統(tǒng)研究

    機(jī)械手是自動(dòng)裝配生產(chǎn)線上必不可少的設(shè)備,它可以模擬人手臂的部分動(dòng)作,按預(yù)定的程序、軌跡和要求,實(shí)現(xiàn)抓取、搬運(yùn)和裝配等工作。在減輕人的勞動(dòng)強(qiáng)度和提高裝配質(zhì)量和在惡劣環(huán)境下作業(yè)等方面,起到了積極的作用。嵌入式系統(tǒng)是近年來發(fā)展起來的以應(yīng)用為中心并且軟硬件可裁剪的實(shí)時(shí)系統(tǒng),它的特點(diǎn)是高度自動(dòng)化,響應(yīng)速度快等,非常適合于要求實(shí)時(shí)的和多任務(wù)的場合。 本文分析了機(jī)械手控制系統(tǒng)的功能要求,研究設(shè)計(jì)了一種基于ARM和DSP的機(jī)械手?jǐn)?shù)控系統(tǒng)的方案。嵌入式ARM處理器,具有運(yùn)行速度快、功耗低、程序設(shè)計(jì)靈活、外圍硬件資源豐富等優(yōu)點(diǎn),但其很難在處理大數(shù)據(jù)量、復(fù)雜算法時(shí)保證系統(tǒng)的靈活性和實(shí)時(shí)性。DSP作為數(shù)字信號處理的核心器件,能夠?qū)崟r(shí)快速的完成控制算法運(yùn)算,由于DSP普通輸入輸出口的高低電平變化周期最快只能到1微秒左右,不適合高速輸入輸出;FPGA芯片高速輸入輸出數(shù)據(jù),時(shí)間可縮短至幾十納秒。另外利用FPGA可以方便的實(shí)現(xiàn)各種接口的邏輯時(shí)序,豐富的接口使得該系統(tǒng)能夠方便的進(jìn)行移植,擴(kuò)展了該系統(tǒng)的應(yīng)用領(lǐng)域,從而提升了其性價(jià)比,通過ARM處理器和DSP以及FPGA技術(shù)的有機(jī)結(jié)合,發(fā)揮各自的優(yōu)勢,使系統(tǒng)具有程序設(shè)計(jì)靈活、以太網(wǎng)通信、大容量存儲(chǔ)、高速數(shù)據(jù)輸出、可移植等特點(diǎn),既滿足高速機(jī)械手自動(dòng)控制的要求,同時(shí)又具有一定的通用性。 通過本課題實(shí)踐表明,基于ARM和DSP構(gòu)建嵌入式數(shù)控系統(tǒng)的應(yīng)用方案全可行、合理,同傳統(tǒng)的人機(jī)交互系統(tǒng)設(shè)計(jì)相比,能大量地減輕研發(fā)任務(wù),提高發(fā)速度,能夠在短時(shí)間內(nèi)得到控制性能優(yōu)秀的數(shù)控系統(tǒng)。

    標(biāo)簽: ARM DSP 數(shù)控 系統(tǒng)研究

    上傳時(shí)間: 2013-06-11

    上傳用戶:康郎

  • CCSDS圖像壓縮和AES加密算法研究及其FPGA實(shí)現(xiàn)

    遙感圖像是深空探測和近地觀測所得數(shù)據(jù)的重要載體,在軍事和社會(huì)經(jīng)濟(jì)生活領(lǐng)域發(fā)揮著重要作用。由于遙感圖像數(shù)據(jù)量巨大,它的存儲(chǔ)和傳輸已成為遙感信息應(yīng)用中的關(guān)鍵問題。圖像壓縮編碼技術(shù)能降低圖像冗余度,從而減小圖像的存儲(chǔ)容量和傳輸帶寬,它的研究對于遙感圖像應(yīng)用具有重要的現(xiàn)實(shí)意義。CCSDS圖像壓縮算法是空間數(shù)據(jù)系統(tǒng)咨詢委員會(huì)(CCSDS)提出的圖像數(shù)據(jù)壓縮算法。該算法復(fù)雜度較低,并行性好,適合于硬件實(shí)現(xiàn),能實(shí)現(xiàn)對空間數(shù)據(jù)的實(shí)時(shí)處理,從而廣泛應(yīng)用于深空探測和近地觀測。對于直接關(guān)系到軍事戰(zhàn)略、經(jīng)濟(jì)建設(shè)等方面的遙感圖像的傳輸,必須對它進(jìn)行加密處理。AES加密算法是由美國國家標(biāo)準(zhǔn)和技術(shù)研究所(NIST)于2000年發(fā)布的數(shù)據(jù)加密標(biāo)準(zhǔn),它不但能抵抗各種攻擊,保證加密數(shù)據(jù)的安全性,而且易于軟件和硬件實(shí)現(xiàn)。本論文對CCSDS圖像壓縮算法和AES加密算法進(jìn)行了研究,完成的主要工作包括: (1)研究了CCSDS圖像壓縮算法的原理和結(jié)構(gòu),用C語言實(shí)現(xiàn)了算法的編解碼器,并與SPIHT算法和JPEG2000算法的性能進(jìn)行了比較。 (2)研究了AES加密算法的原理和結(jié)構(gòu),用C語言實(shí)現(xiàn)了算法的加解密器。 (3)介紹了實(shí)現(xiàn)CCSDS圖像壓縮算法和AES加密算法的FPGA設(shè)計(jì)所選擇的軟件開發(fā)工具、開發(fā)語言和硬件開發(fā)平臺(tái)。 (4)給出了CCSDS編碼器的FPGA實(shí)現(xiàn)方法和實(shí)現(xiàn)性能。 (5)給出了AES加密器的FPGA實(shí)現(xiàn)方法和實(shí)現(xiàn)性能。 本文設(shè)計(jì)的CCSDS圖像壓縮和AES加密FPGA系統(tǒng)運(yùn)用了流水線設(shè)計(jì)、高速內(nèi)存設(shè)計(jì)、模塊并行化設(shè)計(jì)和模塊串行化設(shè)計(jì)等技術(shù),在系統(tǒng)速度和資源面積上取得了較好的平衡,達(dá)到了預(yù)期的設(shè)計(jì)目的。

    標(biāo)簽: CCSDS FPGA AES 圖像壓縮

    上傳時(shí)間: 2013-07-15

    上傳用戶:dylutao

  • 39839電感量計(jì)算小巧實(shí)用的綠色軟件,根據(jù)輸入的線圈長度、線圈直徑、導(dǎo)線直徑、線圈匝數(shù)及工作頻率快速計(jì)算出電感量、自分布電容、空載Q值、自諧振頻率

    39839電感量計(jì)算小巧實(shí)用的綠色軟件,根據(jù)輸入的線圈長度、線圈直徑、導(dǎo)線直徑、線圈匝數(shù)及工作頻率快速計(jì)算出電感量、自分布電容、空載Q值、自諧振頻率

    標(biāo)簽: 39839 電感量 計(jì)算 線圈

    上傳時(shí)間: 2013-06-03

    上傳用戶:夜月十二橋

  • 基于ARM處理器的噴油泵試驗(yàn)臺(tái)控制系統(tǒng)研究與應(yīng)用

    噴油泵是柴油機(jī)燃油噴射系統(tǒng)中燃油的控制、供給單元,其性能的好壞直接決定著柴油機(jī)的加速性能、油耗大小、尾氣的排放質(zhì)量等。準(zhǔn)確測試噴油泵的各種技術(shù)參數(shù)對提高柴油機(jī)的各項(xiàng)技術(shù)性能具有十分重要的意義。嵌入式系統(tǒng)技術(shù)已經(jīng)成為了最熱門的技術(shù)之一。基于ARM的嵌入式技術(shù)己經(jīng)成為當(dāng)前嵌入式領(lǐng)域研究的一個(gè)亮點(diǎn)。ARM公司的32位RISC處理器,以其高速度、低功耗、低成本、功能強(qiáng)等諸多優(yōu)異性能,應(yīng)用越來越廣泛。uCLinux操作系統(tǒng)是從Linux衍生出來的一種操作系統(tǒng),它是專為無MMU的微控制器開發(fā)的嵌入式Linux操作系統(tǒng)。它支持眾多嵌入式處理器類型,具有完善的各類驅(qū)動(dòng)支持。 本文從噴油泵試驗(yàn)臺(tái)控制系統(tǒng)總體結(jié)構(gòu)入手,在詳細(xì)分析了系統(tǒng)所要檢測和控制的參數(shù)的基礎(chǔ)上,設(shè)計(jì)出噴油泵試驗(yàn)臺(tái)控制系統(tǒng)總體架構(gòu)。噴油泵試驗(yàn)臺(tái)控制系統(tǒng)由兩個(gè)模塊組成:以80C196KB單片機(jī)為中心的噴油泵控制及數(shù)據(jù)采集系統(tǒng),以S3C44BOX為中心的上位機(jī)監(jiān)控及管理系統(tǒng)。下位機(jī)通過RS232串口接收上位機(jī)的命令并執(zhí)行噴油泵試驗(yàn)臺(tái)的電機(jī)轉(zhuǎn)速控制、燃油溫度控制、噴油次數(shù)計(jì)數(shù)、提前角監(jiān)控及燃油壓力顯示。上位機(jī)是整個(gè)試驗(yàn)臺(tái)控制系統(tǒng)的管理者,主要完成給下位機(jī)發(fā)送特定的操作命令,完成實(shí)驗(yàn)數(shù)據(jù)的顯示、收集和存儲(chǔ),它有友好的中文顯示界面,可以完成簡單的數(shù)據(jù)管理操作。 文中詳細(xì)闡述了上位機(jī)的操作系統(tǒng)uCLinux的特點(diǎn)和移植過程。同樣對上位機(jī)的界面設(shè)計(jì)及運(yùn)行環(huán)境MiniGUI進(jìn)行了全面分析并給出移植和界面編程方法。在文章的最后,對噴油泵控制系統(tǒng)采用模糊控制算法進(jìn)行優(yōu)化設(shè)計(jì)。詳細(xì)描述了模糊控制器設(shè)計(jì)所包含的三個(gè)主要部分:清晰量的模糊化接口、模糊控制規(guī)則及算法及模糊量的清晰化接口。 通過試驗(yàn)證實(shí),本文設(shè)計(jì)的噴油泵試驗(yàn)臺(tái)控制系統(tǒng)技術(shù)路線正確合理。相信該可靠實(shí)用的控制系統(tǒng)配合噴油泵試驗(yàn)臺(tái)使用將具有良好的市場潛力。

    標(biāo)簽: ARM 處理器 噴油 試驗(yàn)臺(tái)

    上傳時(shí)間: 2013-06-04

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  • DVB信道編解碼算法研究與FPGA實(shí)現(xiàn)

    隨著人們對于數(shù)字視頻和數(shù)字圖像的需求越來越大,數(shù)字電視廣播和手機(jī)電視迅速發(fā)展起來,但是人們對于數(shù)字圖像質(zhì)量的要求也越來越高。對于觀眾來講,畫面的質(zhì)量幾乎是最為重要的,然而由于信道傳輸特性不理想和加性噪聲的影響,不可避免地會(huì)產(chǎn)生誤碼,導(dǎo)致圖像質(zhì)量的下降,甚至無法正常收看。因此,為了保障圖像質(zhì)量就需要采用糾錯(cuò)編碼(又稱信道編碼)的方式來實(shí)現(xiàn)通信。在數(shù)字視頻廣播系統(tǒng)(DVB)中,無論是衛(wèi)星傳輸,電纜傳輸還是地面?zhèn)鬏敹疾捎昧诵诺谰幋a。 本文首先深入研究DVB標(biāo)準(zhǔn)中的信道編碼部分的關(guān)鍵技術(shù);然后依照DVB-T標(biāo)準(zhǔn)技術(shù)要求,設(shè)計(jì)并硬件實(shí)現(xiàn)了數(shù)字視頻傳輸?shù)男诺谰幗獯a系統(tǒng)。在該系統(tǒng)中,編解碼器與信源端的接口利用了MPEG-2的視頻傳輸接口同步并行接口(SPI),這種接口的應(yīng)用讓系統(tǒng)具有很強(qiáng)的通用性;與信道端接口采用了G.703接口,具有G.703接口功能和特性的數(shù)據(jù)通信設(shè)備可以直接與數(shù)字通信設(shè)備連接,這使得應(yīng)用時(shí)對于信道的選擇具有較大的靈活性。 在深入理解RS編解碼算法,卷積交織/解交織原理,卷積編碼/VITERBI譯碼算法原理的基礎(chǔ)上,本文給出了解碼部分的設(shè)計(jì)方案,并利用Xilinx公司的SpartanⅢ系列XC3S2000芯片完成方案的硬件實(shí)現(xiàn)。在RS解碼過程中引入了流水線機(jī)制,從而很大程度上提高了解碼效率。解交織器部分采用了RAM分區(qū)循環(huán)法,利用對RAM讀寫地址的控制實(shí)現(xiàn)解卷積交織,這種方法控制電路簡單,實(shí)現(xiàn)速度比較快,代價(jià)小。VITERBI譯碼器采用截尾譯碼,在幾乎不影響譯碼準(zhǔn)確度的基礎(chǔ)上大大提高了解碼效率。

    標(biāo)簽: FPGA DVB 信道 編解碼

    上傳時(shí)間: 2013-07-16

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  • SK6281量產(chǎn)工具20080409版SK6281_PDT_20080409

    SK6281量產(chǎn)工具20080409版SK6281_PDT_20080409

    標(biāo)簽: 20080409 6281 SK PDT

    上傳時(shí)間: 2013-07-26

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  • 成功量產(chǎn)金士頓4G工具SK6281PDT20080123[1]

    成功量產(chǎn)金士頓4G工具SK6281PDT20080123[1]

    標(biāo)簽: 20080123 6281 PDT SK

    上傳時(shí)間: 2013-04-24

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  • H.264幀內(nèi)預(yù)測算法優(yōu)化及幾個(gè)重要模塊的FPGA實(shí)現(xiàn)

    H.264作為新一代視頻編碼標(biāo)準(zhǔn),相比上一代視頻編碼標(biāo)準(zhǔn)MPEG2,在相同畫質(zhì)下,平均節(jié)約64﹪的碼流。該標(biāo)準(zhǔn)僅設(shè)定了碼流的語法結(jié)構(gòu)和解碼器結(jié)構(gòu),實(shí)現(xiàn)靈活性極大,其規(guī)定了三個(gè)檔次,每個(gè)檔次支持一組特定的編碼功能,并支持一類特定的應(yīng)用,因此。H.264的編碼器的設(shè)計(jì)可以根據(jù)需求的不同而不同。 H.264雖然具有優(yōu)異的壓縮性能,但是其復(fù)雜度卻比一般編碼器高的多。本文對H.264進(jìn)行了編碼復(fù)雜度分析,并統(tǒng)計(jì)了整個(gè)軟件編碼中計(jì)算量的分布。H.264中采用了率失真優(yōu)化算法,提高了幀內(nèi)預(yù)測編碼的效率。在該算法下進(jìn)行幀內(nèi)預(yù)測時(shí),為了得到一個(gè)宏塊的預(yù)測模式,需要進(jìn)行592次率失真代價(jià)計(jì)算。因此為了降低幀內(nèi)預(yù)測模式選擇的計(jì)算復(fù)雜度,本文改進(jìn)了幀內(nèi)預(yù)測模式選擇算法。實(shí)踐證明,在PSNR值的損失可以忽略不計(jì)的情況下,該算法相比原算法,幀內(nèi)編碼時(shí)間平均節(jié)約60﹪以上,對編碼的實(shí)時(shí)性有較大幫助。 為了實(shí)現(xiàn)實(shí)時(shí)編碼,考慮到FPGA的高效運(yùn)算速度和使用靈活性,本文還研究了H.264編碼器基本檔次的FPGA實(shí)現(xiàn)。首先研究了H.264編碼器硬件實(shí)現(xiàn)架構(gòu),并對影響編碼速度,且具有硬件實(shí)現(xiàn)優(yōu)越性的幾個(gè)重要部分進(jìn)行了算法研究和FPGA.實(shí)現(xiàn)。本文主要研究了H.264編碼器中整數(shù)DCT變換、量化、Zig-Zag掃描、CAVLC編碼以及反量化、逆整數(shù)DCT變換等部分。分別對這些模塊進(jìn)行了綜合和時(shí)序仿真,并將驗(yàn)證后通過的系統(tǒng)模塊下載到Xilinx virtex-Ⅱ Pro的FPGA中,進(jìn)行了在線測試,驗(yàn)證了該系統(tǒng)對輸入的殘差數(shù)據(jù)實(shí)時(shí)壓縮編碼的功能。 本文對H.264編碼器幀內(nèi)預(yù)測模式選擇算法的改進(jìn),算法實(shí)現(xiàn)簡單,對軟件編碼的實(shí)時(shí)性有很大幫助。本文對在單片F(xiàn)PGA上實(shí)現(xiàn)H.264編碼器做出了探索性嘗試,這對H.264編碼器芯片的設(shè)計(jì)有著積極的借鑒性。

    標(biāo)簽: FPGA 264 幀內(nèi)預(yù)測 算法優(yōu)化

    上傳時(shí)間: 2013-05-25

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