本課題是江蘇省“十一五”工業攻關項目“總線化智能多參數高精度檢測及控制儀表開發與產業化(BE2006090)”。本項目要求多環境參數測控、多總線接口，選擇具有豐富接口的高速處理器作為本項目的核心。為滿足多參數測控精度和多網絡接口通訊可靠性，嵌入式設計是應用系統的理想選擇。本文所研究的多參數測控裝置是以三星公司生產的32位ARM微處理器S3C2410為核心的嵌入式系統，該系統能實時地獲取水環境參數，為水環境和多總線接口提供基本的數據和控制信息。 本文詳細地介紹了MODBUS和CAN-BUS總線協議和通訊原理，闡述了水產養殖幾個重要環境參數一溶解氧、溫度、PH值的檢測算法原理、以及傳感器調理電路和溫度、溶解氧的控制策略，進行了測控系統的硬件架構和各個模塊的原理設計，實現了操作系統的移植，編寫了驅動程序。在基于QT/E環境下實現了系統的測控和總線通訊部分上層軟件設計。提出并實施了系統測試方案，成功地完成了測控系統的硬件、軟件測試、以及通信功能測試和現場在線測試。 本論文的研究開發工作是在實踐的基礎上完成的，實驗結果證明該系統充分利用了S3C2410芯片提供的資源，具有高性能、低功耗、低成本的優點，在各個方面的性能比傳統的水環境參數測控系統有很大提高，通過測試實現了預期的各種功能，完全達到預期要求。
上傳時間： 2013-06-28
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按照公安部規定，我國從 2004 年開始換發第二代居民身份證，預計到 2008 年基本完成第二代居民身份證的換發工作。第二代身份證與第一代身份證最大的區別在于：它的內部嵌入了一枚指甲蓋大小的非接觸式 IC 芯片，該芯片內存儲有姓名、性別等9項信息。本課題設計出一款基于 ARM 和 GPRS 技術的第二代身份證無線手持閱讀器，該閱讀器能讀出第二代身份證內 IC 卡信息，并可通過 GPRS 網絡將信息進行無線傳輸。 本文以該閱讀器的設計為主線，論述的主要內容如下： 1．介紹了課題背景及意義。全國 9 億第二代身份證的換發，必然帶來各行業對閱讀器的大量需求，而現有閱讀器的弊端促使了對閱讀器做更深入的研究。 2．介紹了相關概念及技術，包括：無線射頻識別技術、ISO/IEC14443 協議、嵌入式系統、ARM、GPRS技術等。 3．詳細介紹了該閱讀器的硬件設計方法，并給出主要硬件模塊電路原理圖及其 PCB 板設計方法，同時也簡單介紹了硬件的焊接和調試過程。 4．詳細介紹了該閱讀器的軟件設計方法，包括：讀卡模塊驅動程序、GPRS 模塊驅動程序、人機對話模塊驅動程序、I/O 口驅動程序的流程圖和部分代碼。 5．為使該閱讀器安全可靠地運行，對閱讀器進行了各種功能測試，包括：讀卡功能、GPRS 數據傳輸功能、人機接口功能。 通過功能測試，該閱讀器能準確讀取第二代身份證內信息并通過GPRS 網絡成功將信息發送出去。該閱讀器與市面上現有的閱讀器相比，具有可脫機操作、無線傳輸、小巧靈便的優點。由于該閱讀器軟件采用模塊化的設計方法，可以方便移植到其他非接觸卡閱讀器中，因此本閱讀器具有非常廣泛的應用前景。
上傳時間： 2013-06-10
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通過駐極體話筒對音樂聲量進行采集后，把采集的信號進行放大整流濾波，并通過555構成的壓控振蕩器把音樂的聲量信號轉化成變化的振蕩頻率，即通過聲量的大小來產生相應頻率的振蕩信號，再經過二進制計數器對該振蕩輸出的脈沖進行計數輸出四種不同的狀態，通過二-四譯碼器對計數器輸出狀態進行譯碼產生相應的選通信號控制燈流接口電路 ，接口電路驅動一列信號指示燈,實現燈流速度隨音樂聲量大小而相應變化的效果。
上傳時間： 2013-04-24
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軟開關技術是電力電子裝置向高頻化、高功率密度化發展的關鍵技術，已成為現代電力電子技術研究的熱點之一。微處理器的出現促進了電力電子變換器的控制技術從傳統的模擬控制轉向數字控制，數字控制技術可使控制電路大為簡化，并能提高系統的抗干擾能力、控制靈活性、通用性以及智能化程度。本文提出了一種利用耦合輸出電感的新型次級箝位ZVZCS PWM DC/DC變換器，其反饋控制采用數字化方式。 論文分析了該新型變換器的工作原理，推導了變換器各種狀態時的參數計算方程；設計了以ARW芯片LPC2210為核心的數字化反饋控制系統，通過軟件設計實現了PWM移相控制信號的輸出；運用Pspice9.2軟件成功地對變換器進行了仿真，分析了各參數對變換器性能的影響，并得出了變換器的優化設計參數；最后研制出基于該新型拓撲和數字化控制策略的1千瓦移相控制零電壓零電流軟開關電源，給出了其主電路、控制電路、驅動電路、保護電路及高頻變壓器等的設計過程，并在實驗樣機上測量出了實際運行時的波形。 理論分析與實驗結果表明：該變換器拓撲能實現超前橋臂的零電壓開關，滯后橋臂的零電流開關；采用ARM微控制器進行數字控制，較傳統的純模擬控制實時反應速度更快、電源穩壓性能更好、外圍電路更簡單、設計更靈活等，為實現智能化數字電源創造了基礎，具有廣泛的應用前景和巨大的經濟價值。
上傳時間： 2013-08-03
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隨著嵌入式控制在工業領域的不斷滲入，進入21世紀之后，基于ARM體系Linux操作系統的嵌入式一體化工業控制系統成為了工業控制的主要發展方向，ARM芯片不僅體積小，功耗低，而且功能強；Linux由于其開源，穩定以及成本低的優點，在嵌入式系統中得到了廣泛的應用。 本文研究的主要內容是基于Linux操作系統ARM體系的嵌入式工控一體機設計與實現。該嵌入式工控一體機是基于Motorola公司研發的ARM9嵌入式系統和Linux操作系統的設備，整個系統體積小，結構精簡，并有很高的執行效率。它根據特定的工業控制對象定制特定的模型與控制算法。另外，該設備自身還具備各種數字PID控制算法，實現PID閉環控制。可以應用于工業控制領域中的各類被控設備，以及為高校自動化控制實驗和工業應用研究提供解決方案。它的軟件編程由Qt集成開發環境實現，Qt是基于C++的針對構造圖形用戶界面（程序）所使用的GUI工具包，它速度塊，易于使用，并具有很好的可移植性。 本文首先對嵌入式系統進行選型，然后提出了系統的軟硬件整體架構和系統的啟動流程。接著介紹了系統開發環境的搭建，包括啟動加載器的設計和實現，Linux內核的移植，設備驅動程序的編寫以及圖形用戶界面的實現。最后，詳細介紹了一個具有創新性的案例作為該嵌入式Linux工控一體機作為通訊和控制終端的典型應用。 該嵌入式Linux工控一體機具有極好的實用性和應用前景，并且其設計和實現過程對于其它嵌入式平臺也具有很好的參考價值。
上傳時間： 2013-07-27
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H.264/AVC是ITU與ISO/IEC(International Standard Organization/Intemational Electrotechnical Commission國際標準化組織/國際電工委員會)聯合推出的活動圖像編碼標準。作為最新的國際視頻編碼標準，H.264/AVC與MPEG-4、H.263等視頻編碼標準相比，性能有了很大提高，并已在流媒體、數字電視、電話會議、視頻存儲等諸多領域得到廣泛的應用。基于上下文的自適應二進制算術編碼(Conrext-based Adaptive Binary Arithmetic Coding，CABAC)是H.264/AVC的兩個熵編碼方案之一，相對于另一熵編碼方案-CAVLC(基于上下文的自適應可變長編碼)，CABAC具有更高的數據壓縮率：在同等編碼質量下要比CAVLC提高10％～15％的壓縮率。CABAC能實現很高的數據壓縮率，但這是以增加實現的復雜性為代價的。在已有的硬件實現方法上，CABAC的解碼效率并不高。 論文在深入研究CABAC解碼算法及其實現流程，并在仔細分析了H.264/AVC碼流結構的基礎上，總結出了影響CABAC解碼效率的各個環節，并以此為出發點，對CABAC解碼所需中的各個功能模塊進行了優化設計，設計出一種新的CABAC解碼器結構，相對于一般的CABAC解碼器，它的解碼效率得到了顯著提高。論文針對影響CABAC解碼過程的"瓶頸"問題一多次訪問存儲部件影響解碼速率，提出了新的存儲組織方式，并根據CABAC的碼流結構特性，采用4個子解碼器級聯的方式來進一步提高解碼速率。 最后，用Verilog語言對所設計的CABAC解碼器進行了描述，用EDA軟件對其進行了仿真，并在FPGA上驗證了其功能，結果顯示，該CABAC解碼器結構顯著提高了解碼效率，能夠滿足高檔次實時通訊的要求。
上傳時間： 2013-07-03
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糾錯碼技術是一種通過增加一定冗余信息來提高信息傳輸可靠性的有效方法。RS碼是一種典型的糾錯碼，在線性分組碼中，它具有最強的糾錯能力，既能糾正隨機錯誤，也能糾正突發錯誤，在深空通信、移動通信、磁盤陣列、光存儲及數字視頻廣播(DVB)等系統中具有廣泛的應用。 DVD是一種高容量的存儲媒質。DVD技術的應用很廣泛，在數字技術中占有重要地位。DVD系統中采用里德-所羅門乘積碼(RS-PC：Reed-Solomon ProductCode)進行糾錯，RS碼譯碼器在伺服芯片中具有重要作用。 FPGA在開發階段具有安全、方便、可隨時修改設計等不可替代的優點，在電子系統中采用FPGA可以極大的提升硬件系統設計的靈活性，可靠性，同時提高硬件開發的速度和降低系統的成本。FPGA的固有優點使其得到越來越廣泛的應用，FPGA設計技術也被越來越多的設計人員所掌握。 本文首先介紹了編碼理論和常用的RS編譯碼算法，提出RS編碼器實現方案，詳細分析了譯碼器的ME算法和改進BM算法的實現，針對ME算法提出了一種流水線結構的糾刪糾錯RS譯碼器實現方案，在譯碼器復雜度和延時上作了折衷，降低了譯碼器的復雜度并提高了最高工作頻率，利用有限域乘法器的特性對編譯碼電路進行優化。這些技術的采用大大的提高了RS編譯碼器的效率，節省了RS編譯碼器占用的資源。在Xilinx公司的Virtex-II系列FPGA上設計并成功實現了RS(208，192)編譯碼器。
上傳時間： 2013-07-20
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文章開篇提出了開發背景。認為現在所廣泛應用的開關電源都是基于傳統的分立元件組成的。它的特點是頻率范圍窄、電力小、功能少、器件多、成本較高、精度低，對不同的客戶要求來“量身定做”不同的產品，同時幾乎沒有通用性和可移植性。在電子技術飛速發展的今天，這種傳統的模擬開關電源已經很難跟上時代的發展步伐。 隨著DSP、ASIC等電子器件的小型化、高速化，開關電源的控制部分正在向數字化方向發展。由于數字化，使開關電源的控制部分的智能化、零件的共通化、電源的動作狀態的遠距離監測成為了可能，同時由于它的智能化、零件的共通化使得它能夠靈活地應對不同客戶的需求，這就降低了開發周期和成本。依靠現代數字化控制和數字信號處理新技術，數字化開關電源有著廣闊的發展空間。 在數字化領域的今天，最后一個沒有數字化的堡壘就是電源領域。近年來，數字電源的研究勢頭與日俱增，成果也越來越多。雖然目前中國制造的開關電源占了世界市場的80％以上，但都是傳統的比較低端的模擬電源。高端市場上幾乎沒有我們份額。 本論文研究的主要內容是在傳統開關電源模擬調節器的基礎上，提出了一種新的數字化調節器方案，即基于DSP和FPGA的數字化PID調節器。論文對系統方案和電路進行了較為具體的設計，并通過測試取得了預期結果。測試證明該方案能夠適合本行業時代發展的步伐，使系統電路更簡單，精度更高，通用性更強。同時該方案也可用于相關領域。 本文首先分析了國內外開關電源發展的現狀，以及研究數字化開關電源的意義。然后提出了數字化開關電源的總體設計框圖和實現方案，并與傳統的開關電源做了較為詳細的比較。本論文的設計方案是采用DSP技術和FPGA技術來做數字化PID調節，通過數字化PID算法產生PWM波來控制斬波器，控制主回路。從而取代傳統的模擬PID調節器，使電路更簡單，精度更高，通用性更強。傳統的模擬開關電源是將電流電壓反饋信號做PID調節后--分立元器件構成，采用專用脈寬調制芯片實現PWM控制。電流反饋信號來自主回路的電流取樣，電壓反饋信號來自主回路的電壓采樣。再將這兩個信號分別送至電流調節器和電壓調節器的反相輸入端，用來實現閉環控制。同時用來保證系統的穩定性及實現系統的過流過壓保護、電流和電壓值的顯示。電壓、電流的給定信號則由單片機或電位器提供。再次，文章對各個模塊從理論和實際的上都做了仔細的分析和設計，并給出了具體的電路圖，同時寫出了軟件流程圖以及設計中應該注意的地方。整個系統由DSP板和ADC板組成。DSP板完成PWM生成、PID運算、環境開關量檢測、環境開關量生成以及本地控制。ADC板主要完成前饋電壓信號采集、負載電壓信號采集、負載電流信號采集、以及對信號的一階數字低通濾波。由于整個系統是閉環控制系統，要求采樣速率相當高。本系統采用FPGA來控制ADC，這樣就避免了高速采樣占用系統資源的問題，減輕了DSP的負擔。DSP可以將讀到的ADC信號做PID調節，從而產生PWM波來控制逆變橋的開關速率，從而達到閉環控制的目的。 最后，對數字化開關電源和模擬開關電源做了對比測試，得出了預期結論。同時也提出了一些需要改進的地方，認為該方案在其他相關行業中可以廣泛地應用。模擬控制電路因為使用許多零件而需要很大空間，這些零件的參數值還會隨著使用時間、溫度和其它環境條件的改變而變動并對系統穩定性和響應能力造成負面影響。數字電源則剛好相反，同時數字控制還能讓硬件頻繁重復使用、加快上市時間以及減少開發成本與風險。在當前對產品要求體積小、智能化、共通化、精度高和穩定度好等前提條件下，數字化開關電源有著廣闊的發展空間。本系統來基本上達到了設計要求。能夠滿足較高精度的設計要求。但對于高精度數字化電源，系統還有值得改進的地方，比如改進主控器，提高參考電壓的精度，提高采樣器件的精度等，都可以提高系統的精度。 本系統涉及電子、通信和測控等技術領域，將數字PID算法與電力電子技術、通信技術等有機地結合了起來。本系統的設計方案不僅可以用在電源控制器上，只要是相關的領域都可以采用。
上傳時間： 2013-06-21
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偏移正交相移鍵控(OQPSK：Offset Quadrature Phase Shift Keying)調制技術是一種恒包絡調制技術，具有頻譜利用率高、頻譜特性好等特點，廣泛應用于衛星通信和移動通信領域。 論文以某型偵收設備中OQPSK解調器的全數字化為研究背景，設計并實現了基于FPGA的全數字OQPSK調制解調器，其中調制器主要用于仿真未知信號，作為測試信號源。論文研究了全數字OQPSK調制解調的基本算法，包括成形濾波器、NCO模型、載波恢復、定時恢復等；完成了整個調制解調算法的MATLAB仿真。在此基礎上，采用VHDL硬件描述語言在Xilinx公司ISE7.1開發環境下設計并實現了各個算法模塊，并在硬件平臺上加以實現。通過實際現場測試，實現了對所偵收信號的正確解調。論文還實現了解調器的百兆以太網接口，使得系統可以方便地將解調數據發送給計算機進行后續處理。
上傳時間： 2013-05-19
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本文以Turbo碼編譯碼器的FPGA實現為目標，對Turbo碼的編譯碼算法和用硬件語言將其實現進行了深入的研究。 首先，在理論上對Turbo碼的編譯碼原理進行了介紹，確定了Max-log-MAF算法的譯碼算法，結合CCSDS標準，在實現編碼器時，針對標準中給定的幀長、碼率與交織算法，以及偽隨機序列模塊與幀同步模塊，提出了相應解決方案；而在相應的譯碼器設計中，采用了FPGA設計中“自上而下”的設計方法，權衡硬件實現復雜度與處理時延等因素，優先考慮面積因素，提高元件的重復利用率和降低電路復雜度，來實現Turbo碼的Max-log-MAP算法譯碼。把整個系統分割成不同的功能模塊，分別闡述了實現過程。 然后，基于Verilog HDL 設計出12位固點數據的Turbo編譯碼器以及仿真驗證平臺，與用Matlab語言設計的相同指標的浮點數據譯碼器進行性能比較，得到該設計的功能驗證。 最后，研究了Tuxbo碼譯碼器幾項最新技術，如滑動窗譯碼，歸一化處理，停止迭代技術結合流水線電路設計，將改進后的譯碼器與先前設計的譯碼器分別在ISE開發環境中針對目標器件xilinx Virtex-Ⅱ500進行電路綜合，證實了這些改進技術能有效地提高譯碼器的吞吐量，減少譯碼時延和存儲器面積從而降低功耗。
上傳時間： 2013-04-24
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