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競(jìng)爭(zhēng)冒險(xiǎn)(xiǎn)

  • 可編程邏輯器件是一種可以通過編程

    可編程邏輯器件是一種可以通過編程，改變系統(tǒng)連線，達(dá)到系統(tǒng)重構(gòu)的器件，該器件\\\\\\\\r\\\\\\\\n可以現(xiàn)場編程，就是說當(dāng)該器件安裝到電路板上后，可以對它的功能進(jìn)行重新設(shè)置，這樣\\\\\\\\r\\\\\\\\n就可以非常方便的進(jìn)行數(shù)字系統(tǒng)的設(shè)計(jì)與制作

    標(biāo)簽： 可編程邏輯器件 編程

    上傳時(shí)間： 2013-08-10

    上傳用戶：stella2015

  • fpga open door,最最基礎(chǔ)的入門介紹

    fpga open door,最最基礎(chǔ)的入門介紹，針對首次接觸此類的新手\r\n

    標(biāo)簽： fpga door open

    上傳時(shí)間： 2013-08-10

    上傳用戶：daijun20803

  • proteus得一些經(jīng)典例子

    這是proteus得一些經(jīng)典例子\r\n供大家學(xué)習(xí)參考

    標(biāo)簽： proteus

    上傳時(shí)間： 2013-08-10

    上傳用戶：chens000

  • 利用FPGA驅(qū)動LED顯示

    FPGA驅(qū)動LED顯示:運(yùn)用硬件描述語言（如VHDL）設(shè)計(jì)一個(gè)顯示譯碼驅(qū)動器，即將要顯示的字符譯成8段碼。由于FPGA有相當(dāng)多的引腳端資源，如果顯示的位數(shù)N較少，可以直接使用靜態(tài)顯示方式，即將每一個(gè)數(shù)碼管都分別連接到不同的8個(gè)引腳線上，共需要8×N條引腳線控制.

    標(biāo)簽： FPGA LED 驅(qū)動

    上傳時(shí)間： 2013-08-10

    上傳用戶：Amygdala

  • proteus寫的實(shí)驗(yàn)程序例子集合4

    為優(yōu)秀的單片機(jī)仿真軟件proteus寫的實(shí)驗(yàn)程序例子\r\n不但可以仿真mcu,外圍器件也可以仿真\r\n跑馬燈的實(shí)驗(yàn)\r\n

    標(biāo)簽： proteus 實(shí)驗(yàn) 程序

    上傳時(shí)間： 2013-08-10

    上傳用戶：1427796291

  • fpga 配置方式

    fpga 配置方式\\r\\n轉(zhuǎn)載的大家看看吧還可以的

    標(biāo)簽： fpga 方式

    上傳時(shí)間： 2013-08-10

    上傳用戶：asdfasdfd

  • 以CPLD 芯片進(jìn)行十字路口的交通燈的設(shè)計(jì)

    摘要：本文主要介紹以CPLD 芯片進(jìn)行十字路口的交通燈的設(shè)計(jì)，用CPLD 作為交通燈控制器的主控芯片，采用VHDL\r\n語言編寫控制程序，利用CPLD的可重復(fù)編程和在動態(tài)系統(tǒng)重構(gòu)的特性，大大地提高了數(shù)字系統(tǒng)設(shè)計(jì)的靈活性和通用性。\r\n關(guān)鍵詞：CPLD；VHDL；交通燈控制器\r\n中圖分類號：TP39\r\nAbstract ：This paper introduces the electronic-traffic lamp, which is based on the VHDL and is com

    標(biāo)簽： CPLD 芯片 十字路口 交通燈

    上傳時(shí)間： 2013-08-11

    上傳用戶：aesuser

  • 基于FPGA的運(yùn)動目標(biāo)檢測系統(tǒng)的研究與開發(fā)

    基于 FPGA 的運(yùn)動目標(biāo)檢測系統(tǒng)的研究與開發(fā) \\r\\n希望有哪位朋友需要

    標(biāo)簽： FPGA 運(yùn)動目標(biāo) 檢測系統(tǒng)

    上傳時(shí)間： 2013-08-11

    上傳用戶：924484786

  • 對硅微諧振式加速度計(jì)的數(shù)據(jù)采集電路開展研究工作

    項(xiàng)目的研究內(nèi)容是對硅微諧振式加速度計(jì)的數(shù)據(jù)采集電路開展研究工作。硅微諧振式加速度計(jì)敏感結(jié)構(gòu)輸出的是兩路差分的頻率信號，因此硅微諧振式加速度計(jì)數(shù)據(jù)采集電路完成的主要任務(wù)是測出兩路頻率信號的差值。測量要求是：實(shí)現(xiàn)10ms內(nèi)對中心諧振頻率為20kHz、標(biāo)度因數(shù)為100Hz/g、量程為±50g、分辨率為1mg的硅微諧振式加速度計(jì)輸出的頻率信號的測量，等效測量誤差為±1mg。電路的控制核心為單片機(jī)，具有串行接口以便將測量結(jié)果傳送給PC機(jī)從而分析、保存測量結(jié)果。\\r\\n按研究內(nèi)容設(shè)計(jì)了軟硬件。軟件采用多周期同步法

    標(biāo)簽： 硅微 加速度計(jì) 數(shù)據(jù)采集電路 諧振式

    上傳時(shí)間： 2013-08-11

    上傳用戶：csgcd001

  • 采用FPGA實(shí)現(xiàn)π/4 DQPSK調(diào)制器

    采用FPGA 實(shí)現(xiàn)π/ 4 DQPSK調(diào)制器--\r\n北　方　交　通　大　學(xué)　學(xué)　報(bào)

    標(biāo)簽： DQPSK FPGA 調(diào)制器

    上傳時(shí)間： 2013-08-11

    上傳用戶：stampede

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