在MATLAB中實(shí)現(xiàn)硬件FPGA
標(biāo)簽： MATLAB FPGA 硬件
上傳時間： 2013-08-14
上傳用戶：15736969615
]本文介紹了如何利用CPLD(復(fù)雜可編程邏輯器件)與單片機(jī)的結(jié)合實(shí)現(xiàn)并行I／\r\nO(輸入／輸出)接口的擴(kuò)展。該設(shè)計(jì)與用8255做并行I／O接口相比，與單片機(jī)軟件完全兼容，\r\n同時擁有速度快，功耗低，價(jià)格便宜，使用靈活等特點(diǎn)
標(biāo)簽： CPLD 如何利用 單片機(jī) 并行
上傳用戶：xa_lgy
XilinxFPGA器件的底層硬件設(shè)計(jì)技巧
標(biāo)簽： XilinxFPGA 器件 底層 硬件
上傳用戶：daijun20803
新手如何學(xué)習(xí)FPGA外圍硬件電路設(shè)計(jì)，這個文件很有用
標(biāo)簽： FPGA 硬件電路設(shè)計(jì)
上傳用戶：zjwangyichao
:針對現(xiàn)場可編程門陣列(FPGA)芯片的特點(diǎn),研究FPGA中雙向端口I/O的設(shè)計(jì),同時給出仿真初始化雙向端口I/O的方法。采用這種雙向端口的設(shè)計(jì)方法,選用Xilinx的Spartan2E芯片設(shè)計(jì)一個多通道圖像信號處理系統(tǒng)。
標(biāo)簽： FPGA 雙向端口
上傳時間： 2013-08-17
上傳用戶：xiaoyunyun
有關(guān)verilog的硬件實(shí)現(xiàn)VGA設(shè)計(jì)的代碼。
標(biāo)簽： verilog VGA 硬件實(shí)現(xiàn) 代碼
上傳時間： 2013-08-18
上傳用戶：ghostparker
cpld ep240硬件開發(fā)圖紙文檔,為CPLD開發(fā)提供平臺
標(biāo)簽： cpld 240 ep 硬件開發(fā)
上傳時間： 2013-08-19
上傳用戶：yeluorag
一個關(guān)于4CAN卡的硬件程序,用VHDL編寫.就是4路CAN總線
標(biāo)簽： VHDL CAN 硬件 程序
上傳時間： 2013-08-20
上傳用戶：jiiszha
對CPLD學(xué)習(xí)者有幫助，既講解了硬件的結(jié)構(gòu)，又講述了VHDL語言的應(yīng)用
標(biāo)簽： CPLD VHDL 硬件結(jié)構(gòu) 語言
上傳用戶：leyesome
FPGA相關(guān)硬件仿真程序，編譯環(huán)境QUARTER Ⅱ。
標(biāo)簽： FPGA 硬件仿真 程序
上傳用戶：lanhuaying
蟲蟲下載站版權(quán)所有 京ICP備2021023401號-1
