VerilogHDL硬件描述語言
標(biāo)簽： VerilogHDL 硬件描述語言
上傳時(shí)間： 2013-10-13
上傳用戶：縹緲
介紹了多入多出-正交頻分復(fù)用（MIMO-OFDM）系統(tǒng)，并分析了其發(fā)射機(jī)的實(shí)現(xiàn)原理。充分利用Altera公司Stratix系列現(xiàn)場(chǎng)可編程門陣列（FPGA）芯片和IP（知識(shí)產(chǎn)權(quán)）核，提出了一種切實(shí)可行的MIMO-OFDM基帶系統(tǒng)發(fā)射機(jī)的FPGA實(shí)現(xiàn)方法。重點(diǎn)論述了適合于FPGA實(shí)現(xiàn)的對(duì)角空時(shí)分層編碼（D-BLAST）的方法和實(shí)現(xiàn)原理以及各個(gè)主要模塊的工作原理。并給出了其在ModelSim環(huán)境下的仿真結(jié)果。結(jié)果表明，本設(shè)計(jì)具有設(shè)計(jì)簡(jiǎn)單、快速、高效和實(shí)時(shí)性好等特點(diǎn)。
標(biāo)簽： MIMO-OFDM FPGA 基帶系統(tǒng) 發(fā)射機(jī)
上傳時(shí)間： 2013-10-13
上傳用戶：Aeray
《基于Xilinx FPGA的OFDM通信系統(tǒng)基帶設(shè)計(jì)》附帶的代碼
標(biāo)簽： Xilinx FPGA OFDM 通信系統(tǒng)
上傳時(shí)間： 2014-01-10
上傳用戶：15501536189
硬件描述語言HDL的現(xiàn)狀與發(fā)展
上傳時(shí)間： 2013-10-14
上傳用戶：SimonQQ
基于xscale與FPGA的微小型飛行器控制系統(tǒng)的硬件設(shè)計(jì)---論文
標(biāo)簽： 8eFPGA 飛行器 控制系統(tǒng) 硬件設(shè)計(jì)
上傳時(shí)間： 2013-11-18
上傳用戶：zhouchang199
講述硬件描述語言的前世今生
上傳時(shí)間： 2013-11-19
上傳用戶：qwerasdf
硬件描述語言Verilog教程
標(biāo)簽： verilog_hdl 教程 硬件描述語言
上傳時(shí)間： 2013-12-08
上傳用戶：tianjinfan
為了對(duì)中頻PCM信號(hào)進(jìn)行直接解調(diào)，提出一種全新的數(shù)字化PCM中頻解調(diào)器的設(shè)計(jì)方法。在實(shí)現(xiàn)過程中，采用大規(guī)模的FPGA芯片對(duì)位幀同步器進(jìn)行了融合，便于設(shè)備的集成化和小型化。這種新型的中頻解調(diào)器比傳統(tǒng)的基帶解調(diào)器具有硬件成本低和誤碼率低等優(yōu)點(diǎn)。
標(biāo)簽： FPGA PCM 數(shù)字化 中頻
上傳時(shí)間： 2013-12-17
上傳用戶：ddddddos
隨著SoC設(shè)計(jì)復(fù)雜度的提高，驗(yàn)證已成為集成電路設(shè)計(jì)過程中的瓶頸，而FPGA技術(shù)的快速發(fā)展以及良好的可編程特性使基于FPGA的原型驗(yàn)證越來越多地被用于SoC系統(tǒng)的設(shè)計(jì)過程。本文討論了GPS基帶的驗(yàn)證方案以及基于FPGA的設(shè)計(jì)實(shí)現(xiàn)，并對(duì)驗(yàn)證過程中的問題進(jìn)行了分析，并提出相應(yīng)的解決辦法。
上傳時(shí)間： 2013-10-22
上傳用戶：sxdtlqqjl
本文對(duì)數(shù)字基帶信號(hào)脈沖成型濾波的應(yīng)用、原理及實(shí)現(xiàn)進(jìn)行了研究。首先介紹了數(shù)字成型濾波的應(yīng)用意義并分析了模擬和數(shù)字兩種硬件實(shí)現(xiàn)方法，接著介紹了成形濾波器設(shè)計(jì)所需要MATLAB軟件，以及利用ISE system generator在FPGA上進(jìn)行濾波器實(shí)現(xiàn)的優(yōu)勢(shì)。文中給出了成形濾波函數(shù)的數(shù)學(xué)模型，討論了幾種常用成形濾波函數(shù)的傳輸特性以及對(duì)傳輸系統(tǒng)信號(hào)誤碼率的影響。然后介紹了本次設(shè)計(jì)中使用到的數(shù)字成形濾波器設(shè)計(jì)的幾種FIR濾波器結(jié)構(gòu)。把各種設(shè)計(jì)方案進(jìn)行仿真，比較仿真結(jié)果，最后根據(jù)實(shí)際應(yīng)用的情況并結(jié)合設(shè)計(jì)仿真中出現(xiàn)的問題進(jìn)行分析，得出各種設(shè)計(jì)結(jié)構(gòu)的優(yōu)缺點(diǎn)以及適合應(yīng)用的場(chǎng)合。
標(biāo)簽： FPGA 數(shù)字 成形 濾波器設(shè)計(jì)
上傳時(shí)間： 2013-10-18
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