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lm75A溫度數字轉換器 FPGA讀寫實驗Verilog邏輯源碼Quartus工程文件+文檔資料,FPGA為CYCLONE4系列中的EP4CE6E22C8. 完整的工程文件，可以做為你的學習設計參考。LM75A 是一個使用了內置帶隙溫度傳感器和模數轉換技術的溫度數字轉換器。它也是一個溫度檢測器，可提供一個過熱檢測輸出。LM75A 包含許多數據寄存器：配置寄存器用來存儲器件的某些配置，如器件的工作模式、OS 工作模式、OS 極性和OS 故障隊列等（在功能描述一節中有詳細描述）；溫度寄存器（Temp），用來存儲讀取的數字溫度；設定點寄存器（Tos & Thyst），用來存儲可編程的過熱關斷和滯后限制，器件通過2 線的串行I2C 總線接口與控制器通信。LM75A 還包含一個開漏輸出（OS），當溫度超過編程限制的值時該輸出有效。LM75A 有3 個可選的邏輯地址管腳，使得同一總線上可同時連接8個器件而不發生地址沖突。LM75A 可配置成不同的工作條件。它可設置成在正常工作模式下周期性地對環境溫度進行監控或進入關斷模式來將器件功耗降至最低。OS 輸出有2 種可選的工作模式：OS 比較器模式和OS 中斷模式。OS 輸出可選擇高電平或低電平有效。故障隊列和設定點限制可編程，為了激活OS 輸出，故障隊列定義了許多連續的故障。溫度寄存器通常存放著一個11 位的二進制數的補碼，用來實現0.125℃的精度。這個高精度在需要精確地測量溫度偏移或超出限制范圍的應用中非常有用。正常工作模式下，當器件上電時，OS 工作在比較器模式，溫度閾值為80℃，滯后75℃，這時，LM75A就可用作一個具有以上預定義溫度設定點的獨立的溫度控制器。module LM75_SEG_LED ( //input input sys_clk ,input sys_rst_n ,inout sda_port ,//output output wire seg_c1 ,output wire seg_c2 ,output wire seg_c3 ,output wire seg_c4 ,output reg seg_a ,output reg seg_b ,output reg seg_c ,output reg seg_e ,output reg seg_d ,output reg seg_f ,output reg seg_g ,output reg seg_h , output reg clk_sclk );//parameter define parameter WIDTH = 8;parameter SIZE = 8;//reg define reg [WIDTH-1:0] counter ;reg [9:0] counter_div ;reg clk_50k ;reg clk_200k ;reg sda ;reg enable ;
上傳時間： 2021-10-27
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該文檔為三相逆變器Matlab仿真簡介資料，講解的還不錯，感興趣的可以下載看看…………………………
上傳時間： 2021-10-28
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電路主要包括以下七個單元電路：正弦波產生電路、正弦波放大及電平變換電路、峰值檢測電路、增益控制電路、三角波產生電路、比較電路、低通濾波電路。正弦波產生電路采用文氏橋正弦波振蕩電路，由放大電路、反饋電路（正反饋）、選頻網絡（和反饋電路一起）、穩幅電路構成，它的振蕩頻率為：f=1/(2Π*RC)，由R4和C1構成RC并聯振蕩，產生正弦波，與R5和C2構成選頻網絡，同時R5和C2又構成該電路的正反饋；穩幅電路是由該電路的負反饋構成，當振幅過大時，二極管導通，R3短路，Av=1+（R2+R3）/R1減小，振幅減小，反之Av=1+（R2+R3）/R1增大，振幅增大，達到穩幅效果，從而保證正弦波的正常產生。正弦波放大及電平變換電路由R10，R7分別與R15滑動電阻部分相連，通過滑動R15來分VCC和VEE的電壓，通過放大器正相來抬高或降低正弦波來達到特定范圍內的幅值，滑動電阻R6與地相連，又與放大器反相端相連，滑動R6分壓來改變振幅，后又由R9和R8構成反饋來達到放大的效果，從而達到正弦波放大及電平變化的目的。峰值檢測電路是由正弦波放大及電平變換電路產生的正弦波送入電壓跟隨器的正相端，通過兩個反向二極管后再連電容，快速充放電達到峰值，然后再送回正弦波放大及電平變換電路的反相端，構成負反饋，達到增益穩幅控制效果三角波產生電路主要由兩個NPN型三極管Q3Q4，一個PNP型三極管Q2，兩個電容C3C4，兩個非門，一個滑動電阻R16組成，通過充放電后經過非門產生三角波。比較電路產生的正弦波送入放大器的正相端，產生的三角波送入放大器的反相端，通過作差比較產SPWM波，后又經過由R22和C8組成的低通濾波電路，還原正弦波。
上傳時間： 2021-10-30
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該文檔為基于labview的音樂播放器的設計.講解資料，講解的還不錯，感興趣的可以下載看看…………………………
上傳時間： 2021-11-02
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四路20秒聲光顯示計分搶答器Multisim14仿真源文件+設計文檔資料摘要數字搶答器由主體電路與擴展電路組成。優先編碼電路、鎖存器、譯碼電路將參賽隊的輸入信號在顯示器上輸出；用控制電路和主持人開關啟動報警電路，以上兩部分組成主體電路。通過定時電路和譯碼電路將秒脈沖產生的信號在顯示器上輸出實現計時功能，構成擴展電路。經過布線、焊接、調試等工作后數字搶答器成形。關鍵字：開關陣列電路；觸發鎖存電路；解鎖電路；編碼電路；顯示電路一，設計目的本設計是利用已學過的數電知識，設計的4人搶答器。（1）重溫自己已學過的數電知識；（2）掌握數字集成電路的設計方法和原理；（3）通過完成該設計任務掌握實際問題的邏輯分析，學會對實際問題進行邏輯狀態分配、化簡；（4）掌握數字電路各部分電路與總體電路的設計、調試、模擬仿真方法。二，整體設計（一）設計任務與要求：1.搶答器同時供4名選手或4個代表隊比賽，分別用4個按鈕S0 ~ S3表示。2.設置一個系統清除和搶答控制開關S，該開關由主持人控制。3.搶答器具有鎖存與顯示功能。即選手按動按鈕，鎖存相應的編號，并在LED數碼管上顯示，同時揚聲器發出報警聲響提示。選手搶答實行優先鎖存，優先搶答選手的編號一直保持到主持人將系統清除為止。4.參賽選手在設定的時間內進行搶答，搶答有效，定時器停止工作，顯示器上顯示選手的編號和搶答的時間，并保持到主持人將系統清除為止。5.如果定時時間已到，無人搶答，本次搶答無效。（二）設計原理與參考電路搶答器的組成框圖搶答器的一般組成框圖如下圖所示。它主要由開關陣列電路、觸發鎖存電路、解鎖電路、編碼電路和顯示電路等幾部分組成。
上傳時間： 2021-11-06
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上傳時間： 2021-11-08
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上傳時間： 2021-11-10
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上傳時間： 2021-11-14
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該文檔為基于FPGA的分頻器的設計與實現簡介文檔，是一份很不錯的參考資料，具有較高參考價值，感興趣的可以下載看看………………
標簽： fpga
上傳時間： 2021-11-15
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漏電感在開關電源主回路中一定存在，尤其在變壓器、電感器等中都是不可避免的。過去在討論中一般把它略而不計，設計中更無從考慮。現在隨著開關電源的單機容量和整機容量的日益提高，這個參數影響到開關電源主要的參數，例如，40A/5V輸出的開關電源，電壓損失竟達20%，還影響到開關電源的重量和效率。因此，漏電感問題討論、研究已擺到日程上了。加上脈沖電壓VS（t）到變壓器線圈就產生電流，沿著鐵心磁徑產生閉合的主磁通Φ(t)和部分路徑在鐵心附近的空氣中閉合的漏磁通Φσ（t）。Φ（t）和Φσ（t）將在線圈分別產生感應電動勢e（t）和eσ（t），兩者之和加上電阻壓降與外加電壓相平衡，遵從KVL方程。過去，一般書刊略去eσ（t）， KVL方程簡化為Vs（t）=Δt 。
上傳時間： 2021-11-23
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