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浮點(diǎn)處理器

  • 飛凌嵌入式-LS1043A LS1046A核心板硬件設計手冊

    飛凌嵌入式-LS1043A LS1046A核心板硬件設計手冊第一章 NXP QorIQ LS104xA 簡介 QorIQ? LS104xA 處理器是恩智浦面向嵌入式網絡推出的一款四核 64 位 ARM?處理器。LS1023A (雙 核版本)和 LS104xA (四核版本)可通過支持無風扇設計的靈活 I/O 封裝，提供超過 10 Gbps 的性能。這款 SoC 是專為小規格網絡和工業應用而設計的解決方案，針對經濟型低端 PCB 進行了 BOM 優化，降低了 電源成本，采用了單時鐘設計。全新 0.9V 版本的 LS104xA 和 LS1023A 能夠面向無線 LAN 和以太網供電 系統提供額外的功耗節省。全新 23x23 封裝方式，支持引腳兼容設計，可擴展至 LS1046A (四核 A72 處 理器)。QorIQ LS104xA 能夠提升雙核 32 位 ARM 產品的性能，并且延續了 QorIQ 系列一貫的 I/O 靈活性， 集成了 QUICC Engine?，繼續提供對 HDLC、TDM 或 Profibus 的無縫支持。 FET104xA-C 核心板 CPU 采用的是 LS1043AXE8QQB 和 LS1046AXE8T1A。如下為 LS1043A 和 LS1046A 的應用處理框圖：

    標簽： 嵌入式

    上傳時間： 2022-03-06

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  • GD32F10X系列中文用戶手冊

    GD32F10x系列器件是基于ARM? Cortex?-M3處理器的32位通用微控制器。ARM? Cortex?- M3處理器包括三條AHB總線分別稱為I-CODE總線、D-Code總線和系統總線。Cortex?-M3處 理器的所有存儲訪問，根據不同的目的和目標存儲空間，都會在這三條總線上執行。存儲器的 組織采用了哈佛結構，預先定義的存儲器映射和高達4 GB的存儲空間，充分保證了系統的靈活 性和可擴展性。

    標簽： mcu

    上傳時間： 2022-04-21

    上傳用戶：shjgzh

  • X波段機載相控陣雷達目標模擬器射頻前端研究.

    現代雷達系統日益復雜，在設計、調試雷達系統的過程中，不可避免的需要雷達的回波信號，為了提高雷達設計效率，人們逐漸開始對雷達回波信號模擬技術進行研究，以求用模擬產生的信號代替實際的雷達回波信號，把雷達系統設計和維護過程中所需的費用降到最低。現在，雷達信號模擬技術逐步取得發展，成為雷達技術的一個重要分支，而雷達信號模擬器的研制成為國內外軍事研究領域的熱門方向.所有無線電系統中都會包含射頻前端，射頻前端的主要作用是將基帶信號經過調制、上混頻、放大后送至天線發射，或是將天線接收到的信號放大、下混頻、解調，最后輸出基帶信號.本課題正是對某機載相控陣雷達目標模擬器射頻前端的研究。該射頻前端系統包括兩個部分：發射機通道和射頻功率合成網絡，發射機通道由三條雜波信號通道和一條目標信號通道組成，每條通道相當于一臺射頻發射機.在發射機通道中首先對基帶1、Q信號進行調制，然后兩次上混頻使輸出信號到達x波段。射頻功率合成網絡主要的功能是使用功分器將目標信號一分為四，利用數控衰減器對四路目標信號進行方向圖增益調制，調制后其中一路信號送至天線系統，另外三路分別與三路雜波信號功率合成，最后輸出至雷達，該項目中筆者主要負責對整體方案和指標的論證，多路信號幅相平衡度的調整，x波段0/i移相器的設計與實現，整機的功能指標測試，與其它分機聯調等工作.本文首先介紹了該機載相控陣雷達目標模擬器的整體方案，然后對無線發射機系統進行了分析，接下來對射頻前端方案進行論證，之后詳述了多路信號幅相校正的方法與0/n移相器的研制，給出了射頻前端系統的測試結果.

    標簽： 雷達

    上傳時間： 2022-06-20

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  • 使8051能訪問整個128KB的RAM空間和128KB的FlashRom空間,在CPLD內建兩個寄存器\r\n

    8051工作于11.0592MHZ,RAM擴展為128KB的628128,FlashRom擴展為128KB的AT29C010A\r\n 128KB的RAM分成4個區(Bank) 地址分配為0x0000-0x7FFF\r\n 128KB的FlashRom分成8個區(Bank) 地址分配為0x8000-0xBFFF\r\n 為了使8051能訪問整個128KB的RAM空間和128KB的FlashRom空間,在CPLD內建兩個寄存器\r\n RamBankReg和FlashRomBankReg用于存放高位地址

    標簽： 128 FlashRom 8051 KB

    上傳時間： 2013-08-30

    上傳用戶：cainaifa

  • 本人自已寫的一個24點的計算器 希望大家多多的幫我改正。 有什麼更好的算法

    本人自已寫的一個24點的計算器 希望大家多多的幫我改正。 有什麼更好的算法，還請指點!

    標簽： 家 正 算法

    上傳時間： 2014-01-25

    上傳用戶：z754970244

  • 一個費諾編碼器,輸入N個總和為1的小數,就可以得到N個費諾碼

    一個費諾編碼器,輸入N個總和為1的小數,就可以得到N個費諾碼

    標簽： 編碼器 輸入

    上傳時間： 2013-12-16

    上傳用戶：LouieWu

  • verilog浮點乘發器

    verilog浮點乘發器，特定數據結構，指數底為10

    標簽： verilog 浮點

    上傳時間： 2013-12-20

    上傳用戶：chenbhdt

  • verilog浮點乘發器

    verilog浮點乘發器，特定數據結構，指數底為10,利用pipeline

    標簽： verilog 浮點

    上傳時間： 2013-12-24

    上傳用戶：ljmwh2000

  • verilog浮點乘發器

    verilog浮點乘發器，特定數據結構，指數底為10,利用pipeline

    標簽： verilog 浮點

    上傳時間： 2013-12-27

    上傳用戶：thinode

  • verilog浮點乘發器

    verilog浮點乘發器，特定數據結構，指數底為10

    標簽： verilog 浮點

    上傳時間： 2014-01-26

    上傳用戶：dengzb84

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